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Datasheet > 存储 > SRAM> CY7C017A-20JC
CY7C017A-20JC PDF预览

CY7C017A-20JC

更新时间： 2024-09-17 00:01:31
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 存储内存集成电路静态存储器
页数 文件大小 规格书
20页 422K
描述
32K/16K x8, 32K/16K x9 Dual-Port Static RAM

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CY7C017A-20JC 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：LCC
包装说明：PLASTIC, LCC-68针数：68
Reach Compliance Code：compliantECCN代码：3A991.B.2.B
HTS代码：8542.32.00.41风险等级：5.92
Is Samacsys：N最长访问时间：20 ns
I/O 类型：COMMONJESD-30 代码：S-PQCC-J68
JESD-609代码：e0长度：24.2316 mm
内存密度：294912 bit内存集成电路类型：DUAL-PORT SRAM
内存宽度：9功能数量：1
端口数量：2端子数量：68
字数：32768 words字数代码：32000
工作模式：ASYNCHRONOUS最高工作温度：70 °C
最低工作温度：组织：32KX9
输出特性：3-STATE封装主体材料：PLASTIC/EPOXY
封装代码：QCCJ封装等效代码：LDCC68,1.0SQ
封装形状：SQUARE封装形式：CHIP CARRIER
并行/串行：PARALLEL峰值回流温度（摄氏度）：225
电源：5 V认证状态：Not Qualified
座面最大高度：5.08 mm最大待机电流：0.0005 A
最小待机电流：4.5 V子类别：SRAMs
最大压摆率：0.275 mA最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：TIN LEAD
端子形式：J BEND端子节距：1.27 mm
端子位置：QUAD处于峰值回流温度下的最长时间：30
宽度：24.2316 mmBase Number Matches：1

CY7C017A-20JC 数据手册

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CY7C006A  
CY7C007A  
CY7C017A32K/16K  
x 8, 32K x 9  
Dual-Port Static RAM  
CY7C006A/CY7C007A  
CY7C016A/CY7C017A  
32K/16K x8, 32K/16K x9  
Dual-Port Static RAM  
Features  
• True dual-ported memory cells which allow  
• Automatic power-down  
• Expandable data bus to 16/18 bits or more using  
Master/Slave chip select when using more than one  
device  
simultaneous access of the same memory location  
• 16K x 8 organization (CY7C006A)  
• 32K x 8 organization (CY7C007A)  
• 16K x 9 organization (CY7C016A)  
• 32K x 9 organization (CY7C017A)  
• 0.35-micron CMOS for optimum speed/power  
• High-speed access: 12[1]/15/20 ns  
• Low operating power  
— Active: ICC = 180 mA (typical)  
— Standby: ISB3 = 0.05 mA (typical)  
• Fully asynchronous operation  
• On-chip arbitration logic  
• Semaphores included to permit software handshaking  
between ports  
• INT flags for port-to-port communication  
• Pin select for Master or Slave  
• Commercial temperature range  
• Available in 68-pin PLCC (CY7C006A, CY7C007A and  
CY7C017A), 64-pin TQFP (CY7C006A), and in 80-pin  
TQFP (CY7C007A and CY7C016A)  
Logic Block Diagram  
R/WL  
R/WR  
CER  
CEL  
OEL  
OER  
8/9  
[2]  
I/O0L–I/O7/8L  
8/9  
[2]  
I/O0R–I/O7/8R  
I/O  
I/O  
Control  
Control  
14/15  
14/15  
Address  
Decode  
Address  
Decode  
True Dual-Ported  
[4]  
[4]  
A0L–A13/14L  
A0R–A13/14R  
RAM Array  
14/15  
14/15  
[4]  
[4]  
A0L–A13/14L  
CEL  
OEL  
R/WL  
A0R–A13/14R  
CER  
Interrupt  
Semaphore  
Arbitration  
OER  
R/WR  
SEML  
BUSYL  
INTL  
SEMR  
[3]  
[3] BUSYR  
INTR  
M/S  
For the most recent information, visit the Cypress web site at www.cypress.com  
Notes:  
1. See page 7 for Load Conditions.  
2. I/O –I/O for x8 devices; I/O –I/O for x9 devices.  
0
7
0
8
3. BUSY is an output in master mode and an input in slave mode.  
4. A –A for 16K; A –A for 32K devices.  
0
13  
0
14  
Cypress Semiconductor Corporation  
•
3901 North First Street  
•
San Jose  
•
CA 95134  
•
408-943-2600  
Document #: 38-06045 Rev. *C  
Revised April 11, 2005  
1234567...20

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与CY7C017A-20JC相关器件

型号 品牌 获取价格 描述 数据表
CY7C017A-20JXC CYPRESS

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 		Dual-Port SRAM, 32KX9, 20ns, CMOS, PQCC68, PLASTIC, LCC-68
CY7C017AV CYPRESS

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 		3.3V 4K/8K/16K/32K x 8/9 Dual-Port Static RAM
CY7C017AV-20JC CYPRESS

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 		3.3V 4K/8K/16K/32K x 8/9 Dual-Port Static RAM
CY7C017AV-20JI CYPRESS

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 		3.3V 4K/8K/16K/32K x 8/9 Dual-Port Static RAM
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 		3.3V 4K/8K/16K/32K x 8/9 Dual-Port Static RAM
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 		Dual-Port SRAM, 32KX9, 25ns, CMOS, PQCC68, PLASTIC, LCC-68
CY7C017V-25JIR CYPRESS

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 		Multi-Port SRAM, 32KX9, 25ns, CMOS, PQCC68, PLASTIC, LCC-68
CY7C017V-25JIT CYPRESS

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 		Dual-Port SRAM, 32KX9, 25ns, CMOS, PQCC68, PLASTIC, LCC-68
CY7C018 CYPRESS

获取价格

 		64K/128K x 8/9 Dual-Port Static RAM

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