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CY24142ZC-01

更新时间： 2024-01-01 17:17:00

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赛普拉斯 - CYPRESS		晶体时钟发生器微控制器和处理器外围集成电路光电二极管
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7页	130K
描述
MediaClock Multimedia Clock Generator

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CY24142ZC-01 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	TSSOP	包装说明：	4.40 MM, MO-153, TSSOP-16
针数：	16	Reach Compliance Code：	not_compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.84	JESD-30 代码：	R-PDSO-G16
JESD-609代码：	e0	长度：	5 mm
端子数量：	16	最高工作温度：	85 °C
最低工作温度：		最大输出时钟频率：	54 MHz
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装等效代码：	TSSOP16,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	3.45 V	主时钟/晶体标称频率：	18.432 MHz
认证状态：	Not Qualified	座面最大高度：	1.1 mm
子类别：	Clock Generators	最大压摆率：	25 mA
最大供电电压：	3.6 V	最小供电电压：	3.15 V
标称供电电压：	3.45 V	表面贴装：	YES
技术：	CMOS	温度等级：	OTHER
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	4.4 mm
uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, VIDEO	Base Number Matches：	1

CY24142ZC-01 数据手册

CY24142

Pin Description

Pin Name

Pin Number

Pin Description

XIN

V_DD

AV_DD

OE1

Crystal Input.

Voltage Supply.

Analog Voltage Supply.

Output Enable 1, 0 = CLK 2 and CLK3 off, 1 = CLK 2 and CLK3 on; weak internal

pull-down.

AV_SS

V_SSL

Analog Ground.

V_DDLGround.

No Connect; leave floating.

CLK1

CLK2

OE2

V_DDL

13.5-MHz Clock Output.

54-MHz Clock Output; controlled by OE1.

Output Enable 2, 0 = CLK4 off, 1 = CLK4 on; weak internal pull-down.

Voltage Supply.

No Connect; leave floating.

Ground.

18.432-MHz Buffered Reference Output, controlled by OE1.

18.432-MHz Buffered Reference Output, controlled by OE2.

Crystal Output.

V_SS

CLK3

CLK4

XOUT

Layout Recommendations

The X_INand X_OUTtraces and pads as well as the crystal

should be placed away from any clock traces or noise sources.

Noise coupling into the X_INand X_OUTtraces may cause

start-up problems. A pad for a resistor to ground should be laid

out on the X_OUTtrace to be stuffed if necessary, in case

start-up issues occur.

Document #: 38-07532 Rev. *B

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型号	品牌	描述	获取价格	数据表
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