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Datasheet > 信号电路 > 锁相环或频率合成电路> CD74HCT7046AM
CD74HCT7046AM PDF预览

CD74HCT7046AM

更新时间： 2024-02-17 05:29:12
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德州仪器 - TI 光电二极管
页数 文件大小 规格书
26页 301K
描述
Phase-Locked Loop with VCO and Lock Detector

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CD74HCT7046AM 技术参数

是否无铅：不含铅是否Rohs认证：符合
生命周期：Active零件包装代码：SOIC
包装说明：SOIC-16针数：16
Reach Compliance Code：compliantHTS代码：8542.39.00.01
Factory Lead Time：1 week风险等级：5.14
Is Samacsys：N模拟集成电路 - 其他类型：PHASE LOCKED LOOP
JESD-30 代码：R-PDSO-G16JESD-609代码：e4
长度：9.9 mm湿度敏感等级：1
功能数量：1端子数量：16
最高工作温度：125 °C最低工作温度：-55 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP16,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：260
电源：5 V认证状态：Not Qualified
座面最大高度：1.58 mm子类别：PLL or Frequency Synthesis Circuits
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：3.91 mm
Base Number Matches：1

CD74HCT7046AM 数据手册

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PHASE  
SUBJECT  
COMPARATOR  
DESIGN CONSIDERATIONS  
o
PLL Conditions with  
No Signal at the  
SIG Input  
IN  
PC1  
PC2  
VCO adjusts to f with φDEMOUT = 90 and V  
= 1/2 V  
(see Figure 2)  
CC  
o
VCOIN  
o
VCO adjusts to f  
with φDEMOUT = -360 and V  
= 0V (see Figure 4)  
MIN  
VCOIN  
PLL Frequency  
Capture Range  
PC1 or PC2  
Loop Filter Component Selection  
|F  
|
)
(j  
ω
R3  
-1/  
τ
C2  
INPUT  
OUTPUT  
ω
(B) AMPLITUDE CHARACTERISTIC  
(C) POLE-ZERO DIAGRAM  
1/2  
(A) τ1 = R3 x C2  
A small capture range (2f ) is obtained if τ > 2f ≈ (1/π) (2πf /τ1.)  
c
c
L
FIGURE 48. SIMPLE LOOP FILTER FOR PLL WITHOUT OFFSET  
R3  
|F  
|
)
(j  
ω
R4  
m =  
R4  
C2  
R3 + R4  
INPUT  
OUTPUT  
-1/  
-1/  
3
2
τ
τ
m
1/  
1/  
2
ω
3
τ
τ
(B) AMPLITUDE CHARACTERISTIC  
(C) POLE-ZERO DIAGRAM  
(A) τ2 = R4 x C2;  
τ3 = (R3 + R4) x C2  
FIGURE 49. SIMPLE LOOP FILTER FOR PLL WITH OFFSET  
PLL Locks on  
Harmonics at Center  
Frequency  
PC1  
PC2  
Yes  
No  
Noise Rejection at  
Signal Input  
PC1  
PC2  
PC1  
PC2  
High  
Low  
o
AC Ripple Content  
when PLL is Locked  
f = 2f , large ripple content at φDEMOUT = 90  
r i  
o
f = f , small ripple content at φDEMOUT = 0  
r
i
Lock Detector Circuit  
The lock detector feature is very useful in data synchroniza-  
tion, motor speed control, and demodulation. By adjusting  
the value of the lock detector capacitor so that the lock out-  
put will change slightly before actually losing lock, the  
designer can create an “early warning” indication allowing  
corrective measures to be implemented. The reverse is also  
true, especially with motor speed controls, generators, and  
clutches that must be set up before actual lock occurs or dis-  
connected during loss of lock.  
When using phase comparator 1, the detector will only indi-  
cate a lock condition on the fundamental frequency and not  
on the harmonics, which PC1 will lock on.  
21  
1...18192021222324...26

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CD74HCT7046AM 替代型号

型号 品牌 替代类型 描述 数据表
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