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74LVT125PW

更新时间： 2024-09-11 11:10:51

品牌	Logo	应用领域
安世 - NEXPERIA		PC 驱动信息通信管理光电二极管逻辑集成电路
页数	文件大小	规格书
13页	238K
描述
3.3 V quad buffer; 3-stateProduction

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74LVT125PW 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	TSSOP,	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.58
Samacsys Confidence：	3	Samacsys Status：	Released
Samacsys PartID：	4913	Samacsys Pin Count：	14
Samacsys Part Category：	Integrated Circuit	Samacsys Package Category：	Small Outline Packages
Samacsys Footprint Name：	SOT401-1(TSSOP14)	Samacsys Released Date：	2015-04-16 09:48:08
Is Samacsys：	N	系列：	LVT
JESD-30 代码：	R-PDSO-G14	JESD-609代码：	e4
长度：	5 mm	逻辑集成电路类型：	BUS DRIVER
湿度敏感等级：	1	位数：	1
功能数量：	4	端口数量：	2
端子数量：	14	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	传播延迟（tpd）：	4.9 ns
座面最大高度：	1.1 mm	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	2.7 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	BICMOS
温度等级：	INDUSTRIAL	端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	宽度：	4.4 mm
Base Number Matches：	1

74LVT125PW 数据手册

74LVT125; 74LVTH125

3.3 V quad buffer; 3-state

Rev. 8 — 18 August 2021

Product data sheet

1. General description

The 74LVT125; 74LVTH125 is a quad buffer/line driver with 3-state outputs controlled by the output

enable inputs (nOE). A HIGH on nOE causes the outputs to assume a high impedance OFF-state.

Bus hold data inputs eliminate the need for external pull-up resistors to define unused inputs. This

device is fully specified for partial power down applications using I_OFF. The I_OFFcircuitry disables

the output, preventing the potentially damaging backflow current through the device when it is

powered down.

2. Features and benefits

•

Quad bus interface

3-state buffers

•

Wide supply voltage range from 2.7 to 3.6 V

BiCMOS high speed and output drive

Output capability: +64 mA and -32 mA

Direct interface with TTL levels

Overvoltage tolerant inputs to 5.5 V

Bus hold data inputs eliminate need for external pull-up resistors to hold unused inputs

Live insertion and extraction permitted

No bus current loading when output is tied to 5 V bus

Power-up 3-state

I_OFFcircuitry provides partial Power-down mode operation

Latch-up performance exceeds 500 mA per JESD 78 Class II Level B

Complies with JEDEC standard JESD8C (2.7 V to 3.6 V)

ESD protection:

•

HBM EIA/JESD22-A114-A exceeds 2000V

MM EIA/JESD22-A115-A exceeds 200V

•

Specified from -40 °C to 85 °C

3. Ordering information

Table 1. Ordering information

Type number

Package

Temperature range Name

Description

Version

74LVT125D

-40 °C to +85 °C

SO14

plastic small outline package; 14 leads;

body width 3.9 mm

SOT108-1

74LVTH125D

74LVT125PW

74LVTH125PW

74LVT125BQ

74LVTH125BQ

TSSOP14

plastic thin shrink small outline package; 14 leads;

body width 4.4 mm

SOT402-1

SOT762-1

DHVQFN14 plastic dual in-line compatible thermal enhanced

very thin quad flat package; no leads; 14 terminals;

body 2.5 × 3 × 0.85 mm

12 3 4 5 6 7...13

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74LVT125PW 替代型号

型号	品牌	替代类型	描述	数据表
SN74LVTH125PWR	TI	类似代替	3.3-V ABT QUADRUPLE BUS BUFFERS WITH 3-STATE OUTPUTS
SN74LVT125PW	TI	类似代替	3.3-V ABT QUADRUPLE BUS BUFFERS WITH 3-STATE OUTPUTS
SN74LVT125QPWRG4Q1	TI	功能相似	3.3-V ABT QUADRUPLE BUS BUFFER WITH 3-STATE OUTPUTS

与74LVT125PW相关器件

型号	品牌	获取价格	描述	数据表
74LVT125PW,112	NXP	获取价格	74LVT(H)125 - 3.3 V quad buffer; 3-state TSSOP 14-Pin
74LVT125PW,118	NXP	获取价格	74LVT(H)125 - 3.3 V quad buffer; 3-state TSSOP 14-Pin
74LVT125PWDH	NXP	获取价格	3.3V Quad buffer 3-State
74LVT125PWDH-T	NXP	获取价格	IC LVT SERIES, QUAD 1-BIT DRIVER, TRUE OUTPUT, PDSO14, Bus Driver/Transceiver
74LVT125PW-T	ETC	获取价格	4-Bit Buffer/Driver
74LVT125SJ	TI	获取价格	LVT SERIES, QUAD 1-BIT DRIVER, TRUE OUTPUT, PDSO14, 0.300 INCH, EIAJ TYPE2, PLASTIC, SOIC-
74LVT125SJ	FAIRCHILD	获取价格	Bus Driver, 1-Func, 4-Bit, True Output, BICMOS, PDSO14,
74LVT125SJX	TI	获取价格	LVT SERIES, QUAD 1-BIT DRIVER, TRUE OUTPUT, PDSO14, 0.300 INCH, EIAJ TYPE2, PLASTIC, SOIC-
74LVT126	NXP	获取价格	3.3V Quad buffer 3-State
74LVT126_1	NXP	获取价格	3.3 V quad buffer; 3-state

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