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74HCT259PW,118 PDF预览

74HCT259PW,118

更新时间： 2024-11-20 19:50:55
品牌 Logo 应用领域
恩智浦 - NXP /
页数 文件大小 规格书
21页 116K
描述
74HC(T)259 - 8-bit addressable latch TSSOP 16-Pin

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74HCT259PW,118 技术参数

是否Rohs认证： 符合生命周期：Transferred
零件包装代码：TSSOP包装说明：4.40 MM, PLASTIC, MO-153, SOT-403-1, TSSOP-16
针数：16Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：7.13
其他特性：1:8 DMUX FOLLOWED BY LATCH系列：HCT
JESD-30 代码：R-PDSO-G16JESD-609代码：e4
长度：5 mm负载电容（CL）：50 pF
逻辑集成电路类型：D LATCH最大I（ol）：0.00002 A
湿度敏感等级：1位数：1
功能数量：1端子数量：16
最高工作温度：125 °C最低工作温度：-40 °C
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP16,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：260
电源：5 VProp。Delay @ Nom-Sup：59 ns
传播延迟（tpd）：57 ns认证状态：Not Qualified
座面最大高度：1.1 mm子类别：FF/Latches
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：AUTOMOTIVE
端子面层：NICKEL PALLADIUM GOLD端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30触发器类型：LOW LEVEL
宽度：4.4 mmBase Number Matches：1

74HCT259PW,118 数据手册

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74HC259; 74HCT259  
8-bit addressable latch  
Rev. 04 — 25 February 2009  
Product data sheet  
1. General description  
The 74HC259; 74HCT259 are high-speed Si-gate CMOS devices and are pin compatible  
with Low-power Schottky TTL (LSTTL). They are specified in compliance with JEDEC  
standard No. 7-A.  
The 74HC259; 74HCT259 are high-speed 8-bit addressable latches designed for general  
purpose storage applications in digital systems. They are multifunctional devices capable  
of storing single-line data in eight addressable latches and providing a 3-to-8 decoder and  
multiplexer function with active HIGH outputs (Q0 to Q7). They also incorporates an active  
LOW common reset (MR) for resetting all latches as well as an active LOW enable input  
(LE).  
The 74HC259; 74HCT259 has four modes of operation:  
• Addressable latch mode, in this mode data on the data line (D) is written into the  
addressed latch. The addressed latch will follow the data input with all non-addressed  
latches remaining in their previous states.  
• Memory mode, in this mode all latches remain in their previous states and are  
unaffected by the data or address inputs.  
• Demultiplexing mode (or 3-to-8 decoding), in this mode the addressed output follows  
the state of the data input (D) with all other outputs in the LOW state.  
• Reset mode, in this mode all outputs are LOW and unaffected by the address inputs  
(A0 to A2) and data input (D).  
When operating the 74HC259; 74HCT259 as an address latch, changing more than one  
address bit could impose a transient wrong address. Therefore, this should only be done  
while in the Memory mode.  
2. Features  
I Combined demultiplexer and 8-bit latch  
I Serial-to-parallel capability  
I Output from each storage bit available  
I Random (addressable) data entry  
I Easily expandable  
I Common reset input  
I Useful as a 3-to-8 active HIGH decoder  
I Input levels:  
N For 74HC259: CMOS level  
N For 74HCT259: TTL level  
 
 
1234567...21

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74HCT259PW,118 替代型号

型号 品牌 替代类型 描述 数据表
74HCT259D,653 NXP

完全替代

 74HC(T)259 - 8-bit addressable latch SOP 16-Pin
74HCT259N,652 NXP

完全替代

 74HC(T)259 - 8-bit addressable latch DIP 16-Pin

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