74HC73PW

更新时间： 2024-11-10 22:53:15

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恩智浦 - NXP		触发器逻辑集成电路光电二极管
页数	文件大小	规格书
21页	108K
描述
Dual JK flip-flop with reset; negative-edge trigger

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74HC73PW 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Transferred	零件包装代码：	TSSOP
包装说明：	4.40 MM, PLASTIC, MO-153, SOT-402-1, TSSOP-14	针数：	14
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.29	其他特性：	MASTER SLAVE OPERATION
系列：	HC/UH	JESD-30 代码：	R-PDSO-G14
JESD-609代码：	e4	长度：	5 mm
负载电容（CL）：	50 pF	逻辑集成电路类型：	J-K FLIP-FLOP
最大频率@ Nom-Sup：	20000000 Hz	最大I（ol）：	0.004 A
湿度敏感等级：	1	位数：	2
功能数量：	2	端子数量：	14
最高工作温度：	125 °C	最低工作温度：	-40 °C
输出极性：	COMPLEMENTARY	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP14,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	电源：	2/6 V
传播延迟（tpd）：	240 ns	认证状态：	Not Qualified
座面最大高度：	1.1 mm	子类别：	FF/Latches
最大供电电压 (Vsup)：	6 V	最小供电电压 (Vsup)：	2 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	AUTOMOTIVE
端子面层：	NICKEL PALLADIUM GOLD	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	触发器类型：	NEGATIVE EDGE
宽度：	4.4 mm	最小 fmax：	24 MHz

74HC73PW 数据手册

74HC73

Dual JK ﬂip-ﬂop with reset; negative-edge trigger

Rev. 03 — 12 November 2004

Product data sheet

1. General description

The 74HC73 is a high-speed Si-gate CMOS device and is pin compatible with low-power

Schottky TTL (LSTTL). The 74HC73 is speciﬁed in compliance with JEDEC

standard no. 7A.

The 74HC is a dual negative-edge triggered JK ﬂip-ﬂop featuring individual J, K, clock

(nCP) and reset (nR) inputs; also complementary nQ and nQ outputs.

The J and K inputs must be stable one set-up time prior to the HIGH-to-LOW clock

transition for predictable operation.

The reset (nR) is an asynchronous active LOW input. When LOW, it overrides the clock

and data inputs, forcing the nQ output LOW and the nQ output HIGH.

Schmitt-trigger action in the clock input makes the circuit highly tolerant to slower clock

rise and fall times.

2. Features

■ Low-power dissipation

■ Complies with JEDEC standard no. 7A

■ ESD protection:

◆ HBM EIA/JESD22-A114-B exceeds 2000 V

◆ MM EIA/JESD22-A115-A exceeds 200 V.

■ Multiple package options

■ Speciﬁed from −40 °C to +80 °C and from −40 °C to +125 °C.

12 3 4 5 6 7...21

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74HC73PW 替代型号

型号	品牌	替代类型	描述	数据表
74HC107PW,118	NXP	完全替代	74HC(T)107 - Dual JK flip-flop with reset; negative-edge trigger TSSOP 14-Pin

与74HC73PW相关器件

型号	品牌	获取价格	描述	数据表
74HC73PW-T	NXP	获取价格	IC HC/UH SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO14,
74HC73U	NXP	获取价格	IC HC/UH SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, UUC, DI
74HC74	ONSEMI	获取价格	Dual D Flip−Flop with Set and Reset High−Performance Silicon−Gate CMOS
74HC74	NXP	获取价格	Dual D-type flip-flop with set and reset; positive-edge trigger
74HC74	HGSEMI	获取价格	具有清零和预置端的双路负边沿触发式 D 型触发器
74HC7403	NXP	获取价格	4-Bit x 64-word FIFO register; 3-state
74HC7403D	NXP	获取价格	4-Bit x 64-word FIFO register; 3-state
74HC7403D	PHILIPS	获取价格	FIFO, 64X4, 98ns, Asynchronous, CMOS, PDSO16
74HC7403D,512	NXP	获取价格	74HC(T)7403 - 4-Bit x 64-word FIFO register; 3-state SOP 16-Pin
74HC7403D,518	NXP	获取价格	74HC(T)7403 - 4-Bit x 64-word FIFO register; 3-state SOP 16-Pin

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