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74ALVC374D

更新时间： 2024-11-07 11:10:23
品牌 Logo 应用领域
安世 - NEXPERIA 驱动光电二极管逻辑集成电路
页数 文件大小 规格书
15页 271K
描述
Octal D-type flip-flop; positive-edge trigger; 3-stateProduction

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74ALVC374D 技术参数

是否Rohs认证： 符合生命周期：Active
包装说明：SOP,Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.27
系列：ALVC/VCX/AJESD-30 代码：R-PDSO-G20
JESD-609代码：e4长度：12.8 mm
逻辑集成电路类型：BUS DRIVER湿度敏感等级：1
位数：8功能数量：1
端口数量：2端子数量：20
最高工作温度：85 °C最低工作温度：-40 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：260传播延迟（tpd）：6.4 ns
认证状态：Not Qualified座面最大高度：2.65 mm
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：1.65 V
标称供电电压 (Vsup)：2.7 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30宽度：7.5 mm
Base Number Matches：1

74ALVC374D 数据手册

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74ALVC374  
Octal D-type flip-flop; positive-edge trigger; 3-state  
Rev. 4 — 10 July 2023  
Product data sheet  
1. General description  
The 74ALVC374 is an octal positive-edge triggered D-type flip-flop with 3-state outputs. The  
device features a clock (CP) and output enable (OE) inputs. The flip-flops will store the state of  
their individual D-inputs that meet the set-up and hold time requirements on the LOW-to-HIGH  
clock (CP) transition. A HIGH on OE causes the outputs to assume a high-impedance OFF-state.  
Operation of the OE input does not affect the state of the flip-flops.  
Schmitt trigger action on all inputs makes the device tolerant of slow rise and fall times.  
This device is fully specified for partial power down applications using IOFF. The IOFF circuitry  
disables the output, preventing the potentially damaging backflow current through the device when  
it is powered down.  
2. Features and benefits  
•
Wide supply voltage range from 1.65 V to 3.6 V  
•
•
•
•
•
•
CMOS low power dissipation  
Overvoltage tolerant inputs to 3.6 V  
Direct interface with TTL levels  
IOFF circuitry provides partial Power-down mode operation  
Latch-up performance exceeds 250 mA per JESD78 Class II.A  
Complies with JEDEC standards:  
•
•
•
JESD8-7 (1.65 V to 1.95 V)  
JESD8-5 (2.3 V to 2.7 V)  
JESD8C/JESD36 (2.7 V to 3.6 V)  
•
ESD protection:  
•
•
HBM: ANSI/ESDA/JEDEC JS-001 class 2 exceeds 2000 V  
CDM: ANSI/ESDA/JEDEC JS-002 class C3 exceeds 1000 V  
•
•
Multiple package options  
Specified from -40 °C to +85 °C and from -40 °C to +125 °C  
3. Ordering information  
Table 1. Ordering information  
Type number  
Package  
Temperature range Name  
Description  
Version  
74ALVC374D  
-40 °C to +125 °C  
SO20  
plastic small outline package; 20 leads;  
body width 7.5 mm  
SOT163-1  
74ALVC374PW -40 °C to +125 °C  
74ALVC374BQ -40 °C to +125 °C  
TSSOP20  
plastic thin shrink small outline package; 20 leads;  
body width 4.4 mm  
SOT360-1  
SOT764-1  
DHVQFN20 plastic dual in-line compatible thermal enhanced  
very thin quad flat package; no leads; 20 terminals;  
body 2.5 × 4.5 × 0.85 mm  
 
 
 
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型号 品牌 获取价格 描述 数据表
74ALVC374D,118 NXP

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 		74ALVC374 - Octal D-type flip-flop; positive-edge trigger; 3-state SOP 20-Pin
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 		Octal D-type flip-flop positive edge-trigger
74ALVC374PW NEXPERIA

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