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74AHC573PW

更新时间： 2024-09-14 11:10:39

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安世 - NEXPERIA		驱动光电二极管逻辑集成电路
页数	文件大小	规格书
16页	276K
描述
Octal D-type transparent latch; 3-stateProduction

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74AHC573PW 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	TSSOP,	Reach Compliance Code：	compliant
风险等级：	5.12	系列：	AHC/VHC/H/U/V
JESD-30 代码：	R-PDSO-G20	JESD-609代码：	e4
长度：	6.5 mm	逻辑集成电路类型：	BUS DRIVER
湿度敏感等级：	1	位数：	8
功能数量：	1	端口数量：	2
端子数量：	20	最高工作温度：	125 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	260
传播延迟（tpd）：	19.5 ns	座面最大高度：	1.1 mm
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	2 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	AUTOMOTIVE
端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	4.4 mm
Base Number Matches：	1

74AHC573PW 数据手册

74AHC573; 74AHCT573

Octal D-type transparent latch; 3-state

Rev. 8 — 13 July 2020

Product data sheet

1. General description

The 74AHC573; 74AHCT573 is an 8-bit D-type transparent latch with 3-state outputs. The device

features latch enable (LE) and output enable (OE) inputs. When LE is HIGH, data at the inputs

enter the latches. In this condition the latches are transparent, a latch output will change each time

its corresponding D-input changes. When LE is LOW the latches store the information that was

present at the inputs a set-up time preceding the HIGH-to-LOW transition of LE. A HIGH on OE

causes the outputs to assume a high-impedance OFF-state. Operation of the OE input does not

affect the state of the latches. Inputs are overvoltage tolerant. This feature allows the use of these

devices as translators in mixed voltage environments.

2. Features and benefits

•

Wide supply voltage range from 2.0 V to 5.5 V

•

Balanced propagation delays

All inputs have Schmitt-trigger action

Overvoltage tolerant inputs to 5.5 V

High noise immunity

CMOS low power dissipation

Common 3-state output enable input

Functionally identical to the 74AHC373; 74AHCT373

Input levels:

•

For 74AHC573: CMOS input level

For 74AHCT573: TTL input level

•

ESD protection:

•

HBM JESD22-A114F exceeds 2000 V

MM JESD22-A115-A exceeds 200 V

CDM JESD22-C101E exceeds 1000 V

•

Latch-up performance exceeds 100 mA per JESD 78 Class II Level A

Multiple package options

Specified from -40 °C to +85 °C and from -40 °C to +125 °C

12 3 4 5 6 7...16

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74AHC573PW 替代型号

型号	品牌	替代类型	描述	数据表
74AHC573PW,118	NXP	功能相似	74AHC(T)573 - Octal D-type transparant latch; 3-state TSSOP2 20-Pin
SN74AHC573PWR	TI	功能相似	OCTAL TRANSPARENT D- TYPE LATCHES WITH 3 STATE OUTPUTS
SN74AHC573PW	TI	功能相似	OCTAL TRANSPARENT D- TYPE LATCHES WITH 3 STATE OUTPUTS

与74AHC573PW相关器件

型号	品牌	获取价格	描述	数据表
74AHC573PW,112	NXP	获取价格	74AHC(T)573 - Octal D-type transparant latch; 3-state TSSOP2 20-Pin
74AHC573PW,118	NXP	获取价格	74AHC(T)573 - Octal D-type transparant latch; 3-state TSSOP2 20-Pin
74AHC573PW/T3	NXP	获取价格	IC AHC/VHC/H/U/V SERIES, 8-BIT DRIVER, TRUE OUTPUT, PDSO20, 4.40 MM, PLASTIC, MO-153, SOT-
74AHC573PWDH	NXP	获取价格	Octal D-type transparent latch; 3-state
74AHC573PW-Q100	NXP	获取价格	IC DRIVER, Bus Driver/Transceiver
74AHC573PW-Q100	NEXPERIA	获取价格	Octal D-type transparant latch 3-state
74AHC573-Q100	NEXPERIA	获取价格	Octal D-type transparant latch 3-state
74AHC574	NXP	获取价格	Octal D-type flip-flop; positive edge-trigger; 3-state
74AHC574BQ	NXP	获取价格	Octal D-type flip-flop; positive edge-trigger; 3-state
74AHC574BQ	NEXPERIA	获取价格	Octal D-type flip-flop; positive-edge trigger; 3-stateProduction

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