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74AHC574PW

更新时间： 2024-09-14 11:12:19

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安世 - NEXPERIA		驱动光电二极管逻辑集成电路触发器
页数	文件大小	规格书
18页	650K
描述
Octal D-type flip-flop; positive-edge trigger; 3-stateProduction

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74AHC574PW 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	TSSOP,	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.1
其他特性：	BROADSIDE VERSION OF 374	系列：	AHC/VHC/H/U/V
JESD-30 代码：	R-PDSO-G20	JESD-609代码：	e4
长度：	6.5 mm	逻辑集成电路类型：	BUS DRIVER
湿度敏感等级：	1	位数：	8
功能数量：	1	端口数量：	2
端子数量：	20	最高工作温度：	125 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	260
传播延迟（tpd）：	21 ns	认证状态：	Not Qualified
座面最大高度：	1.1 mm	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	2 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	AUTOMOTIVE	端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	4.4 mm	Base Number Matches：	1

74AHC574PW 数据手册

74AHC574; 74AHCT574

Octal D-type ﬂip-ﬂop; positive edge-trigger; 3-state

Rev. 02 — 24 January 2008

Product data sheet

1. General description

The 74AHC574; 74AHCT574 are high-speed Si-gate CMOS devices and are pin

compatible with Low Power Schottky TTL (LSTTL). They are speciﬁed in compliance with

JEDEC standard no. 7A.

The 74AHC574; 74AHCT574 are octal D-type ﬂip-ﬂops featuring separate D-type inputs

for each ﬂip-ﬂop and 3-state outputs for bus oriented applications. A clock (CP) and an

output enable (OE) input are common to all ﬂip-ﬂops.

The 8 ﬂip-ﬂops will store the state of their individual D-inputs that meet the set-up and hold

times requirements on the LOW-to-HIGH CP transition.

When OE is LOW the contents of the 8 ﬂip-ﬂops are available at the outputs. When OE is

HIGH, the outputs go to the high-impedance OFF-state. Operation of the OE input does

not affect the state of the ﬂip-ﬂops.

The 74AHC574; 74AHCT574 is functionally identical to the 74AHC564; 74AHCT564, but

has non-inverting outputs. The 74AHC574; 74AHCT574 is functionally identical to

the 74AHC374; 74AHCT374, but has a different pinning.

2. Features

I Balanced propagation delays

I All inputs have a Schmitt-trigger action

I 3-state non-inverting outputs for bus orientated applications

I 8-bit positive, edge-triggered register

I Independent register and 3-state buffer operation

I Common 3-state output enable input

I For 74AHC574 only: operates with CMOS input levels

I For 74AHCT574 only: operates with TTL input levels

I ESD protection:

N HBM JESD22-A114E exceeds 2000 V

N MM JESD22-A115-A exceeds 200 V

N CDM JESD22-C101C exceeds 1000 V

I Multiple package options

I Speciﬁed from −40 °C to +85 °C and from −40 °C to +125 °C

12 3 4 5 6 7...18

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