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PDM4M4110S25Z PDF预览

PDM4M4110S25Z

更新时间: 2024-02-10 23:30:37
品牌 Logo 应用领域
IXYS 静态存储器内存集成电路
页数 文件大小 规格书
10页 215K
描述
SRAM Module, 512KX32, 25ns, CMOS, ZIP-72

PDM4M4110S25Z 技术参数

是否Rohs认证: 不符合生命周期:Transferred
包装说明:ZIP, ZIP72/76,.1,.1Reach Compliance Code:unknown
ECCN代码:3A991.B.2.AHTS代码:8542.32.00.41
风险等级:5.68最长访问时间:25 ns
其他特性:USER CONFIGURABLE AS 512K X 32I/O 类型:COMMON
JESD-30 代码:R-PZMA-T72JESD-609代码:e0
内存密度:16777216 bit内存集成电路类型:SRAM MODULE
内存宽度:8功能数量:1
端口数量:1端子数量:72
字数:2097152 words字数代码:2000000
工作模式:ASYNCHRONOUS最高工作温度:70 °C
最低工作温度:组织:2MX8
输出特性:3-STATE可输出:YES
封装主体材料:PLASTIC/EPOXY封装代码:ZIP
封装等效代码:ZIP72/76,.1,.1封装形状:RECTANGULAR
封装形式:MICROELECTRONIC ASSEMBLY并行/串行:PARALLEL
电源:5 V认证状态:Not Qualified
最大待机电流:0.06 A最小待机电流:4.5 V
子类别:SRAMs最大压摆率:0.68 mA
最大供电电压 (Vsup):5.5 V最小供电电压 (Vsup):4.5 V
标称供电电压 (Vsup):5 V表面贴装:NO
技术:CMOS温度等级:COMMERCIAL
端子面层:Tin/Lead (Sn/Pb)端子形式:THROUGH-HOLE
端子节距:1.27 mm端子位置:ZIG-ZAG
Base Number Matches:1

PDM4M4110S25Z 数据手册

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PRELIMINARY  
PDM4M4110  
(1)  
Timing Waveforms of Read Cycle No.1  
t
RC  
1
2
ADDRESS  
t
AA  
OE  
CS  
t
t
OH  
(5)  
OE  
(5)  
t
OLZ  
3
t
t
OHZ  
ACS  
(5)  
(5)  
t
t
CHZ  
CLZ  
D
OUT  
4
5
(1,2,4)  
Timing Waveforms of Read Cycle No.2  
t
RC  
6
ADDRESS  
t
AA  
t
t
OH  
OH  
7
D
OUT  
Previous Data Valid  
Data Valid  
(1,3,4)  
Timing Waveforms of Read Cycle No.3  
9
CS  
t
ACS  
10  
11  
12  
(5)  
(5)  
t
t
CLZ  
CLZ  
D
OUT  
NOTES 1 WE is HIGH for Read Cycle.  
2. Device is continuously selected. CS = V .  
IL  
3. Address valid prior to or coincident with CS transition LOW.  
4. OE = V .  
5. Transition is measured ±200 mV for steady state. This parameter is  
IL  
determined by device characteristics but is not production tested.  
Rev 2.3

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型号 品牌 描述 获取价格 数据表
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