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NB4N507ADG

更新时间： 2024-10-01 03:46:59

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安森美 - ONSEMI		时钟
页数	文件大小	规格书
7页	124K
描述
3.3V/5V, 50 MHz to 200 MHz PECL Clock Synthesizer

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NB4N507ADG 技术参数

是否无铅：	不含铅	生命周期：	Active
零件包装代码：	SOIC	包装说明：	SOP, SOP16,.25
针数：	16	Reach Compliance Code：	compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
Factory Lead Time：	12 weeks	风险等级：	1.7
JESD-30 代码：	R-PDSO-G16	JESD-609代码：	e3
长度：	9.9 mm	湿度敏感等级：	1
端子数量：	16	最高工作温度：	85 °C
最低工作温度：	-40 °C	最大输出时钟频率：	200 MHz
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SOP16,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	260
电源：	3.3/5 V	主时钟/晶体标称频率：	52 MHz
认证状态：	Not Qualified	座面最大高度：	1.75 mm
子类别：	Clock Generators	最大压摆率：	35 mA
最大供电电压：	5.5 V	最小供电电压：	3 V
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	Tin (Sn)	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	40	宽度：	3.9 mm
uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER	Base Number Matches：	1

NB4N507ADG 数据手册

NB4N507A

3.3V/5V, 50 MHz to 200 MHz

PECL Clock Synthesizer

Description

The NB4N507A is a precision clock synthesizer which generates a

very low jitter differential PECL output clock. It produces a clock

output based on an integer multiple of an input reference frequency.

The NB4N507A accepts a standard fundamental mode crystal,

using Phase−Locked−Loop (PLL) techniques, will produce output

clocks up to 200 MHz. In addition, the PLL circuitry will produce a

50% duty cycle square−wave clock output.

http://onsemi.com

The NB4N507A can be programmed to generate a selection of input

reference frequency multiples. An exact 155.52 MHz output clock can

be generated from a 19.44 MHz crystal and the x8 multiplier selection.

The NB4N507A is intended for low output jitter clock generation.

SOIC−16

D SUFFIX

CASE 751B

Features

• Input Crystal Frequency of 10 − 27 MHz

• Enable Usage of Common Low−Cost Crystal

• Differential PECL Output Clock Frequencies up to 200 MHz

• Duty Cycle of 48%/52%

MARKING DIAGRAM

• Operating Range: V = 3.0 V to 5.5 V

• Ideal for SONET Applications and Oscillator Manufacturers

• Available in Die Form

• Packaged in 16−Pin Narrow SOIC

• Pb−Free Packages are Available*

NB4N507AG

AWLYWW

ꢀ

Osc

= Assembly Location

= Wafer Lot

= Year

= Work Week

= Pb−Free Package

CLKOUT

PECL

VCO

ꢀ

Mult

S0 S1

Figure 1. Simplified Logic Block

ORDERING INFORMATION

See detailed ordering and shipping information in the package

dimensions section on page 5 of this data sheet.

*For additional information on our Pb−Free strategy and soldering details, please

download the ON Semiconductor Soldering and Mounting Techniques

Reference Manual, SOLDERRM/D.

Semiconductor Components Industries, LLC, 2006

Publication Order Number:

November, 2006 − Rev. 2

NB4N507A/D

12 3 4 5 6 7

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NB4N507ADG 替代型号

型号	品牌	替代类型	描述	数据表
NB4N507ADR2G	ONSEMI	完全替代	3.3V/5V, 50 MHz to 200 MHz PECL Clock Synthesizer
NB4N507AD	ONSEMI	完全替代	3.3V/5V, 50 MHz to 200 MHz PECL Clock Synthesizer

与NB4N507ADG相关器件

型号	品牌	获取价格	描述	数据表
NB4N507ADR2	ONSEMI	获取价格	3.3V/5V, 50 MHz to 200 MHz PECL Clock Synthesizer
NB4N507ADR2G	ONSEMI	获取价格	3.3V/5V, 50 MHz to 200 MHz PECL Clock Synthesizer
NB4N527S	ONSEMI	获取价格	3.3V, 2.5Gb/s Dual AnyLevel⑩ to LVDS Receiver
NB4N527SMN	ONSEMI	获取价格	3.3V, 2.5Gb/s Dual AnyLevel⑩ to LVDS Receiver
NB4N527SMNEVB	ONSEMI	获取价格	Evaluation Board Manual for NB4N527S
NB4N527SMNG	ONSEMI	获取价格	3.3V, 2.5Gb/s Dual AnyLevel⑩ to LVDS Receiver
NB4N527SMNR2	ONSEMI	获取价格	3.3V, 2.5Gb/s Dual AnyLevel⑩ to LVDS Receiver
NB4N527SMNR2G	ONSEMI	获取价格	3.3V, 2.5Gb/s Dual AnyLevel⑩ to LVDS Receiver
NB4N7132	ONSEMI	获取价格	Link Replicator for Fibre Channel, Gigabit Ethernet, HDTV and SATA
NB4N7132DTG	ONSEMI	获取价格	Link Replicator for Fibre Channel, Gigabit Ethernet, HDTV and SATA

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