IDTCSPU877DNL

更新时间： 2024-11-15 03:08:39

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艾迪悌 - IDT		时钟驱动器逻辑集成电路动态存储器
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描述
1.8V PHASE LOCKED LOOP DIFFERENTIAL 1:10 SDRAM CLOCK DRIVER

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IDTCSPU877DNL 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	DFN	包装说明：	PLASTIC, MLF-40
针数：	40	Reach Compliance Code：	not_compliant
HTS代码：	8542.39.00.01	风险等级：	5.91
Is Samacsys：	N	系列：	877
输入调节：	DIFFERENTIAL	JESD-30 代码：	S-PQCC-N40
JESD-609代码：	e0	长度：	6 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	最大I（ol）：	0.009 A
湿度敏感等级：	3	功能数量：	1
反相输出次数：		端子数量：	40
实输出次数：	10	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	HVQCCN	封装等效代码：	LCC40,.24SQ,20
封装形状：	SQUARE	封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
电源：	1.8 V	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.04 ns	座面最大高度：	1 mm
子类别：	Clock Drivers	最大供电电压 (Vsup)：	1.9 V
最小供电电压 (Vsup)：	1.7 V	标称供电电压 (Vsup)：	1.8 V
表面贴装：	YES	温度等级：	COMMERCIAL
端子面层：	Tin/Lead (Sn85Pb15)	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
宽度：	6 mm	最小 fmax：	340 MHz
Base Number Matches：	1

IDTCSPU877DNL 数据手册

IDTCSPU877D

COMMERCIALTEMPERATURERANGE

1.8VPLLDIFFERENTIAL1:10SDRAMCLOCKDRIVER

1.8V PHASE LOCKED LOOP

IDTCSPU877D

DIFFERENTIAL 1:10 SDRAM

CLOCK DRIVER

FEATURES:

DESCRIPTION:

• 1 to 10 differential clock distribution

• Optimized for clock distribution in DDR2 (Double Data Rate)

SDRAM applications

TheCSPU877DisaPLLbasedclockdriverthatactsasazerodelaybuffer

to distribute one differential clock input pair(CLK, CLK ) to 10 differential

output pairs (Y[0:9], Y[0:9]) and one differential pair of feedback clock output

(FBOUT,FBOUT). Externalfeedbackpins(FBIN,FBIN)forsynchronization

oftheoutputstotheinputreferenceisprovided.OE,OS,andAVDD controlthe

power-downandtestmodelogic. WhenAVDD isgrounded,thePLListurned

offandbypassedfortestmodepurposes. Whenthedifferentialclockinputs

(CLK,CLK)arebothatlogiclow,thisdevicewillenteralowpower-downmode.

Inthismode,thereceiversaredisabled,thePLListurnedoff,andtheoutput

clockdriversaredisabled,resultinginacurrentconsumptiondeviceoflessthan

500µA.

• Operating frequency: 125MHz to 340MHz

• Very low skew: ≤40ps

• Very low jitter: ≤40ps

• 1.8V AV^DDand 1.8V VDDQ

• CMOS control signal input

• Test mode enables buffers while disabling PLL

• Low current power-down mode

• Tolerant of Spread Spectrum input clock

• Available in 52-Ball VFBGA and 40-pin MLF packages

TheCSPU877Drequiresnoexternalcomponentsandhasbeenoptimised

forverylowphaseerror,skew,andjitter,whilemaintainingfrequencyandduty

cycle over the operating voltage and temperature range. The CSPU877D,

designedforuseinbothmoduleassembliesandsystemmotherboardbased

solutions,providesanoptimumhigh-performanceclocksource.

The CSPU877D is available in Commercial Temperature Range (0°C to

+70°C). SeeOrderingInformationfordetails.

APPLICATIONS:

• Meets or exceeds JEDEC standard 82.8 for registered DDR2

clock driver

• Along with SSTU32864/65/66, DDR2 register, provides complete

solution for DDR2 DIMMs

FUNCTIONAL BLOCK DIAGRAM

LD or OE

POWER

DOWN

AND

LD, OS, or OE

PLL BYPASS

TEST

MODE

LOGIC

AV^DD

CLK

10KΩ - 100KΩ

PLL

FBIN

NOTE:

The Logic Detect (LD) powers down the device when a logic LOW is applied to both CLK and CLK.

FBOUT

The IDT logo is a registered trademark of Integrated Device Technology, Inc.

COMMERCIAL TEMPERATURE RANGE

AUGUST 2004

2004 Integrated Device Technology, Inc.

DSC 6575/4

12 3 4 5 6 7...13

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型号	品牌	获取价格	描述	数据表
IDTCSPU877DNLG	IDT	获取价格	1.8V PHASE LOCKED LOOP DIFFERENTIAL 1:10 SDRAM CLOCK DRIVER
IDTCSPU877DNLG8	IDT	获取价格	PLL Based Clock Driver, 877 Series, 10 True Output(s), 0 Inverted Output(s), PQCC40, GREEN
IDTCSPU877NL	IDT	获取价格	PLL Based Clock Driver, CSPU877 Series, 10 True Output(s), 0 Inverted Output(s), CMOS, PQC
IDTCSPU877NL8	IDT	获取价格	PLL Based Clock Driver, CSPU877 Series, 10 True Output(s), 0 Inverted Output(s), CMOS, PQC
IDTCSPU877NLG	IDT	获取价格	PLL Based Clock Driver, CSPU877 Series, 10 True Output(s), 0 Inverted Output(s), PQCC40, P
IDTCSPUA877A	IDT	获取价格	1.8V PHASE LOCKED LOOP DIFFERENTIAL 1:10 SDRAM CLOCK DRIVER
IDTCSPUA877ABVG	IDT	获取价格	1.8V PHASE LOCKED LOOP DIFFERENTIAL 1:10 SDRAM CLOCK DRIVER
IDTCSPUA877ABVG8	IDT	获取价格	PLL Based Clock Driver, CSPUA877 Series, 10 True Output(s), 0 Inverted Output(s), PBGA52,
IDTCSPUA877ANLG	IDT	获取价格	1.8V PHASE LOCKED LOOP DIFFERENTIAL 1:10 SDRAM CLOCK DRIVER
IDTCSPUA877ANLG8	IDT	获取价格	PLL Based Clock Driver, CSPUA877 Series, 10 True Output(s), 0 Inverted Output(s), PQCC40,

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