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Datasheet > 存储 > SRAM> CY7C1399BL-12VC
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CY7C1399BL-12VC

更新时间： 2024-11-04 22:25:43
品牌 Logo 应用领域
赛普拉斯 - CYPRESS /
页数 文件大小 规格书
10页 153K
描述
32K x 8 3.3V Static RAM

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CY7C1399BL-12VC 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：SOJ包装说明：0.300 INCH, SOJ-28
针数：28Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.32.00.41
风险等级：5.59最长访问时间：12 ns
I/O 类型：COMMONJESD-30 代码：R-PDSO-J28
JESD-609代码：e0长度：17.907 mm
内存密度：262144 bit内存集成电路类型：CACHE SRAM
内存宽度：8功能数量：1
端子数量：28字数：32768 words
字数代码：32000工作模式：ASYNCHRONOUS
最高工作温度：70 °C最低工作温度：
组织：32KX8输出特性：3-STATE
封装主体材料：PLASTIC/EPOXY封装代码：SOJ
封装等效代码：SOJ28,.34封装形状：RECTANGULAR
封装形式：SMALL OUTLINE并行/串行：PARALLEL
电源：3.3 V认证状态：Not Qualified
座面最大高度：3.556 mm最大待机电流：0.00002 A
最小待机电流：2 V子类别：SRAMs
最大压摆率：0.055 mA最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：3 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：J BEND端子节距：1.27 mm
端子位置：DUAL宽度：7.5 mm
Base Number Matches：1

CY7C1399BL-12VC 数据手册

 浏览型号CY7C1399BL-12VC的Datasheet PDF文件第2页浏览型号CY7C1399BL-12VC的Datasheet PDF文件第3页浏览型号CY7C1399BL-12VC的Datasheet PDF文件第4页浏览型号CY7C1399BL-12VC的Datasheet PDF文件第5页浏览型号CY7C1399BL-12VC的Datasheet PDF文件第6页浏览型号CY7C1399BL-12VC的Datasheet PDF文件第7页 
C1399B  
CY7C1399B  
32K x 8 3.3V Static RAM  
active LOW Output Enable (OE) and three-state drivers. The  
device has an automatic power-down feature, reducing the  
power consumption by more than 95% when deselected.  
Features  
• Single 3.3V power supply  
• Ideal for low-voltage cache memory applications  
• High speed  
An active LOW Write Enable signal (WE) controls the writing/  
reading operation of the memory. When CE and WE inputs are  
both LOW, data on the eight data input/output pins (I/O0  
through I/O7) is written into the memory location addressed by  
the address present on the address pins (A0 through A14).  
Reading the device is accomplished by selecting the device  
and enabling the outputs, CE and OE active LOW, while WE  
remains inactive or HIGH. Under these conditions, the con-  
tents of the location addressed by the information on address  
pins is present on the eight data input/output pins.  
— 10/12/15 ns  
• Low active power  
— 216 mW (max.)  
• Low-power alpha immune 6T cell  
• Plastic SOJ and TSOP packaging  
Functional Description[1]  
The input/output pins remain in a high-impedance state unless  
the chip is selected, outputs are enabled, and Write Enable  
(WE) is HIGH. The CY7C1399B is available in 28-pin standard  
300-mil-wide SOJ and TSOP Type I packages.  
The CY7C1399B is a high-performance 3.3V CMOS Static  
RAM organized as 32,768 words by 8 bits. Easy memory ex-  
pansion is provided by an active LOW Chip Enable (CE) and  
Logic Block Diagram  
Pin Configurations  
SOJ  
Top View  
A
A
V
CC  
28  
27  
26  
1
2
3
4
5
6
5
WE  
6
A
A
7
A
4
A
3
8
25  
24  
A
9
A
2
A
10  
A
11  
A
12  
23  
22  
A
1
I/O  
I/O  
I/O  
I/O  
I/O  
I/O  
I/O  
7
8
9
10  
11  
12  
13  
OE  
A
0
0
1
2
3
4
5
6
21  
20  
19  
18  
17  
INPUT BUFFER  
A
13  
A
14  
CE  
I/O  
A
0
7
I/O  
I/O  
I/O  
I/O  
I/O  
A
1
0
1
2
6
5
4
A
2
16  
15  
A
3
I/O  
I/O  
A
4
GND  
14  
3
32K x 8  
ARRAY  
A
5
A
6
A
7
A
8
A
9
CE  
WE  
POWER  
DOWN  
COLUMN  
DECODER  
I/O  
7
OE  
Selection Guide  
1399B-10  
1399B-12  
1399B-15  
1399B-20  
Maximum Access Time (ns)  
10  
60  
12  
55  
15  
50  
20  
45  
Maximum Operating Current (mA)  
Maximum CMOS Standby Current (µA)  
500  
50  
500  
50  
500  
50  
500  
50  
L
Note:  
1. For guidelines on SRAM system design, please refer to the ‘System Design Guidelines’ Cypress application note, available on the internet at www.cypress.com.  
Cypress Semiconductor Corporation  
•
3901 North First Street  
•
San Jose  
•
CA 95134  
•
408-943-2600  
Document #: 38-05071 Rev. *C  
Revised June 19, 2001  
1234567...10

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型号 品牌 获取价格 描述 数据表
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