Datasheet > 存储 > SRAM> CY7C038-15AC

CY7C038-15AC

更新时间： 2024-11-09 00:01:31

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赛普拉斯 - CYPRESS		存储内存集成电路静态存储器
页数	文件大小	规格书
19页	258K
描述
32K/64K x 16/18 Dual-Port Static RAM

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CY7C038-15AC 技术参数

生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	LFQFP, QFP100,.63SQ,20	针数：	100
Reach Compliance Code：	compliant	ECCN代码：	3A991.B.2.A
HTS代码：	8542.32.00.41	风险等级：	5.78
Is Samacsys：	N	最长访问时间：	15 ns
其他特性：	INTERRUPT FLAG	I/O 类型：	COMMON
JESD-30 代码：	S-PQFP-G100	长度：	14 mm
内存密度：	1179648 bit	内存集成电路类型：	DUAL-PORT SRAM
内存宽度：	18	功能数量：	1
端口数量：	2	端子数量：	100
字数：	65536 words	字数代码：	64000
工作模式：	ASYNCHRONOUS	最高工作温度：	70 °C
最低工作温度：		组织：	64KX18
输出特性：	3-STATE	可输出：	YES
封装主体材料：	PLASTIC/EPOXY	封装代码：	LFQFP
封装等效代码：	QFP100,.63SQ,20	封装形状：	SQUARE
封装形式：	FLATPACK, LOW PROFILE, FINE PITCH	并行/串行：	PARALLEL
电源：	5 V	认证状态：	Not Qualified
座面最大高度：	1.6 mm	最大待机电流：	0.00025 A
最小待机电流：	2 V	子类别：	SRAMs
最大压摆率：	0.28 mA	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	4.5 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
宽度：	14 mm	Base Number Matches：	1

CY7C038-15AC 数据手册

25/0251

CY7C027/028

CY7C037/038

32K/64K x 16/18

Dual-Port Static RAM

• Fully asynchronous operation

Features

• Automatic power-down

• Expandable data bus to 32/36 bits or more using Mas-

ter/Slave chip select when using more than one device

• True Dual-Ported memory cells which allow simulta-

neous access of the same memory location

• 32K x 16 organization (CY7C027)

• 64K x 16 organization (CY7C028)

• 32K x 18 organization (CY7C037)

• 64K x 18 organization (CY7C038)

• 0.35-micron CMOS for optimum speed/power

• High-speed access: 12^[1]/15/20 ns

• Low operating power

• On-chip arbitration logic

• Semaphores included to permit software handshaking

between ports

• INT flags for port-to-port communication

• Separate upper-byte and lower-byte control

• Dual Chip Enables

• Pin select for Master or Slave

— Active: I_CC= 180 mA (typical)

• Commercial and industrial temperature ranges

• Available in 100-pin TQFP

— Standby: I_SB3= 0.05 mA (typical)

• Pin-compatible and functionally equivalent to IDT7027

Logic Block Diagram

R/W_L

UB_L

R/W_R

UB_R

CE_0L

CE_0R

CE_1L

CE_1R

CE_L

CE_R

LB_L

LB_R

OE_L

OE_R

8/9

[2]

8/9

[2]

I/O_8/9L–I/O_15/17L

I/O_8/9L–I/O_15/17R

8/9

[3]

I/O

Control

I/O

Control

I/O_0L–I/O_7/8L

I/O_0L–I/O_7/8R

15/16

[4]

15/16

[4]

Address

Decode

Address

Decode

True Dual-Ported

A_0L–A

_0R–A_14/15R

14/15L

RAM Array

15/16

[4]

A_0L–A

A_0R–A_14/15R

14/15L

CE_L

CE_R

Interrupt

Semaphore

Arbitration

OE_L

OE_R

R/W_L

SEM_L

BUSY_L^[5]

R/W_R

SEM_R

^[5]BUSY_R

INT_R

INT_L

UB_L

UB_R

LB_L

M/S

LB_R

Notes:

1. See page 6 for Load Conditions.

2. I/O₈–I/O₁₅for x16 devices; I/O₉–I/O₁₇for x18 devices.

3. I/O₀–I/O₇for x16 devices; I/O₀–I/O₈for x18 devices.

4. A₀–A₁₄for 32K; A₀–A₁₅for 64K devices.

5. BUSY is an output in master mode and an input in slave mode.

For the most recent information, visit the Cypress web site at www.cypress.com

Cypress Semiconductor Corporation

•

3901 North First Street

•

San Jose

•

CA 95134

•

408-943-2600

Document #: 38-06042 Rev. *A

Revised December 27, 2002

12 3 4 5 6 7...19

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