ADCLK854

更新时间： 2024-01-17 18:30:40

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亚德诺 - ADI		时钟
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16页	532K
描述
1.8 V, 12-LVDS/24-CMOS Output, Low Power Clock Fanout Buffer

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ADCLK854 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	QFN
包装说明：	HVQCCN,	针数：	48
Reach Compliance Code：	unknown	风险等级：	5.75
Is Samacsys：	N	放大器类型：	BUFFER
最大平均偏置电流 (IIB)：	350 µA	JESD-30 代码：	S-XQCC-N48
JESD-609代码：	e3	长度：	7 mm
湿度敏感等级：	NOT APPLICABLE	功能数量：	1
端子数量：	48	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	UNSPECIFIED
封装代码：	HVQCCN	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	峰值回流温度（摄氏度）：	260
认证状态：	COMMERCIAL	座面最大高度：	1 mm
子类别：	Buffer Amplifier	供电电压上限：	2 V
标称供电电压 (Vsup)：	1.8 V	表面贴装：	YES
温度等级：	INDUSTRIAL	端子面层：	MATTE TIN
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	40
宽度：	7 mm	Base Number Matches：	1

ADCLK854 数据手册

ADCLK854

PIN CONFIGURATION AND FUNCTION DESCRIPTIONS

36 NC

REF

PIN 1

INDICATOR

CLK0

GND

35 NC

34 OUT4 (OUT4A)

33 OUT4 (OUT4B)

32 OUT5 (OUT5A)

31 OUT5 (OUT5B)

CLK1

ADCLK854

TOP VIEW

(Not to Scale)

30 V

OUT11 (OUT11B)

OUT11 (OUT11A)

29 GND

28 OUT6 (OUT6A)

27 OUT6 (OUT6B)

26 OUT7 (OUT7A)

25 OUT7 (OUT7B)

IN_SEL 10

CTRL_A 11

CTRL_B 12

NOTES:

1. NC = NO CONNECT.

2. EXPOSED PADDLE MUST BE CONNECTED TO GND.

Figure 2. Pin Configuration

Table 7. Pin Function Descriptions

Pin No.

Mnemonic

Description

V_REF

CLK0

Reference Voltage.

Input (Negative) 0.

Input (Positive) 0.

Supply Voltage.

CLK0

7, 18, 24, 30, V_S

37, 43

CLK1

Input (Negative) 1.

CLK1

Input (Positive) 1.

(OUT11B) Complementary Side of Differential LVDS Output 11, or CMOS Output 11 on Channel B.

OUT11

OUT11 (OUT11A) True Side of Differential LVDS Output 11, or CMOS Output 11 on Channel A.

IN_SEL

CTRL_A

CTRL_B

CTRL_C

SLEEP

Input Select. (0 = CLK0,

; 1 = CLK1,

). CMOS logic input with 200 kΩ pull-down resistor.

CLK1

CLK0

Control for Output 3 to Output 0 (0 = LVDS, 1 = CMOS). CMOS logic input with 200 kΩ pull-down resistor.

Control for Output 7 to Output 4 (0 = LVDS, 1 = CMOS). CMOS logic input with 200 kΩ pull-down resistor.

Control for Output 11 to Output 8 (0 = LVDS, 1 = CMOS). CMOS logic input with 200 kΩ pull-down resistor.

Sleep Mode Control (0 = normal operation, 1 = sleep). CMOS logic input with 200 kΩ pull down resistor.

(OUT10B) Complementary Side of Differential LVDS Output 10, or CMOS Output 10 on Channel B.

OUT10

OUT10 (OUT10A) True Side of Differential LVDS Output 10, or CMOS Output 10 on Channel A.

4, 17, 23, 29, GND

38, 44

Ground Pin.

(OUT9B)

Complementary Side of Differential LVDS Output 9, or CMOS Output 9 on Channel B.

True Side of Differential LVDS Output 9, or CMOS Output 9 on Channel A.

Complementary Side of Differential LVDS Output 8, or CMOS Output 8 on Channel B.

True Side of Differential LVDS Output 8, or CMOS Output 8 on Channel A.

Complementary Side of Differential LVDS Output 7, or CMOS Output 7 on Channel B.

OUT9

OUT9 (OUT9A)

(OUT8B)

OUT8

OUT8 (OUT8A)

(OUT7B)

OUT7

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