ADCLK854

更新时间： 2024-02-19 14:44:53

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亚德诺 - ADI		时钟
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16页	532K
描述
1.8 V, 12-LVDS/24-CMOS Output, Low Power Clock Fanout Buffer

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ADCLK854 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	QFN
包装说明：	HVQCCN,	针数：	48
Reach Compliance Code：	unknown	风险等级：	5.75
Is Samacsys：	N	放大器类型：	BUFFER
最大平均偏置电流 (IIB)：	350 µA	JESD-30 代码：	S-XQCC-N48
JESD-609代码：	e3	长度：	7 mm
湿度敏感等级：	NOT APPLICABLE	功能数量：	1
端子数量：	48	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	UNSPECIFIED
封装代码：	HVQCCN	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	峰值回流温度（摄氏度）：	260
认证状态：	COMMERCIAL	座面最大高度：	1 mm
子类别：	Buffer Amplifier	供电电压上限：	2 V
标称供电电压 (Vsup)：	1.8 V	表面贴装：	YES
温度等级：	INDUSTRIAL	端子面层：	MATTE TIN
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	40
宽度：	7 mm	Base Number Matches：	1

ADCLK854 数据手册

ADCLK854

SPECIFICATIONS

ELECTRICAL CHARACTERISTICS

Typical (Typ) values are given for V_S= 1.8 V and T_A= 25°C, unless otherwise noted. Minimum (Min) and maximum (Max) values are given over

the full V_S= 1.8 V 5ꢀ and T_A= −40°C to +85°C variation, unless otherwise noted. Input slew rate > 1 V/ns, unless otherwise noted.

Table 1. Clock Inputs and Outputs

Parameter

Symbol Min

Typ Max

Unit

Conditions

CLOCK INPUTS

Differential input

Input Frequency

Input Sensitivity, Differential

1200

150

MHz

mV p-p Jitter performance improves with higher slew

rates (greater voltage swing)

Input Level

1.8

V p-p

Larger voltage swings can turn on the protection

diodes and degrade jitter performance

Input Common-Mode Voltage V_CM

V_S/2 − 0.1

0.4

V_S/2 + 0.5

V_S− 0.4

Inputs are self-biased; enables ac coupling

Inputs dc-coupled with 200 mV p-p signal applied

Input Common-Mode Range

Input Voltage Offset

Input Sensitivity, Single-Ended

Input Resistance (Differential)

Input Capacitance

V_CMR

150

mV p-p CLKx ac-coupled;

ac bypassed to ground

CLKx

kΩ

C_IN

Input Bias Current (Each Pin)

LVDS CLOCK OUTPUTS

Output Frequency

Output Voltage Differential

Delta V_OD

Offset Voltage

Delta V_OS

Short-Circuit Current

−350

+350

1200

μA

Full input swing

Termination = 100 Ω; differential (OUTx,

See Figure 9 for swing vs. frequency

)

OUTx

MHz

V_OD

ΔV_OD

V_OS

ΔV_OS

I_SA, I_SB

247

344 454

1.25 1.375

1.125

Each pin (output shorted to GND)

CMOS CLOCK OUTPUTS

Output Frequency

Single-ended; termination = open; OUTx and

in phase

OUTx

250

MHz

With 10 pF load per output; see Figure 16 for

swing vs. frequency

Output Voltage High

Output Voltage Low

Output Voltage High

Output Voltage Low

Reference Voltage

Output Voltage

V_OH

V_OL

V_OH

V_OL

V_REF

V_S− 0.1

@ 1 mA load

@ 10 mA load

0.1

V_S− 0.35

0.35

V_S/2 − 0.1 V_S/2 V_S/2 + 0.1

500 μA

Output Resistance

Output Current

μA

500

Rev. 0 | Page 3 of 16

1 234 5 6 7...16

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