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ADCLK846BCPZ-REEL7

更新时间： 2024-02-19 14:46:00

品牌	Logo	应用领域
亚德诺 - ADI		时钟驱动器逻辑集成电路 PC
页数	文件大小	规格书
16页	518K
描述
1.8 V, 6 LVDS/12 CMOS Outputs Low Power Clock Fanout Buffer

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ADCLK846BCPZ-REEL7 技术参数

是否无铅：	含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	QFN
包装说明：	HVQCCN, LCC24,.16SQ,20	针数：	24
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	1.26
Samacsys Confidence：	3	Samacsys Status：	Released
2D Presentation：	https://componentsearchengine.com/2D/0T/578999.3.1.png	Schematic Symbol：	https://componentsearchengine.com/symbol.php?partID=578999
PCB Footprint：	https://componentsearchengine.com/footprint.php?partID=578999	3D View：	https://componentsearchengine.com/viewer/3D.php?partID=578999
Samacsys PartID：	578999	Samacsys Image：	https://componentsearchengine.com/Images/9/ADCLK846BCPZ-REEL7.jpg
Samacsys Thumbnail Image：	https://componentsearchengine.com/Thumbnails/3/ADCLK846BCPZ-REEL7.jpg	Samacsys Pin Count：	25
Samacsys Part Category：	Integrated Circuit	Samacsys Package Category：	Quad Flat No-Lead
Samacsys Footprint Name：	24-Lead Lead Frame Chip Scale Package [LFCSP] 4 mm × 4 mm and 0.75 mm Package Height (CP-24-14)	Samacsys Released Date：	2017-01-11 11:21:59
Is Samacsys：	N	系列：	CMOS
输入调节：	DIFFERENTIAL	JESD-30 代码：	S-XQCC-N24
JESD-609代码：	e3	长度：	4 mm
逻辑集成电路类型：	LOW SKEW CLOCK DRIVER	最大I（ol）：	0.01 A
湿度敏感等级：	3	功能数量：	1
反相输出次数：		端子数量：	24
实输出次数：	6	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	UNSPECIFIED
封装代码：	HVQCCN	封装等效代码：	LCC24,.16SQ,20
封装形状：	SQUARE	封装形式：	CHIP CARRIER
峰值回流温度（摄氏度）：	260	电源：	1.8 V
Prop。Delay @ Nom-Sup：	4.2 ns	传播延迟（tpd）：	4.2 ns
认证状态：	Not Qualified	Same Edge Skew-Max（tskwd）：	0.64 ns
座面最大高度：	1 mm	子类别：	Clock Drivers
最大供电电压 (Vsup)：	1.89 V	最小供电电压 (Vsup)：	1.71 V
标称供电电压 (Vsup)：	1.8 V	表面贴装：	YES
温度等级：	INDUSTRIAL	端子面层：	Matte Tin (Sn)
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	40
宽度：	4 mm	最小 fmax：	250 MHz
Base Number Matches：	1

ADCLK846BCPZ-REEL7 数据手册

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ADCLK846

SPECIFICATIONS

ELECTRICAL CHARACTERISTICS

Typical values are given for V_S= 1.8 V and T_A= 25°C, unless otherwise noted. Minimum and maximum values are given over the full

V_S= 1.8 V 5% and T_A= −40°C to +85°C variations, unless otherwise noted. Input slew rate > 1 V/ns, unless otherwise noted.

Table 1.

Parameter

Symbol Min

Typ Max

Unit

Conditions

CLOCK INPUTS

Differential input

Input Frequency

Input Sensitivity, Differential

1200

150

MHz

mV p-p Jitter performance is improved with higher slew

rates (greater voltage swing)

Input Level

1.8

V p-p

Larger voltage swings can turn on the protection

diodes and can degrade jitter performance

Input Common-Mode Voltage

Input Common-Mode Range

V_CM

V_CMR

V_S/2 − 0.1

0.4

V_S/2 + 0.05

V_S− 0.4

Inputs are self-biased; enables ac coupling

Inputs are dc-coupled with 200 mV p-p signal

applied

Input Voltage Offset

150

Input Sensitivity, Single-Ended

Input Resistance (Differential)

Input Capacitance

mV p-p CLK ac-coupled; CLK ac-bypassed to ground

kΩ

C_IN

Input Bias Current (Each Pin)

−350

+350

1200

μA

Full input swing

LVDS CLOCK OUTPUTS

Output Frequency

Differential Output Voltage

Termination = 100 Ω; differential (OUTx, OUTx)

See Figure 9 for a swing vs. frequency plot

MHz

V_OD

ΔV_OD

V_OS

ΔV_OS

I_SA, I_SB

247

344 454

1.25 1.375

Offset Voltage

1.125

Short-Circuit Current

Each pin (output shorted to GND )

CMOS CLOCK OUTPUTS

Output Frequency

Single-ended; termination = open

OUTx and OUTx in phase

250

MHz

With 10 pF load each output; see Figure 16 for

swing vs. frequency

Output Voltage High

V_OH

V_OL

V_REF

V_S− 0.1

V_S− 0.35

At 1 mA load

At 10 mA load

At 1 mA load

At 10 mA load

Output Voltage Low

0.1

0.35

Reference Voltage

Output Voltage

Output Resistance

Output Current

V_S/2 − 0.1 V_S/2 V_S/2 + 0.1

μA

500 μA

500

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型号	品牌	描述	获取价格	数据表
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