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74LVC377D

更新时间： 2023-09-03 20:34:58

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安世 - NEXPERIA		光电二极管逻辑集成电路触发器
页数	文件大小	规格书
12页	231K
描述
Octal D-type flip-flop with data enable; positive-edge triggerProduction

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74LVC377D 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	SOP,	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.61
其他特性：	WITH HOLD MODE	系列：	LVC/LCX/Z
JESD-30 代码：	R-PDSO-G20	JESD-609代码：	e4
长度：	12.8 mm	逻辑集成电路类型：	D FLIP-FLOP
湿度敏感等级：	1	位数：	8
功能数量：	1	端子数量：	20
最高工作温度：	125 °C	最低工作温度：	-40 °C
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	260
传播延迟（tpd）：	15.5 ns	座面最大高度：	2.65 mm
最大供电电压 (Vsup)：	3.6 V	最小供电电压 (Vsup)：	1.2 V
标称供电电压 (Vsup)：	1.8 V	表面贴装：	YES
技术：	CMOS	温度等级：	AUTOMOTIVE
端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	触发器类型：	POSITIVE EDGE
宽度：	7.5 mm	Base Number Matches：	1

74LVC377D 数据手册

74LVC377

Octal D-type flip-flop with data enable; positive-edge trigger

Rev. 7 — 27 August 2021

Product data sheet

1. General description

The 74LVC377 is an octal positive-edge triggered D-type flip-flop. The device features clock

(CP) and data enable (E) inputs. When E is LOW, the outputs Qn will assume the state of their

corresponding D inputs that meet the set-up and hold time requirements on the LOW-to-HIGH

clock (CP) transition. Input E must be stable one set-up time prior to the LOW-to-HIGH transition

for predictable operation. Inputs can be driven from either 3.3 V or 5 V devices. This feature allows

the use of these devices as translators in mixed 3.3 V and 5 V environments.

2. Features and benefits

•

Wide supply voltage range from 1.2 V to 3.6 V

•

Overvoltage tolerant inputs to 5.5 V

CMOS low power consumption

Direct interface with TTL levels

Output drive capability 50 Ω transmission lines at 125 °C

Complies with JEDEC standard:

•

JESD8-7A (1.65 V to 1.95 V)

JESD8-5A (2.3 V to 2.7 V)

JESD8-C/JESD36 (2.7 V to 3.6 V)

•

ESD protection:

•

HBM JESD22-A114F exceeds 2000 V

MM JESD22-A115-B exceeds 200 V

CDM JESD22-C101E exceeds 1000 V

•

Specified from -40 °C to +85 °C and from -40 °C to +125 °C

3. Ordering information

Table 1. Ordering information

Type number

Package

Temperature

range

Name

Description

Version

74LVC377D

-40 °C to +125 °C

SO20

plastic small outline package; 20 leads;

body width 7.5 mm

SOT163-1

SOT360-1

74LVC377PW

-40 °C to +125 °C

TSSOP20 plastic thin shrink small outline package; 20 leads;

body width 4.4 mm

12 3 4 5 6 7...12

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与74LVC377D相关器件

型号	品牌	获取价格	描述	数据表
74LVC377D,112	NXP	获取价格	74LVC377 - Octal D-type flip-flop with data enable; positive-edge trigger SOP 20-Pin
74LVC377D,118	NXP	获取价格	74LVC377 - Octal D-type flip-flop with data enable; positive-edge trigger SOP 20-Pin
74LVC377DB	NXP	获取价格	Octal D-type flip-flop with data enable; positive-edge trigger
74LVC377DB,112	NXP	获取价格	74LVC377 - Octal D-type flip-flop with data enable; positive-edge trigger SSOP2 20-Pin
74LVC377DB,118	NXP	获取价格	74LVC377 - Octal D-type flip-flop with data enable; positive-edge trigger SSOP2 20-Pin
74LVC377DB-T	NXP	获取价格	IC LVC/LCX/Z SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO20, 5.30 MM, PL
74LVC377D-T	NXP	获取价格	IC LVC/LCX/Z SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO20, 7.50 MM, PL
74LVC377PW	NXP	获取价格	Octal D-type flip-flop with data enable; positive-edge trigger
74LVC377PW	NEXPERIA	获取价格	Octal D-type flip-flop with data enable; positive-edge triggerProduction
74LVC377PW,112	NXP	获取价格	74LVC377 - Octal D-type flip-flop with data enable; positive-edge trigger TSSOP2 20-Pin

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