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74LVC00APW

更新时间： 2024-11-16 11:11:23

品牌	Logo	应用领域
安世 - NEXPERIA		光电二极管逻辑集成电路
页数	文件大小	规格书
12页	230K
描述
Quad 2-input NAND gateProduction

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74LVC00APW 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	TSSOP-14	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.57
Is Samacsys：	N	系列：	LVC/LCX/Z
JESD-30 代码：	R-PDSO-G14	JESD-609代码：	e4
长度：	5 mm	逻辑集成电路类型：	NAND GATE
湿度敏感等级：	1	功能数量：	4
输入次数：	2	端子数量：	14
最高工作温度：	125 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	传播延迟（tpd）：	9.7 ns
座面最大高度：	1.1 mm	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	1.2 V	标称供电电压 (Vsup)：	1.8 V
表面贴装：	YES	技术：	CMOS
温度等级：	AUTOMOTIVE	端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	4.4 mm	Base Number Matches：	1

74LVC00APW 数据手册

74LVC00A

Quad 2-input NAND gate

Rev. 9 — 17 September 2021

Product data sheet

1. General description

The 74LVC00A is a quad 2-input NAND gate. Inputs can be driven from either 3.3 V or 5 V devices.

This feature allows the use of these devices as translators in mixed 3.3 V and 5 V environments.

Schmitt-trigger action at all inputs makes the circuit tolerant of slower input rise and fall times.

2. Features and benefits

•

Overvoltage tolerant inputs to 5.5 V

•

Wide supply voltage range from 1.2 V to 3.6 V

CMOS low-power consumption

Direct interface with TTL levels

Complies with JEDEC standard:

•

JESD8-7A (1.65 V to 1.95 V)

JESD8-5A (2.3 V to 2.7 V)

JESD8-C/JESD36 (2.7 V to 3.6 V)

•

ESD protection:

•

HBM JESD22-A114F exceeds 2000 V

MM JESD22-A115-B exceeds 200 V

CDM JESD22-C101E exceeds 1000 V

•

Multiple package options

Specified from -40 °C to +85 °C and -40 °C to +125 °C

3. Ordering information

Table 1. Ordering information

Type number

Package

Temperature range Name

Description

Version

74LVC00AD

-40 °C to +125 °C

SO14

plastic small outline package; 14 leads;

body width 3.9 mm

SOT108-1

74LVC00APW -40 °C to +125 °C

74LVC00ABQ -40 °C to +125 °C

TSSOP14

plastic thin shrink small outline package; 14 leads;

body width 4.4 mm

SOT402-1

SOT762-1

DHVQFN14 plastic dual in-line compatible thermal enhanced

very thin quad flat package; no leads; 14 terminals;

body 2.5 × 3 × 0.85 mm

12 3 4 5 6 7...12

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74LVC00APW 替代型号

型号	品牌	替代类型	描述	数据表
SN74LVC00APWRG4	TI	功能相似	QUADRUPLE 2-INPUT POSITIVE-NAND GATES
SN74LVC00APWR	TI	功能相似	QUADRUPLE 2-INPUT POSITIVE-NAND GATES
SN74LVC00APW	TI	功能相似	QUADRUPLE 2-INPUT POSITIVE-NAND GATES

与74LVC00APW相关器件

型号	品牌	获取价格	描述	数据表
74LVC00APW/T3	NXP	获取价格	IC LVC/LCX/Z SERIES, QUAD 2-INPUT NAND GATE, PDSO14, 4.40 MM, PLASTIC, MO-153, SOT-402-1,
74LVC00APW-118	NXP	获取价格	Quad 2-input NAND gate Rev. 7 â 25 April 20
74LVC00APWDH	NXP	获取价格	Quad 2-input NAND gate
74LVC00APWDH-T	NXP	获取价格	IC LVC/LCX/Z SERIES, QUAD 2-INPUT NAND GATE, PDSO14, Gate
74LVC00APW-Q100	NEXPERIA	获取价格	Quad 2-input NAND gate
74LVC00APW-T	ETC	获取价格	Quad 2-input NAND Gate
74LVC00A-Q100	NEXPERIA	获取价格	Quad 2-input NAND gate
74LVC00AS14	DIODES	获取价格	QUADRUPLE 2-INPUT NAND GATES
74LVC00AS14-13	DIODES	获取价格	QUADRUPLE 2-INPUT NAND GATES
74LVC00AT14	DIODES	获取价格	QUADRUPLE 2-INPUT NAND GATES

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