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70V639S15PRFG8

更新时间： 2024-09-15 15:46:19
品牌 Logo 应用领域
艾迪悌 - IDT 静态存储器内存集成电路
页数 文件大小 规格书
24页 705K
描述
Dual-Port SRAM, 128KX18, 15ns, CMOS, PQFP128, 14 X 20 MM, 1.40 MM HEIGHT, GREEN, TQFP-128

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70V639S15PRFG8 技术参数

生命周期：Active包装说明：LFQFP,
Reach Compliance Code：compliantHTS代码：8542.32.00.41
风险等级：5.69最长访问时间：15 ns
JESD-30 代码：R-PQFP-G128长度：20 mm
内存密度：2359296 bit内存集成电路类型：DUAL-PORT SRAM
内存宽度：18功能数量：1
端子数量：128字数：131072 words
字数代码：128000工作模式：ASYNCHRONOUS
最高工作温度：70 °C最低工作温度：
组织：128KX18封装主体材料：PLASTIC/EPOXY
封装代码：LFQFP封装形状：RECTANGULAR
封装形式：FLATPACK, LOW PROFILE, FINE PITCH并行/串行：PARALLEL
座面最大高度：1.6 mm最大供电电压 (Vsup)：3.45 V
最小供电电压 (Vsup)：3.15 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子形式：GULL WING
端子节距：0.5 mm端子位置：QUAD
宽度：14 mmBase Number Matches：1

70V639S15PRFG8 数据手册

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HIGH-SPEED 3.3V  
128K x 18 ASYNCHRONOUS  
DUAL-PORT STATIC RAM  
IDT70V639S  
Š
Features  
◆
True Dual-Port memory cells which allow simultaneous  
access of the same memory location  
High-speed access  
◆
◆
Fully asynchronous operation from either port  
◆
Separate byte controls for multiplexed bus and bus  
matching compatibility  
– Commercial:10/12/15ns(max.)  
◆
Supports JTAG features compliant to IEEE 1149.1  
– Due to limited pin count, JTAG is not supported on the  
128-pin TQFP package.  
– Industrial:12/15ns(max.)  
◆
◆
Dual chip enables allow for depth expansion without  
external logic  
◆
◆
◆
◆
◆
LVTTL-compatible, single 3.3V (±150mV) power supply for  
core  
IDT70V639 easily expands data bus width to 36 bits or  
more using the Master/Slave select when cascading more  
than one device  
LVTTL-compatible, selectable 3.3V (±150mV)/2.5V (±100mV)  
power supply for I/Os and control signals on each port  
Available in a 128-pin Thin Quad Flatpack, 208-ball fine  
pitch Ball Grid Array, and 256-ball Ball Grid Array  
Industrial temperature range (–40°C to +85°C) is available  
for selected speeds  
◆
M/S = VIH for BUSY output flag on Master,  
M/S = VIL for BUSY input on Slave  
Busy and Interrupt Flags  
◆
◆
◆
On-chip port arbitration logic  
Full on-chip hardware support of semaphore signaling  
Green parts available, see ordering information  
between ports  
Functional Block Diagram  
UB  
LB  
L
UB  
R
L
LB  
R
R/WL  
R/WR  
B
B
E
1
L
B
E
1
B
E
0
E
0
L
CE0L  
CE0R  
R
R
CE1L  
CE1R  
OEL  
OER  
Dout0-8_L  
Dout0-8_R  
Dout9-17_L  
Dout9-17_R  
128K x 18  
MEMORY  
ARRAY  
Din_L  
I/O0L- I/O17L  
Din_R  
I/O0R - I/O17R  
A
A
16R  
0R  
Address  
Decoder  
Address  
Decoder  
A
16L  
0L  
ADDR_L  
ADDR_R  
A
OE  
L
ARBITRATION  
OER  
INTERRUPT  
SEMAPHORE  
LOGIC  
CE0R  
CE1R  
CE0L  
CE1L  
R/WL  
R/WR  
BUSY  
SEM  
INT  
R
BUSY  
SEM  
INT  
L
L
M/S  
R
L
R
TMS  
TCK  
TRST  
TDI  
JTAG  
TDO  
5621 drw 01  
NOTES:  
1. BUSY is an input as a Slave (M/S=VIL) and an output when it is a Master (M/S=VIH).  
2. BUSY and INT are non-tri-state totem-pole outputs (push-pull).  
JUNE 2015  
1
DSC-5621/7  
©2015 Integrated Device Technology, Inc.  
1234567...24

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与70V639S15PRFG8相关器件

型号 品牌 获取价格 描述 数据表
70V639S15PRFGI IDT

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 		HIGH-SPEED 3.3V 128K x 18 ASYNCHRONOUS DUAL-PORT STATIC RAM
70V639S15PRFGI8 IDT

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 		Dual-Port SRAM, 128KX18, 15ns, CMOS, PQFP128, 14 X 20 MM, 1.40 MM HEIGHT, GREEN, TQFP-128
70V639S15PRFI IDT

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 		Application Specific SRAM, 128KX18, 15ns, CMOS, PQFP128, 14 X 20 MM, 1.40 MM HEIGHT, TQFP-
70V639S15PRFI8 IDT

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 		Application Specific SRAM, 128KX18, 15ns, CMOS, PQFP128, 14 X 20 MM, 1.40 MM HEIGHT, TQFP-
70V657 RENESAS

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 		32K x 36 3.3V Dual-Port RAM, Interleaved I/O's
70V657S10BCG IDT

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 		HIGH-SPEED 3.3V 128/64/32K x 36 ASYNCHRONOUS DUAL-PORT STATIC RAM
70V657S10BCG8 IDT

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70V657S10BF8 IDT

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 		CABGA-208, Reel

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