Datasheet > 存储 > FIFO> UPD485505G-25

UPD485505G-25

更新时间： 2024-10-13 22:52:35

品牌	Logo	应用领域
日电电子 - NEC		存储光电二极管先进先出芯片
页数	文件大小	规格书
20页	174K
描述
LINE BUFFER 5K-WORD BY 8-BIT

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UPD485505G-25 技术参数

生命周期：	Obsolete	包装说明：	11.43 MM, PLASTIC, SOP-24
Reach Compliance Code：	unknown	风险等级：	5.78
Is Samacsys：	N	最长访问时间：	18 ns
周期时间：	25 ns	JESD-30 代码：	R-PDSO-G24
内存密度：	40960 bit	内存宽度：	8
功能数量：	1	端子数量：	24
字数：	5120 words	字数代码：	5000
工作模式：	SYNCHRONOUS	最高工作温度：	70 °C
最低工作温度：		组织：	5KX8
输出特性：	3-STATE	可输出：	NO
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
并行/串行：	PARALLEL	认证状态：	Not Qualified
座面最大高度：	2.3 mm	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	4.5 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
宽度：	8.4 mm	Base Number Matches：	1

UPD485505G-25 数据手册

DATA SHEET

MOS INTEGRATED CIRCUIT

µPD485505

LINE BUFFER

5K-WORD BY 8-BIT

Description

The µPD485505 is a 5,048 words by 8 bits high speed FIFO (First In First Out) line buffer. Its CMOS static circuitry

provides high speed access and low power consumption.

The µPD485505 can be used for one line delay and time axis conversion in high speed facsimile machines and

digital copiers.

Moreover, the µPD485505 can execute read and write operations independently on an asynchronous basis. Thus

the µPD485505 is suitable as a buffer for data transfer between units with different transfer rates and as a buffer for

the synchronization of multiple input signals. There are three versions, E, K, P, and L. This data sheet can be applied

to the version P and L. These versions operate with different specifications. Each version is identified with its lot

number (refer to 7. Example of Stamping).

Features

•

5,048 words by 8 bits

Asynchronous read/write operations available

Variable length delay bits; 21 to 5,048 bits (Cycle time: 25 ns)

15 to 5,048 bits (Cycle time: 35 ns)

•

Power supply voltage V^CC= 5.0 V ± 0.5 V

Suitable for sampling one line of A3 size paper (16 dots/mm)

All input/output TTL compatible

3-state output

Full static operation; data hold time = infinity

Ordering Information

Part Number

µPD485505G-25

µPD485505G-35

R/W Cycle Time

Package

25 ns

35 ns

24-pin plastic SOP

(11.43 mm (450))

The information in this document is subject to change without notice. Before using this document, please

confirm that this is the latest version.

Not all devices/types available in every country. Please check with local NEC representative for availability

and additional information.

Document No. M10059EJ7V0DSJ1 (7th edition)

Date Published December 2000 N CP(K)

Printed in Japan

The mark shows major revised points.

1994,1996

12 3 4 5 6 7...20

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与UPD485505G-25相关器件

型号	品牌	获取价格	描述	数据表
UPD485505G-25-A	NEC	获取价格	FIFO, 5KX8, 18ns, Synchronous, CMOS, PDSO24, 0.450 INCH, PLASTIC, SOP-24
UPD485505G-25-E2	NEC	获取价格	5KX8 OTHER FIFO, 18ns, PDSO24, 11.43 MM, PLASTIC, SOP-24
UPD485505G-25-E2-A	NEC	获取价格	FIFO, 5KX8, 18ns, Synchronous, CMOS, PDSO24, 11.43 MM, PLASTIC, SOP-24
UPD485505G-27	ETC	获取价格	Field/Frame/Line Memory
UPD485505G-35	NEC	获取价格	LINE BUFFER 5K-WORD BY 8-BIT
UPD485505G-35-A	NEC	获取价格	暂无描述
UPD485505GU-25	ETC	获取价格	Field/Frame/Line Memory
UPD485505GU-35	ETC	获取价格	Field/Frame/Line Memory
UPD485505V-25	ETC	获取价格	Field/Frame/Line Memory
UPD485505V-35	ETC	获取价格	Field/Frame/Line Memory

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