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SY100EL14VZITR

更新时间： 2024-11-20 03:02:31
品牌 Logo 应用领域
麦瑞 - MICREL 时钟驱动器逻辑集成电路光电二极管
页数 文件大小 规格书
5页 61K
描述
5V/3.3V 1:5 CLOCK DISTRIBUTION

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SY100EL14VZITR 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：SOIC包装说明：0.300 INCH, SOIC-20
针数：20Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.22
Is Samacsys：N系列：100EL
输入调节：DIFFERENTIAL MUXJESD-30 代码：R-PDSO-G20
JESD-609代码：e0长度：12.83 mm
逻辑集成电路类型：LOW SKEW CLOCK DRIVER湿度敏感等级：1
功能数量：1反相输出次数：
端子数量：20实输出次数：5
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP20,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：240
电源：-3.3/-5 VProp。Delay @ Nom-Sup：0.88 ns
传播延迟（tpd）：0.83 ns认证状态：Not Qualified
Same Edge Skew-Max（tskwd）：0.05 ns座面最大高度：2.65 mm
子类别：Clock Drivers表面贴装：YES
技术：ECL温度等级：INDUSTRIAL
端子面层：Tin/Lead (Sn85Pb15)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30宽度：7.52 mm
Base Number Matches：1

SY100EL14VZITR 数据手册

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®  
®
5V/3.3V 1:5 CLOCK  
DISTRIBUTION  
Precision Edge  
SY100EL14V  
FEATURES  
■ 3.3V and 5V power supply options  
■ Typical 30ps output-to-output skew  
■ Max. 50ps output-to-output skew  
■ Synchronous enable/disable  
®
Precision Edge  
DESCRIPTION  
■ Multiplexed clock input  
The SY100EL14V is a low skew 1:5 clock distribution  
chip designed explicitly for low skew clock distribution  
applications. The device can be driven by either a  
differential or single-ended ECL or, if positive power  
supplies are used, PECL input signal. The EL14V is  
suitable for operation in systems operating from 3.3V to  
5.0V supplies. If a single-ended input is to be used the  
VBB output should be connected to the CLK input and  
bypassed to ground via a 0.01µF capacitor. The VBB  
output is designed to act as the switching reference for  
the input of the EL14V under single-ended input  
conditions, as a result this pin can only source/sink up to  
0.5mA of current.  
■ 75KΩ internal input pull-down resistors  
■ Available in 20-pin SOIC package  
The EL14V features a multiplexed clock input to allow  
for the distribution of a lower speed scan or test clock  
along with the high speed system clock. When LOW (or  
left open and pulled LOW by the input pull-down resistor)  
the SEL pin will select the differential clock input.  
The common enable (EN) is synchronous so that the  
outputs will only be enabled/disabled when they are  
already in the LOW state. This avoids any chance of  
generating a runt clock pulse when the device is enabled/  
disabled as can happen with an asynchronous control.  
The internal flip flop is clocked on the falling edge of the  
input clock, therefore all associated specification limits  
are referenced to the negative edge of the clock input.  
When both differential inputs are left open, CLK input  
will pull down to VEE and CLK input will bias around  
VCC/2.  
Precision Edge is a registered trademark of Micrel, Inc.  
Rev.: D  
Amendment:/0  
M9999-031006  
hbwhelp@micrel.com or (408) 955-1690  
1
Issue Date: March 2006  
12345

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与SY100EL14VZITR相关器件

型号 品牌 获取价格 描述 数据表
SY100EL14VZY MICROCHIP

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 		100EL SERIES, LOW SKEW CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20
SY100EL14VZYTR MICREL

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 		暂无描述
SY100EL14VZYTR MICROCHIP

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 		100EL SERIES, LOW SKEW CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20, 0.300
SY100EL14VZY-TR MICROCHIP

获取价格

 		100EL SERIES, LOW SKEW CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20
SY100EL15 MICREL

获取价格

 		1:4 CLOCK DISTRIBUTION
SY100EL15L MICREL

获取价格

 		3.3V 1:4 CLOCK DISTRIBUTION
SY100EL15L MICROCHIP

获取价格

 		The SY100EL15L is a low skew 1:4 clock distribution IC designed explicitly for low skew cl
SY100EL15L_06 MICREL

获取价格

 		3.3V 1:4 CLOCK DISTRIBUTION
SY100EL15LZC MICREL

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 		3.3V 1:4 CLOCK DISTRIBUTION
SY100EL15LZCTR MICREL

获取价格

 		3.3V 1:4 CLOCK DISTRIBUTION

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