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| 是否无铅： | 含铅 | 是否Rohs认证： | 不符合 |
| 生命周期： | Obsolete | 零件包装代码： | DIP |
| 包装说明： | DIP, DIP14,.3 | 针数： | 14 |
| Reach Compliance Code： | unknown | HTS代码： | 8542.39.00.01 |
| 风险等级： | 5.19 | 系列： | LS |
| JESD-30 代码： | R-PDIP-T14 | JESD-609代码： | e0 |
| 长度： | 18.86 mm | 逻辑集成电路类型： | NAND GATE |
| 功能数量： | 3 | 输入次数： | 3 |
| 端子数量： | 14 | 最高工作温度： | 70 °C |
| 最低工作温度： | 封装主体材料： | PLASTIC/EPOXY | |
| 封装代码： | DIP | 封装等效代码： | DIP14,.3 |
| 封装形状： | RECTANGULAR | 封装形式： | IN-LINE |
| 峰值回流温度（摄氏度）： | NOT SPECIFIED | 电源： | 5 V |
| 传播延迟（tpd）： | 15 ns | 认证状态： | Not Qualified |
| 施密特触发器： | NO | 座面最大高度： | 5.08 mm |
| 子类别： | Gates | 最大供电电压 (Vsup)： | 5.25 V |
| 最小供电电压 (Vsup)： | 4.75 V | 标称供电电压 (Vsup)： | 5 V |
| 表面贴装： | NO | 技术： | TTL |
| 温度等级： | COMMERCIAL | 端子面层： | Tin/Lead (Sn/Pb) |
| 端子形式： | THROUGH-HOLE | 端子节距： | 2.54 mm |
| 端子位置： | DUAL | 处于峰值回流温度下的最长时间： | NOT SPECIFIED |
| 宽度： | 7.62 mm | Base Number Matches： | 1 |
| 型号 | 品牌 | 获取价格 | 描述 | 数据表 |
| SN74LS10NSR | TI |
获取价格 |
TRIPLE 3-INPUT POSITIVE-NAND GATES |
|
| SN74LS10NSRG4 | TI |
获取价格 |
LS SERIES, TRIPLE 3-INPUT NAND GATE, PDSO14, GREEN, PLASTIC, SOP-14 |
|
| SN74LS11 | TI |
获取价格 |
TRIPLE 3-INPUT POSITIVE-AND GATES |
|
| SN74LS112 | TI |
获取价格 |
DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS WITH PRESET AND CLEAR |
|
| SN74LS112A | TI |
获取价格 |
DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS WITH PRESET AND CLEAR |
|
| SN74LS112AD | TI |
获取价格 |
DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS WITH PRESET AND CLEAR |
|
| SN74LS112ADE4 | TI |
获取价格 |
DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS WIITH PRESET AND CLEAR |
|
| SN74LS112ADG4 | TI |
获取价格 |
LS SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO16, GREEN |
|
| SN74LS112ADR | TI |
获取价格 |
DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS WIITH PRESET AND CLEAR |
|
| SN74LS112ADR2 | MOTOROLA |
获取价格 |
LS SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO16, PLAST |
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