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Datasheet > 逻辑 > 触发器/锁存器> SN74ALS112ADR
SN74ALS112ADR PDF预览

SN74ALS112ADR

更新时间： 2024-11-24 13:00:55
品牌 Logo 应用领域
德州仪器 - TI 触发器
页数 文件大小 规格书
6页 99K
描述
Dual J-K Negative-Edge-Triggered Flip-Flops With Clear and Preset 16-SOIC 0 to 70

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SN74ALS112ADR 技术参数

是否Rohs认证：符合生命周期：Obsolete
零件包装代码：SOIC包装说明：SO-16
针数：16Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
Factory Lead Time：1 week风险等级：5.52
Is Samacsys：N系列：ALS
JESD-30 代码：R-PDSO-G16JESD-609代码：e4
长度：9.9 mm负载电容（CL）：50 pF
逻辑集成电路类型：J-K FLIP-FLOP最大频率@ Nom-Sup：30000000 Hz
最大I（ol）：0.008 A湿度敏感等级：1
位数：2功能数量：2
端子数量：16最高工作温度：70 °C
最低工作温度：输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP16,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE包装方法：TAPE AND REEL
峰值回流温度（摄氏度）：260电源：5 V
最大电源电流（ICC）：4.5 mA传播延迟（tpd）：19 ns
认证状态：Not Qualified座面最大高度：1.75 mm
子类别：FF/Latches最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：TTL
温度等级：COMMERCIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：NEGATIVE EDGE宽度：3.9 mm
最小 fmax：30 MHzBase Number Matches：1

SN74ALS112ADR 数据手册

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SN54ALS112A, SN74ALS112A  
DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS  
WITH CLEAR AND PRESET  
SDAS199A – APRIL 1982 – REVISED DECEMBER 1994  
SN54ALS112A . . . J PACKAGE  
SN74ALS112A . . . D OR N PACKAGE  
(TOP VIEW)  
• Fully Buffered to Offer Maximum Isolation  
From External Disturbance  
• Package Options Include Plastic  
Small-Outline (D) Packages, Ceramic Chip  
Carriers (FK), and Standard Plastic (N) and  
Ceramic (J) 300-mil DIPs  
1CLK  
1K  
V
CC  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
1CLR  
2CLR  
2CLK  
2K  
1J  
1PRE  
1Q  
TYPICAL MAXIMUM TYPICAL POWER  
CLOCK  
FREQUENCY  
(MHz)  
DISSIPATION  
PER FLIP-FLOP  
(mW)  
TYPE  
1Q  
11 2J  
10  
9
2Q  
2PRE  
2Q  
GND  
′ALS112A  
50  
6
description  
SN54ALS112A . . . FK PACKAGE  
(TOP VIEW)  
These devices contain two independent J-K  
negative-edge-triggered flip-flops. A low level at  
the preset (PRE) or clear (CLR) inputs sets or  
resets the outputs, regardless of the levels of the  
other inputs. When PRE and CLR are inactive  
(high), data at the J and K inputs meeting the  
setup-time requirements is transferred to the  
outputs on the negative-going edge of the clock  
pulse (CLK). Clock triggering occurs at a voltage  
level and is not directly related to the fall time of the  
clock pulse. Following the hold-time interval, data  
at the J and K inputs may be changed without  
affecting the levels at the outputs. These versatile  
flip-flops can perform as toggle flip-flops by tying  
J and K high.  
3
2
1 20 19  
18  
1J  
1PRE  
NC  
4
5
6
7
8
2CLR  
2CLK  
NC  
17  
16  
15  
14  
1Q  
2K  
1Q  
2J  
9 10 11 12 13  
NC – No internal connection  
The SN54ALS112A is characterized for operation over the full military temperature range of –55°C to 125°C.  
The SN74ALS112A is characterized for operation from 0°C to 70°C.  
FUNCTION TABLE  
(each flip-flop)  
INPUTS  
OUTPUTS  
PRE  
L
CLR  
H
CLK  
X
J
X
X
X
L
K
X
X
X
L
Q
H
L
Q
L
H
L
X
H
†
H
†
L
L
X
H
H
H
↓
Q
Q
0
0
H
H
↓
H
L
L
H
L
H
H
↓
H
H
X
L
H
H
H
↓
H
X
Toggle  
H
H
H
Q
Q
0
0
†
The output levels in this configuration may not meet the  
minimum levels for V . Furthermore, this configuration is  
nonstable; that is, it does not persist when either PRE or  
CLR returns to its inactive (high) level.  
OH  
Copyright 1994, Texas Instruments Incorporated  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
testing of all parameters.  
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
123456

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SN74ALS112ADR 替代型号

型号 品牌 替代类型 描述 数据表
SN74ALS112ANSR TI

完全替代

 Dual J-K Negative-Edge-Triggered Flip-Flops With Clear and Preset 16-SO 0 to 70
SN74LS112ADRE4 TI

类似代替

 DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS WIITH PRESET AND CLEAR
SN74ALS112AD TI

类似代替

 DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS WITH CLEAR AND PRESET

与SN74ALS112ADR相关器件

型号 品牌 获取价格 描述 数据表
SN74ALS112AFN TI

获取价格

 		IC,FLIP-FLOP,DUAL,J/K TYPE,ALS-TTL,LDCC,20PIN,PLASTIC
SN74ALS112AFN-00 TI

获取价格

 		ALS SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PQCC20
SN74ALS112AJ TI

获取价格

 		IC,FLIP-FLOP,DUAL,J/K TYPE,ALS-TTL,DIP,16PIN,CERAMIC
SN74ALS112AJ4 TI

获取价格

 		IC,FLIP-FLOP,DUAL,J/K TYPE,ALS-TTL,DIP,16PIN,CERAMIC
SN74ALS112AJP4 TI

获取价格

 		IC,FLIP-FLOP,DUAL,J/K TYPE,ALS-TTL,DIP,16PIN,CERAMIC
SN74ALS112AN TI

获取价格

 		DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS WITH CLEAR AND PRESET
SN74ALS112AN3 TI

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 		DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS WITH CLEAR AND PRESET
SN74ALS112ANP1 TI

获取价格

 		IC,FLIP-FLOP,DUAL,J/K TYPE,ALS-TTL,DIP,16PIN,PLASTIC
SN74ALS112ANP3 TI

获取价格

 		IC,FLIP-FLOP,DUAL,J/K TYPE,ALS-TTL,DIP,16PIN,PLASTIC
SN74ALS112ANSR TI

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 		Dual J-K Negative-Edge-Triggered Flip-Flops With Clear and Preset 16-SO 0 to 70

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