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SN74ALS113AD PDF预览

SN74ALS113AD

更新时间： 2024-11-20 20:08:03
品牌 Logo 应用领域
德州仪器 - TI 光电二极管逻辑集成电路触发器
页数 文件大小 规格书
4页 55K
描述
Dual J-K Negative-Edge-Triggered Flip-Flops With Preset 14-SOIC 0 to 70

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SN74ALS113AD 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：SOP, SOP14,.25针数：14
Reach Compliance Code：not_compliantHTS代码：8542.39.00.01
风险等级：5.8系列：ALS
JESD-30 代码：R-PDSO-G14长度：8.65 mm
负载电容（CL）：50 pF逻辑集成电路类型：J-K FLIP-FLOP
位数：2功能数量：2
端子数量：14最高工作温度：70 °C
最低工作温度：输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP14,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：NOT SPECIFIED
电源：5 V最大电源电流（ICC）：4.5 mA
传播延迟（tpd）：19 ns认证状态：Not Qualified
座面最大高度：1.75 mm子类别：FF/Latches
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：TTL温度等级：COMMERCIAL
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：NEGATIVE EDGE宽度：3.9 mm
最小 fmax：30 MHzBase Number Matches：1

SN74ALS113AD 数据手册

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SN54ALS113A, SN74ALS113A  
DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS  
WITH PRESET  
SDAS200 – D2661, APRIL 1982 – REVISED MAY 1986  
• Fully Buffered to Offer Maximum isolation  
SN54ALS113A . . . J PACKAGE  
SN74ALS113A . . . D OR N PACKAGE  
from External Disturbance  
(TOP VIEW)  
• Package Options Include Plastic Small  
Outline Packages, Ceramic Chip Carriers,  
and Standard Plastic and Ceramic 300-mil  
DIPs  
V
1
2
3
4
5
6
7
14  
13  
12  
11  
10  
9
1 CLK  
1K  
1J  
1PRE  
1Q  
CC  
2CLK  
2K  
2J  
2PRE  
2Q  
• Dependable Texas Instruments Quality and  
Reliability  
1Q  
GND  
TYPICAL POWER  
DISSIPATION  
PER FLIP-FLOP  
TYPICAL MAXIMUM  
CLOCK FREQUENCY  
TYPE  
2Q  
8
’ALS113A  
40 MHz (C =15 pF)  
6 mW  
L
SN54ALS113A . . . FK PACKAGE  
(TOP VIEW)  
description  
These devices contain two independent J-K  
negative-edge-triggered flip-flops. A low level at  
the Preset input sets the outputs regardless of the  
levels of the other inputs. When Preset PRE is  
inactive (high), data at the J and K inputs meeting  
the setup time requirements are transferred to the  
outputs on the negative-going edge of the clock  
pulse. Clock triggering occurs at a voltage level  
and is not directly related to the fall time of the  
clock pulse. Following the hold time interval, data  
at the J and K inputs may be changed without  
affecting the levels at the outputs. These versatile  
flip-flops can perform as toggle flip-flops by tying  
J and K high.  
3
2
1
20 19  
18  
2K  
1J  
NC  
4
5
6
7
8
NC  
2J  
17  
16  
15  
14  
1PRE  
NC  
NC  
2PRE  
1Q  
9 10 11 12 13  
NC–No internal connection  
†
logic symbol  
The SN54ALS113A is characterized for operation  
over the full military temperature range of –55°C  
to 125°C. The SN74ALS113A is characterized for  
operation from 0°C to 70°C.  
4
3
S
1PRE  
1J  
5
1Q  
1J  
1
2
C1  
1K  
1CLK  
1K  
FUNCTION TABLE  
6
9
8
1Q  
2Q  
2Q  
INPUTS  
OUTPUTS  
10  
PRE  
L
CLK  
J
X
L
K
X
L
Q
Q
2PRE  
2J  
X
↓
H
L
11  
13  
H
Q
Q
0
0
2CLK  
2K  
H
↓
H
L
L
H
L
12  
H
↓
H
H
X
L
H
H
↓
H
X
TOGGLE  
H
H
Q
Q
0
0
†
This symbol is in accordance with ANSI/IEEE Std 91-1984 and  
IEC Publication 617-12.  
Pin numbers shown are for D, J, and N packages.  
Copyright 1986, Texas Instruments Incorporated  
5BASIC  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
testing of all parameters.  
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
1234

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与SN74ALS113AD相关器件

型号 品牌 获取价格 描述 数据表
SN74ALS113ADR TI

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 		DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS WITH PRESET
SN74ALS113AFN TI

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 		IC,FLIP-FLOP,DUAL,J/K TYPE,ALS-TTL,LDCC,20PIN,PLASTIC
SN74ALS113AFN-00 TI

获取价格

 		ALS SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PQCC20
SN74ALS113AJ4 TI

获取价格

 		IC,FLIP-FLOP,DUAL,J/K TYPE,ALS-TTL,DIP,14PIN,CERAMIC
SN74ALS113AJP4 TI

获取价格

 		IC,FLIP-FLOP,DUAL,J/K TYPE,ALS-TTL,DIP,14PIN,CERAMIC
SN74ALS113AN ROCHESTER

获取价格

 		J-K Flip-Flop, ALS Series, 2-Func, Negative Edge Triggered, 2-Bit, Complementary Output, T
SN74ALS113AN TI

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 		Dual J-K Negative-Edge-Triggered Flip-Flops With Preset 14-PDIP 0 to 70
SN74ALS113AN-10 TI

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 		ALS SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PDIP14
SN74ALS113AN3 TI

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 		IC,FLIP-FLOP,DUAL,J/K TYPE,ALS-TTL,DIP,14PIN,PLASTIC
SN74ALS113ANP1 TI

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 		IC,FLIP-FLOP,DUAL,J/K TYPE,ALS-TTL,DIP,14PIN,PLASTIC

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