SN54LS173AJD

更新时间： 2024-09-10 12:57:55

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摩托罗拉 - MOTOROLA		输出元件
页数	文件大小	规格书
6页	210K
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LS SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, CDIP16, CERAMIC, DIP-16

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SN54LS173AJD 技术参数

生命周期：	Obsolete	零件包装代码：	DIP
包装说明：	DIP,	针数：	16
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.21	Is Samacsys：	N
其他特性：	WITH HOLD MODE	系列：	LS
JESD-30 代码：	R-GDIP-T16	长度：	19.3 mm
负载电容（CL）：	45 pF	逻辑集成电路类型：	D FLIP-FLOP
位数：	4	功能数量：	1
端子数量：	16	最高工作温度：	125 °C
最低工作温度：	-55 °C	输出特性：	3-STATE
输出极性：	TRUE	封装主体材料：	CERAMIC, GLASS-SEALED
封装代码：	DIP	封装形状：	RECTANGULAR
封装形式：	IN-LINE	最大电源电流（ICC）：	30 mA
传播延迟（tpd）：	30 ns	认证状态：	Not Qualified
座面最大高度：	4.19 mm	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	4.5 V	标称供电电压 (Vsup)：	5 V
表面贴装：	NO	技术：	TTL
温度等级：	MILITARY	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
触发器类型：	POSITIVE EDGE	宽度：	7.62 mm
最小 fmax：	30 MHz	Base Number Matches：	1

SN54LS173AJD 数据手册

SN54/74LS173A

4-BIT D-TYPE REGISTER

WITH 3-STATE OUTPUTS

The SN54/74LS173A is a high-speed 4-Bit Register featuring 3-state

outputs for use in bus-organized systems. The clock is fully edge-triggered

allowing either a load from the D inputs or a hold (retain register contents)

4-BIT D-TYPE REGISTER

WITH 3-STATE OUTPUTS

depending on the state of the Input Enable Lines (IE , IE ). A HIGH on either

Output Enable line (OE , OE ) brings the output to a high impedance state

LOW POWER SCHOTTKY

without affecting the actual register contents. A HIGH on the Master Reset

(MR) input resets the Register regardless of the state of the Clock (CP), the

Output Enable (OE , OE ) or the Input Enable (IE , IE ) lines.

• Fully Edge-Triggered

• 3-State Outputs

J SUFFIX

CERAMIC

CASE 620-09

• Gated Input and Output Enables

• Input Clamp Diodes Limit High-Speed Termination Effects

CONNECTION DIAGRAM DIP (TOP VIEW)

N SUFFIX

PLASTIC

CASE 648-08

NOTE:

The Flatpak version

has the same pinouts

(Connection Diagram) as

the Dual In-Line Package.

D SUFFIX

SOIC

CASE 751B-03

ORDERING INFORMATION

SN54LSXXXJ

Ceramic

SN74LSXXXN Plastic

SN74LSXXXD SOIC

PIN NAMES

LOADING (Note a)

HIGH

LOW

D –D

Data Inputs

0.5 U.L.

0.25 U.L.

LOGIC SYMBOL

IE –IE

Input Enable (Active LOW)

Output Enable (Active LOW) Inputs

Clock Pulse (Active HIGH Going Edge)

Input

0.5 U.L.

OE –OE

Q –Q

Master Reset Input (Active HIGH)

Outputs (Note b)

0.5 U.L.

65 (25) U.L. 15 (7.5) U.L.

0.25 U.L.

NOTES:

a. 1 TTL Unit Load (U.L.) = 40 µA HIGH/1.6 mA LOW.

b. The Output LOW drive factor is 2.5 U.L. for Military (54) and 5 U.L. for Commercial (74)

b. Temperature Ranges.

FAST AND LS TTL DATA

5-316

12 3 4 5 6

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与SN54LS173AJD相关器件

型号	品牌	获取价格	描述	数据表
SN54LS173AW	TI	获取价格	4-BIT D-TYPE REGISTERS WITH 3-STATE OUTPUTS
SN54LS173J	MOTOROLA	获取价格	4-BIT D-TYPE REGISTER WITH 3-STATE OUTPUTS
SN54LS173W	TI	获取价格	JBAR-KBAR FLIP-FLOP
SN54LS174	MOTOROLA	获取价格	HEX D FLIP-FLOP
SN54LS174	TI	获取价格	HEX/QUADRUPLE D-TYPE FLIP-FLOPS WITH CLEAR
SN54LS174FK	ROCHESTER	获取价格	D Flip-Flop, LS Series, 1-Func, Positive Edge Triggered, 6-Bit, True Output, TTL, CQCC20,
SN54LS174J	TI	获取价格	HEX/QUADRUPLE D-TYPE FLIP-FLOPS WITH CLEAR
SN54LS174J	MOTOROLA	获取价格	HEX D FLIP-FLOP
SN54LS174J	ROCHESTER	获取价格	D Flip-Flop, LS Series, 1-Func, Positive Edge Triggered, 6-Bit, True Output, TTL, CDIP16,
SN54LS174JD	MOTOROLA	获取价格	LS SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, CDIP16, CERAMIC, DIP-16

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