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SN54AHC594FKR PDF预览

SN54AHC594FKR

更新时间： 2024-11-02 13:13:43
品牌 Logo 应用领域
德州仪器 - TI 移位寄存器输出元件
页数 文件大小 规格书
17页 441K
描述
AHC SERIES, 8-BIT RIGHT SERIAL IN PARALLEL OUT SHIFT REGISTER, TRUE OUTPUT, CQCC20, CERAMIC, LCC-20

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SN54AHC594FKR 技术参数

生命周期：Obsolete零件包装代码：QLCC
包装说明：CERAMIC, LCC-20针数：20
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.84Is Samacsys：N
其他特性：PARALLEL OUTPUT IS REGISTERED计数方向：RIGHT
系列：AHCJESD-30 代码：S-CQCC-N20
长度：8.89 mm逻辑集成电路类型：SERIAL IN PARALLEL OUT
位数：8功能数量：1
端子数量：20最高工作温度：125 °C
最低工作温度：-55 °C输出极性：TRUE
封装主体材料：CERAMIC, METAL-SEALED COFIRED封装代码：QCCN
封装形状：SQUARE封装形式：CHIP CARRIER
传播延迟（tpd）：13.9 ns认证状态：Not Qualified
座面最大高度：2.03 mm最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子形式：NO LEAD
端子节距：1.27 mm端子位置：QUAD
触发器类型：POSITIVE EDGE宽度：8.89 mm
最小 fmax：115 MHzBase Number Matches：1

SN54AHC594FKR 数据手册

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SCLS423F − JUNE 1998 − REVISED SEPTEMBER 2003  
SN54AHC594 . . . J OR W PACKAGE  
SN74AHC594 . . . D, DB, N, NS, OR PW PACKAGE  
(TOP VIEW)  
D
D
Operating Range 2-V to 5.5-V V  
CC  
8-Bit Serial-In, Parallel-Out Shift  
Registers With Storage  
Q
Q
V
CC  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
D
D
D
D
Independent Direct Overriding Clears  
on Shift and Storage Registers  
B
Q
C
D
A
Q
SER  
Independent Clocks for Shift and  
Storage Registers  
Q
RCLR  
E
Q
12 RCLK  
F
Latch-Up Performance Exceeds 100 mA  
Per JESD 78, Class II  
11  
10  
9
Q
SRCLK  
SRCLR  
G
Q
H
ESD Protection Exceeds JESD 22  
− 2000-V Human-Body Model (A114-A)  
− 200-V Machine Model (A115-A)  
GND  
Q
H′  
SN54AHC594 . . . FK PACKAGE  
(TOP VIEW)  
− 1000-V Charged-Device Model (C101)  
description/ordering information  
The ’AHC594 devices contain an 8-bit serial-in,  
parallel-out shift register that feeds an 8-bit D-type  
storage register. Separate clocks and direct  
overriding clear (SRCLR, RCLR) inputs are  
provided on the shift and storage registers. A  
3
2
1
20 19  
18  
SER  
RCLR  
NC  
Q
4
5
6
7
8
D
Q
17  
16  
E
NC  
15 RCLK  
14  
9 10 11 12 13  
Q
F
serial (Q ) output is provided for cascading  
H′  
SRCLK  
Q
G
purposes.  
The shift register (SRCLK) and storage register  
(RCLK) clocks are positive-edge triggered. If the  
clocks are tied together, the shift register always  
is one clock pulse ahead of the storage register.  
NC − No internal connection  
ORDERING INFORMATION  
ORDERABLE  
PART NUMBER  
TOP-SIDE  
MARKING  
†
PACKAGE  
T
A
PDIP − N  
SOIC − D  
Tube  
SN74AHC594N  
SN74AHC594N  
Tube  
SN74AHC594D  
AHC594  
Tape and reel  
Tape and reel  
Tape and reel  
Tube  
SN74AHC594DR  
SN74AHC594NSR  
SN74AHC594DBR  
SN74AHC594PW  
SN74AHC594PWR  
SNJ54AHC594J  
SNJ54AHC594W  
SNJ54AHC594FK  
−40°C to 85°C  
SOP − NS  
AHC594  
HA594  
SSOP − DB  
TSSOP − PW  
HA594  
Tape and reel  
Tube  
CDIP − J  
CFP − W  
LCCC − FK  
SNJ54AHC594J  
SNJ54AHC594W  
SNJ54AHC594FK  
Tube  
−55°C to 125°C  
Tube  
†
Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines are  
available at www.ti.com/sc/package.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Copyright 2003, Texas Instruments Incorporated  
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1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
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SN54AHC594J TI

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