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NBSG14MN

更新时间： 2024-11-07 03:46:55
品牌 Logo 应用领域
安森美 - ONSEMI 驱动器时钟
页数 文件大小 规格书
13页 391K
描述
2.5V/3.3V SiGe Differential 1:4 Clock/Data Driver with RSECL Outputs

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NBSG14MN 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFN包装说明：QFN-16
针数：16Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.42
其他特性：RSNECL MODE: VCC = 0 V WITH VEE = -2.375 V TO -3.465 V系列：14
输入调节：DIFFERENTIALJESD-30 代码：S-XQCC-N16
JESD-609代码：e0长度：3 mm
逻辑集成电路类型：LOW SKEW CLOCK DRIVER功能数量：1
反相输出次数：端子数量：16
实输出次数：4最高工作温度：85 °C
最低工作温度：-40 °C输出特性：SERIES-RESISTOR
封装主体材料：UNSPECIFIED封装代码：HVQCCN
封装等效代码：LCC16,.12SQ,20封装形状：SQUARE
封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE峰值回流温度（摄氏度）：240
电源：-2.5/-3.3/2.5/3.3 VProp。Delay @ Nom-Sup：0.15 ns
传播延迟（tpd）：0.16 ns认证状态：Not Qualified
Same Edge Skew-Max（tskwd）：0.015 ns座面最大高度：1 mm
子类别：Clock Drivers最大供电电压 (Vsup)：3.465 V
最小供电电压 (Vsup)：2.375 V标称供电电压 (Vsup)：2.5 V
表面贴装：YES技术：ECL
温度等级：INDUSTRIAL端子面层：Tin/Lead (Sn90Pb10)
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：30
宽度：3 mm最小 fmax：10500 MHz
Base Number Matches：1

NBSG14MN 数据手册

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NBSG14  
2.5V/3.3VꢀSiGe Differential  
1:4 Clock/Data Driver with  
RSECL* Outputs  
*Reduced Swing ECL  
http://onsemi.com  
MARKING DIAGRAMS*  
Description  
The NBSG14 is a 1−to−4 clock/data distribution chip, optimized for  
ultra−low skew and jitter.  
SG  
14  
ALYW  
Inputs incorporate internal 50 ꢀ termination resistors and accept  
NECL (Negative ECL), PECL (Positive ECL), LVTTL, LVCMOS,  
CML, or LVDS. Outputs are RSECL (Reduced Swing ECL), 400 mV.  
FCBGA−16  
BA SUFFIX  
CASE 489  
Features  
• Maximum Input Clock Frequency up to 12 GHz Typical  
• Maximum Input Data Rate up to 12 Gb/s Typical  
• 30 ps Typical Rise and Fall Times  
• 125 ps Typical Propagation Delay  
16  
1
SG14  
ALYWG  
G
• RSPECL Output with Operating Range: V = 2.375 V to 3.465 V  
QFN−16  
MN SUFFIX  
CASE 485G  
CC  
with V = 0 V  
EE  
• RSNECL Output with RSNECL or NECL Inputs with  
Operating Range: V = 0 V with V = −2.375 V to −3.465 V  
CC  
EE  
• RSECL Output Level (400 mV Peak−to−Peak Output),  
Differential Output  
A
L
= Assembly Location  
= Wafer Lot  
Y
W
G
= Year  
= Work Week  
= Pb−Free Package  
• 50 ꢀ Internal Input Termination Resistors  
• Compatible with Existing 2.5 V/3.3 V LVEP, EP, and LVEL Devices  
• Pb−Free Packages are Available  
(Note: Microdot may be in either location)  
*For additional marking information, refer to  
Application Note AND8002/D.  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 11 of this data sheet.  
© Semiconductor Components Industries, LLC, 2006  
1
Publication Order Number:  
July, 2006 − Rev. 9  
NBSG14/D  
1234567...13

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