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MT90868AG2

更新时间： 2024-11-23 20:52:19
品牌 Logo 应用领域
美高森美 - MICROSEMI 电信电信集成电路
页数 文件大小 规格书
75页 1425K
描述
Digital Time Switch, PBGA466, 35 X 35 MM, LEAD FREE, PLASTIC, MS-034, BGA-466

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MT90868AG2 技术参数

生命周期：Active零件包装代码：BGA
包装说明：BGA,针数：466
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.58JESD-30 代码：S-PBGA-B466
JESD-609代码：e1长度：35 mm
功能数量：1端子数量：466
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：BGA
封装形状：SQUARE封装形式：GRID ARRAY
座面最大高度：2.46 mm标称供电电压：1.8 V
表面贴装：YES电信集成电路类型：DIGITAL TIME SWITCH
温度等级：INDUSTRIAL端子面层：TIN SILVER COPPER
端子形式：BALL端子节距：1.27 mm
端子位置：BOTTOM宽度：35 mm
Base Number Matches：1

MT90868AG2 数据手册

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MT90868  
High Bandwidth Digital Switch  
Data Sheet  
December 2009  
Features  
•
•
•
•
•
•
•
•
•
•
32,768-channel x 8,192-channel blocking  
switching between backplane and local streams  
Ordering Information  
MT90868AG  
466 Ball PBGA  
Trays  
8,192-channel x 8,192-channel non-blocking  
switching for local input and output streams  
MT90868AG2  
466 Ball PBGA* Trays  
*Pb Free Tin/Silver/Copper  
1,024-channel x 1,024-channel switch between  
two selected backplane input and output streams  
-40 to +85° C  
Rate conversion between backplane and local  
streams  
•
•
Per-channel constant throughput delay  
Per-channel high impedance output control for  
local streams  
Accepts ST-BUS streams with data rate of  
16.384 Mb/s or 32.768 Mb/s for backplane port  
•
•
•
Per-channel high impedance or driven-high output  
control for backplane streams  
Accepts ST-BUS streams with data rate of  
8.192 Mb/s for local port  
Per-channel message mode for backplane and  
local output streams  
Per-stream channel and bit delay for the local  
input streams  
Pseudo-Random Binary Sequence (PRBS)  
pattern generation and testing for local and  
backplane ports  
Per-stream channel and bit advancement for the  
local output streams  
Per-stream bit delay for the backplane input  
streams  
•
•
Non-multiplexed microprocessor interface  
Connection memory block programming for fast  
device initialization  
Per-stream bit advancement for the backplane  
output streams  
V
V
V (GND)  
SS  
RESET  
ODE  
DD_IO  
DD_core  
BIME  
BSTi0-63  
BSTo0-63  
Backplane  
Interface  
Backplane Data Memories  
(32,768 channels)  
LSTo0-63  
LCSTo0-3  
S/P  
Converter  
Local  
Loopback  
Data  
Memory  
(1,024  
channels)  
Connection  
Memory  
(8,192  
locations)  
FP4o  
FP8o  
FP16o  
C4o  
C8o  
C16o  
Backplane  
Interface  
Local Timing  
Unit  
P/S  
Converter  
Local Data  
Memories  
(8,192 channels)  
FP8i  
C8i  
Output  
Mux  
Backplane  
Timing Unit  
LSTi0-63  
IC0-IC5  
Backplane  
Connection Memory  
(32,768 locations)  
Microprocessor Interface  
and Internal Registers  
APLL  
Test Port  
TMS TDi TDo TCK TRST  
DS CS R/W A15-A0 DTA D15-D0  
TM1 TM2 SG1 AT1 DT1  
Figure 1 - Functional Block Diagram  
1
Zarlink Semiconductor Inc.  
Zarlink, ZL and the Zarlink Semiconductor logo are trademarks of Zarlink Semiconductor Inc.  
Copyright 2002-2009, Zarlink Semiconductor Inc. All Rights Reserved.  
1234567...75

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