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MT90871AV

更新时间： 2024-02-14 12:57:38
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加拿大卓联 - ZARLINK 开关
页数 文件大小 规格书
65页 641K
描述
Flexible 8K Digital Switch (F8KDX)

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MT90871AV 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：BGA
包装说明：15 X 15 MM, 1 MM PITCH, LBGA-196针数：196
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.84JESD-30 代码：S-PBGA-B196
JESD-609代码：e0长度：15 mm
功能数量：1端子数量：196
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：BGA
封装等效代码：BGA196,14X14,40封装形状：SQUARE
封装形式：GRID ARRAY峰值回流温度（摄氏度）：225
电源：1.8,3.3 V认证状态：Not Qualified
座面最大高度：1.75 mm子类别：Other Telecom ICs
标称供电电压：1.8 V表面贴装：YES
电信集成电路类型：DIGITAL TIME SWITCH温度等级：INDUSTRIAL
端子面层：TIN LEAD端子形式：BALL
端子节距：1 mm端子位置：BOTTOM
处于峰值回流温度下的最长时间：30宽度：15 mm

MT90871AV 数据手册

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MT90871  
Flexible 8K Digital Switch (F8KDX)  
Data Sheet  
December 2002  
Features  
•
8,192-channel x 8,192-channel non-blocking  
Ordering Information  
unidirectional switching. The Backplane and  
Local inputs and outputs can be combined to  
form a non-blocking switching matrix with 32  
stream inputs and 32 stream outputs.  
MT90871AV 196 Ball LBGA  
-40C to +85C  
•
•
•
•
•
4,096-channel x 4,096 channel non-blocking  
Backplane to Local stream switch.  
•
•
•
•
Per-stream channel and bit delay for Local input  
streams.  
4,096-channel x 4,096 channel non-blocking  
Local to Backplane stream switch.  
Per-stream channel and bit delay for Backplane  
4,096-channel x 4,096 channel non-blocking  
input streams.  
Backplane input to Backplane output switch.  
Per-stream advancement for Local output  
streams.  
4,096-channel x 4,096 channel non-blocking  
Local input to Local output stream switch.  
Per-stream advancement for Backplane output  
Rate conversion on all data paths, Backplane to  
Local, Local to Backplane, Backplane to  
Backplane and Local to Local streams.  
Backplane port accepts 16 ST-BUS streams with  
data rates of 2.048Mb/s, 4.096Mb/s, 8.192Mb/s  
or 16.384Mb/s in any combination.  
Local port accepts 16 ST-BUS streams with data  
rates of 2.048Mb/s, 4.096Mb/s, 8.192Mb/s or  
16.384Mb/s, in any combination.  
streams.  
•
•
Constant throughput delay for frame integrity.  
Per-channel high impedance output control for  
•
•
Local and Backplane streams.  
•
•
Per-channel driven-high output control for Local  
and Backplane streams.  
High impedance-control outputs for external  
drivers on Backplane and Local port.  
V
V
V
SS (GND)  
DD_IO  
DD_CORE  
RESET  
ODE  
Backplane Data Memories  
(4,096 channels)  
BSTi0-15  
BSTo0-15  
LSTi0-15  
Backplane  
Local  
Local  
Backplane  
Interface  
Connection Memory  
(4,096 locations)  
Connection Memory  
(4,096 locations)  
Interface  
LSTo0-15  
LCST0-1  
BCST0-1  
BORS  
Local Data Memories  
(4,096 channels)  
LORS  
FP8o  
FP8i  
Local  
Backplane  
FP16o  
Timing  
Unit  
Timing Unit  
C8o  
C16o  
Microprocessor Interface  
and Internal Registers  
Test Port  
C8i  
PLL  
V
DD_PLL  
DS CS R/W A14-A0 DTA D15-D0 TMS TDi TDo TCK TRST  
Figure 1 - MT90871 Functional Block Diagram  
1
Zarlink Semiconductor Inc.  
1234567...65

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