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MPC9993AC

更新时间： 2024-11-11 14:53:55

品牌	Logo	应用领域
艾迪悌 - IDT		驱动逻辑集成电路
页数	文件大小	规格书
11页	331K
描述
PLL Based Clock Driver, 9993 Series, 5 True Output(s), 0 Inverted Output(s), CMOS, PQFP32, 7 X 7 MM, 1.40 MM HEIGHT, 0.80 MM PITCH, LEAD FREE, MS-026BBA, LQFP-32

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MPC9993AC 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	LQFP-32	针数：	32
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.25
Is Samacsys：	N	系列：	9993
输入调节：	DIFFERENTIAL MUX	JESD-30 代码：	S-PQFP-G32
JESD-609代码：	e3	长度：	7 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	最大I（ol）：	0.024 A
湿度敏感等级：	3	功能数量：	1
反相输出次数：		端子数量：	32
实输出次数：	5	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	LQFP	封装等效代码：	QFP32,.35SQ,32
封装形状：	SQUARE	封装形式：	FLATPACK, LOW PROFILE
峰值回流温度（摄氏度）：	260	电源：	3.3 V
传播延迟（tpd）：	1.8 ns	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.08 ns	座面最大高度：	1.6 mm
子类别：	Clock Drivers	最大供电电压 (Vsup)：	3.465 V
最小供电电压 (Vsup)：	3.135 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Matte Tin (Sn) - annealed
端子形式：	GULL WING	端子节距：	0.8 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	7 mm	最小 fmax：	100 MHz
Base Number Matches：	1

MPC9993AC 数据手册

Intelligent Dynamic Clock Switch (IDCS)

PLL Clock Driver

MPC9993

Product Discontinuance Notice – Last Time Buy Expires on (12/7/2013)

DATASHEET

The MPC9993 is a PLL clock driver designed specifically for redundant clock

tree designs. The device receives two differential LVPECL clock signals from

which it generates 5 new differential LVPECL clock outputs. Two of the output

pairs regenerate the input signals frequency and phase while the other three

pairs generate 2x, phase aligned clock outputs.

MPC9993

Features

•

Fully Integrated PLL

INTELLIGENT DYNAMIC

CLOCK SWITCH

PLL CLOCK DRIVER

Intelligent Dynamic Clock Switch

LVPECL Clock Outputs

LVCMOS Control I/O

3.3 V Operation

32-Lead LQFP Packaging

32-Lead Pb-Free Package Available

Functional Description

FA SUFFIX

32-LEAD LQFP PACKAGE

CASE 873A-04

The MPC9993 Intelligent Dynamic Clock Switch (IDCS) circuit continuously

monitors both input CLK signals. Upon detection of a failure (CLK stuck HIGH or

LOW for at least 1 period), the INP_BAD for that CLK will be latched (H). If that

CLK is the primary clock, the IDCS will switch to the good secondary clock and

phase/frequency alignment will occur with minimal output phase disturbance.

The typical phase bump caused by a failed clock is eliminated. (See Application

Information section).

AC SUFFIX

32-LEAD LQFP PACKAGE

Pb-FREE PACKAGE

CASE 873A-04

PLL_En

Clk_Selected

Inp1bad

Dynamic

Inp0bad

Switch

Man_Override

Alarm_Reset

Logic

Qb0

Sel_Clk

CLK0

Qb1

Qb2

CLK0

CLK1

8

16

PLL

Qa0

Ext_FB

800 – 1600 MHz

Qa1

Figure 1. Block Diagram

MPC9993 REVISION 3 JANUARY 23, 2013

12 3 4 5 6 7...11

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MPC9993AC 替代型号

型号	品牌	替代类型	描述	数据表
MPC9993ACR2	IDT	完全替代	PLL Based Clock Driver, 9993 Series, 5 True Output(s), 0 Inverted Output(s), CMOS, PQFP32,

与MPC9993AC相关器件

型号	品牌	获取价格	描述	数据表
MPC9993ACR2	IDT	获取价格	PLL Based Clock Driver, 9993 Series, 5 True Output(s), 0 Inverted Output(s), CMOS, PQFP32,
MPC9993D	MOTOROLA	获取价格	INTELLIGENT DYNAMIC CLOCK SWITCH (IDCS)PLL CLOCK DRIVER
MPC9993DFA	MOTOROLA	获取价格	INTELLIGENT DYNAMIC CLOCK SWITCH (IDCS)PLL CLOCK DRIVER
MPC9993FA	MOTOROLA	获取价格	INTELLIGENT DYNAMIC CLOCK SWITCH (IDCS)PLL CLOCK DRIVER
MPC9993FAR2	NXP	获取价格	IC,1:5 OUTPUT, DIFFERENTIAL,CMOS,QFP,32PIN,PLASTIC
MPC9993FAR2	MOTOROLA	获取价格	PLL BASED CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32, PLASTIC, LQFP-32
MPC99J93	MOTOROLA	获取价格	Intelligent Dynamic Clock Switch (IDCS) PLL Clock Driver
MPC99J93ACR2	NXP	获取价格	99J SERIES, PLL BASED CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32, LQFP-3
MPC99J93FA	MOTOROLA	获取价格	PLL Based Clock Driver, 5 True Output(s), 0 Inverted Output(s), PQFP32, PLASTIC, LQFP-32
MPC99J93FA	NXP	获取价格	PLL BASED CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32, PLASTIC, LQFP-32

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