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MCM67Q909ZP12

更新时间： 2024-11-07 22:06:43
品牌 Logo 应用领域
摩托罗拉 - MOTOROLA 存储内存集成电路静态存储器时钟
页数 文件大小 规格书
10页 143K
描述
512K x 9 Bit Separate I/O Synchronous Fast Static RAM

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MCM67Q909ZP12 技术参数

是否Rohs认证：不符合生命周期：Obsolete
零件包装代码：BGA包装说明：BGA, BGA86,9X10
针数：86Reach Compliance Code：unknown
ECCN代码：3A991.B.2.AHTS代码：8542.32.00.41
风险等级：5.55Is Samacsys：N
最长访问时间：5 ns最大时钟频率 (fCLK)：83 MHz
I/O 类型：SEPARATEJESD-30 代码：R-PBGA-B86
JESD-609代码：e0长度：17.78 mm
内存密度：4718592 bit内存集成电路类型：STANDARD SRAM
内存宽度：9功能数量：1
端口数量：1端子数量：86
字数：524288 words字数代码：512000
工作模式：SYNCHRONOUS最高工作温度：70 °C
最低工作温度：组织：512KX9
输出特性：3-STATE可输出：YES
封装主体材料：PLASTIC/EPOXY封装代码：BGA
封装等效代码：BGA86,9X10封装形状：RECTANGULAR
封装形式：GRID ARRAY并行/串行：PARALLEL
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
认证状态：Not Qualified座面最大高度：2.44 mm
子类别：SRAMs最大压摆率：0.23 mA
最大供电电压 (Vsup)：5.25 V最小供电电压 (Vsup)：4.75 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：MOS温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：BALL
端子节距：1.524 mm端子位置：BOTTOM
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：16.26 mm
Base Number Matches：1

MCM67Q909ZP12 数据手册

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by MCM67Q909/D  
SEMICONDUCTOR TECHNICAL DATA  
MCM67Q909  
Advance Information  
512K x 9 Bit Separate I/O  
Synchronous Fast Static RAM  
The MCM67Q909 is a 4M–bit static random access memory, organized as  
512K words of 9 bits. It features separate TTL input and output buffers, which  
drive 3.3 V output levels, and incorporates input and output registers on–board  
withhighspeedSRAM. Italsofeaturestransparent–writeanddatapass–through  
capabilities.  
86 BUMP PBGA  
CASE 896A–02  
The synchronous design allows for precise cycle control with the use of an  
external single clock (K). The addresses (A0 – A18), data input (D0 – D8), data  
output (Q0 – Q8), write–enable (W), chip–enable (E), andoutput–enable(G), are  
registered on the rising edge of clock (K).  
The control pins (E, W, G) function differently in comparison to most synchro-  
nous SRAMs. This device will not deselect with E high. The RAM remains active  
at all times. If E is registered high, the output pins (Q0 – Q8) will be driven if G  
is registered low. The transparent write feature allows the output data to track the  
input data. E, G, and W must be asserted to perform a transparent write (write  
and pass–through). The input data is available at the ouputs on the next rising  
edge of clock (K).  
The pass–through function is always enabled. E high disables the write to the  
array while allowing a pass–through cycle to occur on the next rising edge of  
clock (K). Only a registered G high will three–state the outputs.  
The MCM67Q909 is available in an 86–bump surface mount PBGA (Plastic  
Ball Grid Array) package.  
PIN NAMES  
A0 – A18 . . . . . . . . . . . . . . . . . Address Input  
E . . . . . . . . . . . . . . . . . . . . . . . . . Chip Enable  
W . . . . . . . . . . . . . . . . . . . . . . . . Write Enable  
G . . . . . . . . . . . . . . . . . . . . . . Output Enable  
D0 – D8 . . . . . . . . . . . . . . . . . . . . Data Inputs  
Q0 – Q8 . . . . . . . . . . . . . . . . . . Data Outputs  
K . . . . . . . . . . . . . . . . . . . . . . . . . . Clock Input  
SCK . . . . . . . . . . . . . . . . . . Scan Clock Input  
SE . . . . . . . . . . . . . . . . . . . . . . . Scan Enable  
SDI . . . . . . . . . . . . . . . . . . . . Scan Data Input  
SDO . . . . . . . . . . . . . . . . . Scan Data Output  
V
CC  
V
SS  
. . . . . . . . . . . . . . . + 5 V Power Supply  
. . . . . . . . . . . . . . . . . . . . . . . . . . Ground  
NC . . . . . . . . . . . . . . . . . . . . . No Connection  
•
•
•
•
•
•
•
•
•
•
•
•
Single 5 V ± 5% Power Supply  
Fast Cycle Time: 12 ns Max  
Single Clock Operation  
PIN ASSIGNMENT  
4
5
6
7
8
9
1
2
3
TTL Input and Output Levels (Outputs LVTTL Compatible)  
Address, Data Input, E, W, and G Registers On–Chip  
83 MHz Maximum Clock Cycle Time  
Self–Timed Write  
Separate Data Input and Output Pins  
Transparent–Write and Pass–Through  
High Output Drive Capability: 50 pF/Output at Rated Access Time  
Boundary Scan Implementation  
A
B
E
W
G
V
SDI SDO A4  
A6 A2  
A0  
CC  
A16 A14  
D7  
K
V
V
D8  
SS  
SS  
C
D
E
F
A15 A17  
Q7  
V
V
V
V
Q8  
Q6  
V
SS  
SS  
SS  
SS  
SS  
V
V
V
V
V
V
V
D6  
SS  
SS  
SS SS  
SS  
SS  
D5  
V
V
V
V
V
V
V
V
CC  
SS  
SS  
SS  
SS  
SS  
SS  
SS  
PBGA Package for High Speed Operation  
V
Q5  
V
V
V
V
D4 Q4  
CC  
SS  
SS  
SS  
SS SS  
SS  
SS  
SS  
G
D3  
Q3  
D1  
V
V
V
V
SS  
V
V
D2  
D0  
Q2  
SS  
SS  
H
V
A18  
V
V
V
V
SS  
SS  
SS SS  
SS  
J
Q1 A12 A10  
V
A9  
A8  
SE  
A5  
A7  
A1  
A3  
Q0  
SS  
K
A13 A11 SCK  
V
CC  
TOP VIEW  
86–BUMP  
Not to Scale  
This document contains information on a new product. Specifications and information herein are subject to change without notice.  
REV 3  
12/23/97  
Motorola, Inc. 1997  
1234567...10

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与MCM67Q909ZP12相关器件

型号 品牌 获取价格 描述 数据表
MCM67Q909ZP12R NXP

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 		512K X 9 STANDARD SRAM, 5 ns, PBGA86, PLASTIC, BGA-86
MCM67Q909ZP12R MOTOROLA

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 		512K x 9 Bit Separate I/O Synchronous Fast Static RAM
MCM67Q909ZP15 MOTOROLA

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 		512KX9 STANDARD SRAM, PBGA86, PLASTIC, BGA-86
MCM67Q909ZP15R MOTOROLA

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