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MCM6246WJ35

更新时间: 2024-02-04 09:30:28
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摩托罗拉 - MOTOROLA 存储
页数 文件大小 规格书
8页 130K
描述
512K x 8 Bit Static Random Access Memory

MCM6246WJ35 技术参数

是否Rohs认证: 不符合生命周期:Obsolete
包装说明:0.400 INCH, SOJ-36Reach Compliance Code:unknown
ECCN代码:3A991.B.2.AHTS代码:8542.32.00.41
风险等级:5.86最长访问时间:35 ns
JESD-30 代码:R-PDSO-J36JESD-609代码:e0
长度:23.5 mm内存密度:4194304 bit
内存集成电路类型:STANDARD SRAM内存宽度:8
功能数量:1端口数量:1
端子数量:36字数:524288 words
字数代码:512000工作模式:ASYNCHRONOUS
最高工作温度:70 °C最低工作温度:
组织:512KX8输出特性:3-STATE
可输出:YES封装主体材料:PLASTIC/EPOXY
封装代码:SOJ封装形状:RECTANGULAR
封装形式:SMALL OUTLINE并行/串行:PARALLEL
峰值回流温度(摄氏度):NOT SPECIFIED认证状态:Not Qualified
座面最大高度:3.76 mm最大供电电压 (Vsup):5.5 V
最小供电电压 (Vsup):4.5 V标称供电电压 (Vsup):5 V
表面贴装:YES技术:CMOS
温度等级:COMMERCIAL端子面层:Tin/Lead (Sn/Pb)
端子形式:J BEND端子节距:1.27 mm
端子位置:DUAL处于峰值回流温度下的最长时间:NOT SPECIFIED
宽度:10.16 mm

MCM6246WJ35 数据手册

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by MCM6246/D  
SEMICONDUCTOR TECHNICAL DATA  
MCM6246  
512K x 8 Bit Static Random  
Access Memory  
The MCM6246 is a 4,194,304 bit static random access memory organized as  
524,288 words of 8 bits. Static design eliminates the need for external clocks or  
timing strobes, while CMOS circuitry reduces power consumption and provides  
for greater reliability.  
The MCM6246 is equipped with chip enable (E) and output enable (G) pins,  
allowing for greater system flexibility and eliminating bus contention problems.  
Either input, when high, will force the outputs into high impedance.  
TheMCM6246isavailableina400mil, 36–leadsurface–mountSOJpackage.  
WJ PACKAGE  
400 MIL SOJ  
CASE 893–01  
PIN ASSIGNMENT  
Single 5 V ± 10% Power Supply  
Fast Access Time: 17/20/25/35 ns  
Equal Address and Chip Enable Access Time  
All Inputs and Outputs are TTL Compatible  
Three–State Outputs  
A
A
1
2
36  
35  
34  
33  
32  
31  
30  
29  
28  
27  
NC  
A
A
A
3
4
A
A
Power Operation: 205/200/185/170 mA Maximum, Active AC  
A
5
A
E
DQ  
DQ  
6
G
BLOCK DIAGRAM  
7
DQ  
DQ  
V
8
A
A
V
9
CC  
SS  
V
10  
V
CC  
SS  
A
A
DQ  
11  
12  
26  
25  
DQ  
DQ  
DQ  
MEMORY MATRIX  
1024 ROWS x  
4096 COLUMNS  
A
A
A
A
ROW  
DECODER  
W
A
13  
14  
15  
24  
23  
22  
A
A
A
A
A
16  
21  
A
A
A
A
A
17  
18  
20  
19  
A
NC  
COLUMN I/O  
COLUMN DECODER  
DQ  
DQ  
E
PIN NAMES  
INPUT  
DATA  
CONTROL  
A . . . . . . . . . . . . . . . . . . . Address Inputs  
W . . . . . . . . . . . . . . . . . . . . Write Enable  
G . . . . . . . . . . . . . . . . . . . Output Enable  
E . . . . . . . . . . . . . . . . . . . . . . Chip Enable  
DQ . . . . . . . . . . . . . . . Data Input/Output  
NC . . . . . . . . . . . . . . . . . No Connection  
A
A
A
A
A
A
A
A
A
DQ  
DQ  
V
CC  
V
SS  
. . . . . . . . . . . . + 5 V Power Supply  
. . . . . . . . . . . . . . . . . . . . . . . Ground  
W
G
REV 5  
6/9/97  
Motorola, Inc. 1997  

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