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Datasheet > 逻辑 > 触发器/锁存器> MC10H175FNR2
MC10H175FNR2 PDF预览

MC10H175FNR2

更新时间： 2024-09-23 05:10:23
品牌 Logo 应用领域
安森美 - ONSEMI 触发器锁存器逻辑集成电路
页数 文件大小 规格书
7页 160K
描述
Quint Latch

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MC10H175FNR2 技术参数

是否Rohs认证：不符合生命周期：Obsolete
零件包装代码：QFN包装说明：PLASTIC, LLC-20
针数：20Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01Factory Lead Time：1 week
风险等级：7.5Is Samacsys：N
系列：10HJESD-30 代码：S-PQCC-J20
JESD-609代码：e0长度：8.965 mm
逻辑集成电路类型：D LATCH位数：5
功能数量：1端子数量：20
最高工作温度：75 °C最低工作温度：
输出特性：OPEN-EMITTER输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装等效代码：LDCC20,.4SQ封装形状：SQUARE
封装形式：CHIP CARRIER包装方法：TAPE AND REEL
峰值回流温度（摄氏度）：240最大电源电流（ICC）：107 mA
Prop。Delay @ Nom-Sup：2.4 ns传播延迟（tpd）：2 ns
认证状态：Not Qualified座面最大高度：4.57 mm
子类别：FF/Latches表面贴装：YES
技术：ECL温度等级：COMMERCIAL EXTENDED
端子面层：Tin/Lead (Sn80Pb20)端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30触发器类型：LOW LEVEL
宽度：8.965 mmBase Number Matches：1

MC10H175FNR2 数据手册

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MC10H175  
Quint Latch  
Description  
The MC10H175 is a quint D type latch with common reset and  
clock lines. This MECL 10KH part is a functional/pinout duplication  
of the standard MECL 10K™ family part, with 100% improvement in  
propagation delay and no increase in power−supply current.  
http://onsemi.com  
MARKING DIAGRAMS*  
Features  
• Propagation Delay, 1.2 ns Typical  
• Power Dissipation, 400 mW Typical  
16  
• Improved Noise Margin 150 mV (Over Operating Voltage and  
MC10H175L  
AWLYYWW  
Temperature Range)  
• Voltage Compensated  
1
• MECL 10K Compatible  
CDIP−16  
L SUFFIX  
CASE 620A  
• Pb−Free Packages are Available*  
TRUTH TABLE  
16  
1
D
C0  
C1  
Reset  
Q
n+1  
MC10H175P  
AWLYYWWG  
L
H
Qn  
Qn  
L
16  
L
L
H
X
H
X
L
L
X
H
X
H
X
X
L
L
H
H
L
H
X
X
X
X
1
PDIP−16  
P SUFFIX  
CASE 648  
L
10H175  
ALYWG  
DIP  
PIN ASSIGNMENT  
SOEIAJ−16  
CASE 966  
1 20  
V
V
CC2  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
CC1  
Q1  
Q0  
D2  
D1  
Q2  
10H175G  
AWLYYWW  
20  
Q3  
Q4  
D4  
C0  
C1  
1
PLLC−20  
FN SUFFIX  
CASE 775  
RESET  
D0  
A
= Assembly Location  
= Year  
WL, L = Wafer Lot  
YY, Y  
WW, W = Work Week  
D3  
V
EE  
G
= Pb−Free Package  
Pin assignment is for Dual−in−Line Package.  
For PLCC pin assignment, see the Pin Conversion Tables on page 18  
of the ON Semiconductor MECL Data Book (DL122/D).  
*For additional marking information, refer to  
Application Note AND8002/D.  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 4 of this data sheet.  
*For additional information on our Pb−Free strategy and soldering details, please  
download the ON Semiconductor Soldering and Mounting Techniques  
Reference Manual, SOLDERRM/D.  
©
Semiconductor Components Industries, LLC, 2006  
1
Publication Order Number:  
February, 2006 − Rev. 7  
MC10H175/D  
1234567

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MC10H175FNR2 替代型号

型号 品牌 替代类型 描述 数据表
MC10H186FNG ONSEMI

完全替代

 Hex D Master−Slave Flip−Flop with Reset
MC10H131FNR2G ONSEMI

类似代替

 Dual D Type Master−Slave Flip−Flop
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