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MC10H160FNR2 PDF预览

MC10H160FNR2

更新时间： 2024-11-09 21:16:51
品牌 Logo 应用领域
安森美 - ONSEMI 输出元件逻辑集成电路
页数 文件大小 规格书
6页 144K
描述
10H SERIES, 12-BIT PARITY GENERATOR/CHECKER, TRUE OUTPUT, PQCC20, PLASTIC, LCC-20

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MC10H160FNR2 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QLCC包装说明：QCCJ,
针数：20Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.69
系列：10HJESD-30 代码：S-PQCC-J20
JESD-609代码：e0长度：8.965 mm
逻辑集成电路类型：PARITY GENERATOR/CHECKER位数：12
功能数量：1端子数量：20
最高工作温度：75 °C最低工作温度：
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：QCCJ封装形状：SQUARE
封装形式：CHIP CARRIER峰值回流温度（摄氏度）：NOT SPECIFIED
传播延迟（tpd）：3.3 ns认证状态：Not Qualified
座面最大高度：4.57 mm表面贴装：YES
技术：ECL温度等级：COMMERCIAL EXTENDED
端子面层：TIN LEAD端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：8.965 mm
Base Number Matches：1

MC10H160FNR2 数据手册

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MC10H160  
12−Bit Parity  
Generator−Checker  
Description  
The MC10H160 is a 12−bit parity generator−checker. The output  
goes high when an odd number of inputs are high providing the odd  
parity function. Unconnected inputs are pulled to a logic low allowing  
parity detection and generation for less than 12−bits. The MC10H160  
is a functional pin duplication of the standard 10K family part with  
100% improvement in propagation delay and no increase in  
power−supply current.  
http://onsemi.com  
MARKING DIAGRAMS*  
16  
MC10H160L  
AWLYYWW  
Features  
• Propagation Delay, 2.5 ns Typical  
1
• Power Dissipation, 320 mW Typical  
• Improved Noise Margin 150 mV  
(Over Operating Voltage and Temperature Range)  
• Voltage Compensated  
CDIP−16  
L SUFFIX  
CASE 620A  
• MECL 10K™ Compatible  
16  
1
• Pb−Free Packages are Available*  
MC10H160P  
AWLYYWWG  
16  
1
LOGIC DIAGRAM  
3
PDIP−16  
P SUFFIX  
CASE 648  
4
5
V
V
V
= PIN 1  
= PIN 16  
CC1  
CC2  
TRUTH TABLE  
INPUT  
= PIN 8  
6
7
EE  
OUTPUT  
10H160  
ALYWG  
Sum of  
High Level  
Inputs  
Pin 2  
9
10  
2
Even  
Odd  
Low  
11  
12  
High  
SOEIAJ−16  
CASE 966  
13  
14  
1 20  
DIP  
PIN ASSIGNMENT  
15  
10H160G  
AWLYYWW  
20  
1
V
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
V
CC2  
CC1  
OUT  
IN1  
IN2  
IN3  
IN4  
IN5  
IN12  
IN11  
IN10  
IN9  
PLLC−20  
FN SUFFIX  
CASE 775  
A
= Assembly Location  
= Year  
WL, L = Wafer Lot  
YY, Y  
WW, W = Work Week  
G
IN8  
IN7  
= Pb−Free Package  
IN6  
V
EE  
Pin assignment is for Dual−in−Line Package.  
For PLCC pin assignment, see the Pin Conversion Tables on page 18  
of the ON Semiconductor MECL Data Book (DL122/D).  
*For additional marking information, refer to  
Application Note AND8002/D.  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 3 of this data sheet.  
*For additional information on our Pb−Free strategy and soldering details, please  
download the ON Semiconductor Soldering and Mounting Techniques  
Reference Manual, SOLDERRM/D.  
©
Semiconductor Components Industries, LLC, 2006  
1
Publication Order Number:  
February, 2006 − Rev. 8  
MC10H160/D  
123456

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