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IDT74ALVCH16260PV

更新时间： 2024-09-09 22:57:23
品牌 Logo 应用领域
艾迪悌 - IDT 锁存器输出元件
页数 文件大小 规格书
7页 72K
描述
3.3V CMOS 12-BIT TO 24-BIT MULTIPLEXED D-TYPE LATCH WITH 3-STATE OUTPUTS AND BUS-HOLD

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IDT74ALVCH16260PV 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：SSOP包装说明：SSOP, SSOP56,.4
针数：56Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.73
系列：ALVC/VCX/AJESD-30 代码：R-PDSO-G56
JESD-609代码：e0长度：18.415 mm
负载电容（CL）：50 pF逻辑集成电路类型：MULTIPLEXER AND DEMUX/DECODER
湿度敏感等级：1功能数量：12
输入次数：1输出次数：2
端子数量：56最高工作温度：85 °C
最低工作温度：-40 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：SSOP封装等效代码：SSOP56,.4
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, SHRINK PITCH
电源：3.3 V传播延迟（tpd）：5.2 ns
认证状态：Not Qualified座面最大高度：2.794 mm
子类别：Other Logic ICs最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：2.7 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Tin/Lead (Sn85Pb15)
端子形式：GULL WING端子节距：0.635 mm
端子位置：DUAL宽度：7.5 mm
Base Number Matches：1

IDT74ALVCH16260PV 数据手册

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3.3V CMOS 12-BIT TO 24-BIT  
IDT74ALVCH16260  
MULTIPLEXED D-TYPE LATCH  
WITH 3-STATE OUTPUTS  
AND BUS-HOLD  
FEATURES:  
DESCRIPTION:  
• 0.5 MICRON CMOS Technology  
This12-bitto24-bitmultiplexedD-typelatchisbuiltusingadvanceddual  
metalCMOStechnology.TheALVCH16260isusedinapplicationsinwhich  
twoseparatedatapathsmustbemultiplexedonto,ordemultiplexedfrom,a  
singledatapath.Typicalapplicationsincludemultiplexingand/ordemultiplexing  
addressanddatainformationinmicroprocessororbus-interfaceapplications.  
Thisdevicealsoisusefulinmemoryinterleavingapplications.  
• Typical tSK(o) (Output Skew) < 250ps  
• ESD > 2000V per MIL-STD-883, Method 3015; > 200V using  
machine model (C = 200pF, R = 0)  
• VCC = 3.3V ± 0.3V, Normal Range  
• VCC = 2.7V to 3.6V, Extended Range  
• VCC = 2.5V ± 0.2V  
• CMOS power levels (0.4µ W typ. static)  
• Rail-to-Rail output swing for increased noise margin  
• Available in SSOP and TSSOP packages  
Three12-bitI/Oports(A1-A12,1B1-1B12,and2B1-2B12)areavailable  
foraddressand/ordatatransfer.Theoutput-enable(OE1B,OE2B,andOEA)  
inputs control the bus transceiver functions. The OE1B and OE2B control  
signalsalsoallowbankcontrolintheA-to-Bdirection. Addressand/ordata  
informationcanbestoredusingtheinternalstoragelatches.Thelatch-enable  
(LE1B,LE2B,LEA1B,andLEA2B)inputsareusedtocontroldatastorage.  
Whenthelatch-enableinputishigh,thelatchistransparent.Whenthelatch-  
enableinputgoeslow,thedatapresentattheinputsislatchedandremains  
latcheduntilthelatch-enableinputisreturnedhigh.  
DRIVE FEATURES:  
• High Output Drivers: ±24mA  
• Suitable for heavy loads  
The ALVCH16260 has been designed with a ±24mA output driver. This  
driveriscapableofdrivingamoderatetoheavyloadwhilemaintainingspeed  
performance.  
APPLICATIONS:  
• 3.3V high speed systems  
• 3.3V and lower voltage computing systems  
The ALVCH16260 has “bus-hold” which retains the inputs’ last state  
whenevertheinputgoestoahighimpedance.Thispreventsfloatinginputs  
andeliminatestheneedforpull-up/downresistors.  
FUNCTIONALBLOCKDIAGRAM  
29  
OE1B  
30  
A-1B  
LEA1B  
1B1:12  
12  
LATCH  
2
LE1B  
1B-A  
12  
LATCH  
12  
12  
28  
SEL  
1
OEA  
1
M
A1:12  
U
X
12  
0
12  
12  
2B-A  
LATCH  
27  
12  
LE2B  
A-2B  
LATCH  
2B1:12  
55  
56  
12  
LEA2B  
OE2B  
TheIDTlogoisaregisteredtrademarkofIntegratedDeviceTechnology,Inc.  
INDUSTRIAL TEMPERATURE RANGE  
JANUARY 2004  
1
© 2004 Integrated Device Technology, Inc.  
DSC-4737/2  
1234567

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