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IDT74ALVCH162721PV

更新时间： 2024-09-13 22:57:23

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艾迪悌 - IDT		总线驱动器总线收发器触发器逻辑集成电路光电二极管输出元件
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3.3V CMOS 20-BIT FLIP-FLOP WITH 3-STATE OUTPUTS AND BUS-HOLD

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IDT74ALVCH162721PV 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	SSOP	包装说明：	SSOP, SSOP56,.4
针数：	56	Reach Compliance Code：	not_compliant
风险等级：	5.45	Is Samacsys：	N
其他特性：	WITH CLOCK ENABLE	系列：	ALVC/VCX/A
JESD-30 代码：	R-PDSO-G56	JESD-609代码：	e0
长度：	18.415 mm	负载电容（CL）：	50 pF
逻辑集成电路类型：	BUS DRIVER	最大频率@ Nom-Sup：	150000000 Hz
最大I（ol）：	0.012 A	湿度敏感等级：	1
位数：	20	功能数量：	1
端口数量：	2	端子数量：	56
最高工作温度：	85 °C	最低工作温度：	-40 °C
输出特性：	3-STATE WITH SERIES RESISTOR	输出极性：	TRUE
封装主体材料：	PLASTIC/EPOXY	封装代码：	SSOP
封装等效代码：	SSOP56,.4	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, SHRINK PITCH	电源：	3.3 V
Prop。Delay @ Nom-Sup：	4.3 ns	传播延迟（tpd）：	6.2 ns
认证状态：	Not Qualified	座面最大高度：	2.794 mm
子类别：	FF/Latches	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	2.7 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Tin/Lead (Sn85Pb15)
端子形式：	GULL WING	端子节距：	0.635 mm
端子位置：	DUAL	触发器类型：	POSITIVE EDGE
宽度：	7.5 mm	Base Number Matches：	1

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IDT74ALVCH162721

3.3V CMOS 20-BIT FLIP-FLOP WITH 3-STATE OUTPUTS

EXTENDED COMMERCIAL TEMPERATURE RANGE

3.3V CMOS 20-BIT

IDT74ALVCH162721

FLIP-FLOP WITH 3-STATE

OUTPUTS AND BUS-HOLD

DESCRIPTION:

FEATURES:

This 20-bit flip-flop is built using advanced dual metal CMOS technol-

–

0.5 MICRON CMOS Technology

Typicalt^SK(0)(Output Skew) < 250ps

ESD > 2000V per MIL-STD-883, Method 3015;

> 200V using machine model (C = 200pF, R = 0)

0.635mm pitch SSOP, 0.50mm pitch TSSOP,

and 0.40mm pitch TVSOP packages

ogy. The 20 flip-flops of the ALVCH162721 are edge-triggered D-type

flip-flops with qualified clock storage. On the positive transition of the

clock (CLK) input, the device provides true data at the Q outputs if the

clock-enable (CLKEN) input is low. If CLKEN is high, no data is stored.

–

A buffered output-enable (OE) input places the 20 outputs in either a

normal logic state (high or low) or a high-impedance state. In the high-

impedance state, the outputs neither load nor drive the bus lines

significantly. The high-impedance state and increased drive provide the

capability to drive bus lines without need for interface or pullup compo-

nents. OE does not affect the internal operation of the flip-flops. Old data

can be retained or new data can be entered while the outputs are in the

high-impedance state.

–

Extended commercial range of – 40°C to + 85°C

V^CC= 3.3V ± 0.3V, Normal Range

V^CC= 2.7V to 3.6V, Extended Range

V^CC= 2.5V ± 0.2V

CMOS power levels (0.4µW typ. static)

Rail-to-Rail output swing for increased noise margin

Drive Features for ALVCH162721:

–

Balanced Output Drivers: ±12mA

Low switching noise

The ALVCH162721 has series resistors in the device output structure

which will significantly reduce line noise when used with light loads. This

driver has been designed to drive ±12mA at the designated threshold

levels.

APPLICATIONS:

• 3.3V High Speed Systems

• 3.3V and lower voltage computing systems

The ALVCH162721 has “bus-hold” which retains the inputs’ last state

whenever the input goes to a high impedance. This prevents floating

inputs and eliminates the need for pull-up/down resistor.

Functional Block Diagram

CLK

CLKEN

Q¹

D¹

To 19 Other Channels

EXTENDED COMMERCIAL TEMPERATURE RANGE

MARCH1999

1999 Integrated Device Technology, Inc.

DSC-4566/-

12 3 4 5 6

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