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IDT72V3654L15PF PDF预览

IDT72V3654L15PF

更新时间： 2024-11-26 09:37:51
品牌 Logo 应用领域
艾迪悌 - IDT 时钟先进先出芯片内存集成电路
页数 文件大小 规格书
37页 409K
描述
Bi-Directional FIFO, 2KX36, 10ns, Synchronous, CMOS, PQFP128, TQFP-128

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IDT72V3654L15PF 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFP包装说明：TQFP-128
针数：128Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.32.00.71
风险等级：5.92最长访问时间：10 ns
其他特性：MAIL BOX BYPASS REGISTER最大时钟频率 (fCLK)：66.7 MHz
周期时间：15 nsJESD-30 代码：R-PQFP-G128
JESD-609代码：e0长度：20 mm
内存密度：73728 bit内存集成电路类型：BI-DIRECTIONAL FIFO
内存宽度：36湿度敏感等级：3
功能数量：1端子数量：128
字数：2048 words字数代码：2000
工作模式：SYNCHRONOUS最高工作温度：70 °C
最低工作温度：组织：2KX36
可输出：YES封装主体材料：PLASTIC/EPOXY
封装代码：LFQFP封装等效代码：QFP128,.63X.87,20
封装形状：RECTANGULAR封装形式：FLATPACK, LOW PROFILE, FINE PITCH
并行/串行：PARALLEL峰值回流温度（摄氏度）：240
电源：3.3 V认证状态：Not Qualified
座面最大高度：1.6 mm最大待机电流：0.005 A
子类别：FIFOs最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：3 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：Tin/Lead (Sn85Pb15)
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：20
宽度：14 mm

IDT72V3654L15PF 数据手册

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3.3 VOLT CMOS SyncBiFIFOTM WITH BUS-MATCHING  
2,048 x 36 x 2  
4,096 x 36 x 2  
8,192 x 36 x 2  
IDT72V3654  
IDT72V3664  
IDT72V3674  
• Big- or Little-Endian format for word and byte bus sizes  
• Retransmit Capability  
• Master Reset clears data and configures FIFO, Partial Reset  
clears data but retains configuration settings  
• Mailbox bypass registers for each FIFO  
• Free-running CLKA and CLKB may be asynchronous or coincident  
(simultaneous reading and writing of data on a single clock edge  
is permitted)  
• Auto power down minimizes power dissipation  
• Available in space saving 128-pin Thin Quad Flatpack (TQFP)  
• Pin and functionally compatible version of the 5V operating  
IDT723654/723664/723674  
FEATURES  
• Memory storage capacity:  
IDT72V3654  
IDT72V3664  
IDT72V3674  
–
–
–
2,048 x 36 x 2  
4,096 x 36 x 2  
8,192 x 36 x 2  
• Clock frequencies up to 100 MHz (6.5ns access time)  
• Two independent clocked FIFOs buffering data in opposite  
directions  
• Select IDT Standard timing (using EFA, EFB, FFA, and FFB flags  
functions) or First Word Fall Through Timing (using ORA, ORB,  
IRA, and IRB flag functions)  
• Programmable Almost-Empty and Almost-Full flags; each has five  
default offsets (8, 16, 64, 256 and 1,024 )  
• Serial or parallel programming of partial flags  
• Port B bus sizing of 36 bits (long word), 18 bits (word) and 9 bits  
(byte)  
• Pin compatible to the lower density parts, IDT72V3624/72V3634/  
72V3644  
• Industrial temperature range (–40°C to +85°C) is available  
FUNCTIONAL BLOCK DIAGRAM  
MBF1  
Mail 1  
Register  
CLKA  
Port-A  
Control  
Logic  
CSA  
W/RA  
ENA  
RAM ARRAY  
2,048 x 36  
4,096 x 36  
8,192 x 36  
36  
36  
MBA  
36  
FIFO1,  
Mail1  
Reset  
Logic  
MRS1  
PRS1  
Write  
Pointer  
Read  
Pointer  
36  
Status Flag  
Logic  
EFB/ORB  
AEB  
FFA/IRA  
AFA  
FIFO1  
FIFO2  
FS2  
FS0/SD  
Programmable Flag  
Offset Registers  
Timing  
Mode  
FWFT  
FS1/SEN  
B0-B35  
A0-A35  
13  
Status Flag  
Logic  
EFA/ORA  
FFB/IRB  
AFB  
AEA  
36  
Read  
Pointer  
Write  
Pointer  
36  
FIFO2,  
Mail2  
Reset  
Logic  
MRS2  
PRS2  
RT1  
RTM  
RT2  
FIFO1 and  
FIFO2  
Retransmit  
Logic  
RAM ARRAY  
2,048 x 36  
4,096 x 36  
8,192 x 36  
36  
36  
CLKB  
CSB  
W/RB  
ENB  
MBB  
BE  
Port-B  
Control  
Logic  
Mail 2  
Register  
BM  
SIZE  
MBF2  
4664 drw01  
IDTandtheIDTlogoaretrademarksofIntegratedDeviceTechnology,Inc. TheSyncFIFOisatrademarkofIntegratedDeviceTechnology,Inc.  
NOVEMBER 2003  
COMMERCIAL TEMPERATURE RANGE  
1
2003 Integrated Device Technology, Inc. All rights reserved. Product specifications subject to change without notice.  
DSC-4664/5  
1234567...37

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型号 品牌 获取价格 描述 数据表
IDT72V3654L15PF9 IDT

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 		FIFO, 2KX36, 10ns, Synchronous, CMOS, PQFP128, TQFP-128
IDT72V3654L20PF IDT

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 		FIFO, 2KX36, 12ns, Synchronous, CMOS, PQFP128, TQFP-128
IDT72V3656 IDT

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 		3.3 VOLT CMOS TRIPLE BUS SyncFIFOTM WITH BUS-MATCHING
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