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Datasheet > 逻辑 > 时钟驱动器> IDT59910A-2SO
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IDT59910A-2SO

更新时间： 2024-11-08 22:17:43
品牌 Logo 应用领域
艾迪悌 - IDT 时钟驱动器逻辑集成电路光电二极管
页数 文件大小 规格书
6页 54K
描述
LOW SKEW PLL CLOCK DRIVER TURBOCLOCK JR.

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IDT59910A-2SO 技术参数

是否Rohs认证：不符合生命周期：Obsolete
零件包装代码：SOIC包装说明：0.300 INCH, SOIC-24
针数：24Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.92
Is Samacsys：N输入调节：STANDARD
JESD-30 代码：R-PDSO-G24JESD-609代码：e0
长度：15.4 mm逻辑集成电路类型：PLL BASED CLOCK DRIVER
最大I（ol）：0.046 A湿度敏感等级：1
功能数量：1反相输出次数：
端子数量：24实输出次数：8
最高工作温度：70 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP24,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：225
电源：5 V认证状态：Not Qualified
Same Edge Skew-Max（tskwd）：0.25 ns座面最大高度：2.65 mm
子类别：Clock Drivers最大供电电压 (Vsup)：5.25 V
最小供电电压 (Vsup)：4.75 V标称供电电压 (Vsup)：5 V
表面贴装：YES温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30宽度：7.5 mm
最小 fmax：100 MHzBase Number Matches：1

IDT59910A-2SO 数据手册

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LOW SKEW  
IDT59910A  
PLL CLOCK DRIVER  
TURBOCLOCK™ JR.  
FEATURES:  
DESCRIPTION:  
• Eight zero delay outputs  
The IDT59910A is a high fanout phase lock loop clock driver in-  
tended for high performance computing and data-communications appli-  
cations. The IDT59910A has eight zero delay TTL outputs.  
• Selectable positive or negative edge synchronization  
• Synchronous output enable  
• Output frequency: 15MHz to 100MHz  
• TTL outputs  
• 3 skew grades:  
IDT59910A-2: tSKEW0<250ps  
The IDT59910A maintains Cypress CY7B9910 compatibility while pro-  
viding two additional features: Synchronous Output Enable (GND/sOE),  
and Positive/Negative Edge Synchronization (VCCQ/PE). When the GND/  
sOE pin is held low, all the outputs are synchronously enabled (CY7B9910  
compatibility). However, if GND/sOE is held high, all the outputs except  
Q2 and Q3 are synchronously disabled.  
Furthermore, when the VCCQ/PE is held high, all the outputs are syn-  
chronized with the positive edge of the REF clock input (CY7B9910  
compatibility). When VCCQ/PE is held low, all the outputs are synchro-  
nized with the negative edge of REF.  
The FB signal is compared with the input REF signal at the phase  
detector in order to drive the VCO. Phase differences cause the VCO of  
the PLL to adjust upwards or downwards accordingly.  
An internal loop filter moderates the response of the VCO to the  
phase detector. The loop filter transfer function has been chosen to  
provide minimal jitter (or frequency variation) while still providing accu-  
rate responses to input frequency changes.  
IDT59910A-5: tSKEW0<500ps  
IDT59910A-7: tSKEW0<750ps  
• 3-level inputs for PLL range control  
• PLL bypass for DC testing  
• External feedback, internal loop filter  
• 46mA IOL high drive outputs  
• Low Jitter: <200ps peak-to-peak  
• Outputs drive 50Ω terminated lines  
• Pin-compatible with Cypress CY7B9910  
• Available in SOIC package  
FUNCTIONALBLOCKDIAGRAM  
VCCQ/PE  
GND/sOE  
Q0  
Q1  
Q2  
Q3  
Q4  
Q5  
Q6  
Q7  
FB  
PLL  
REF  
FS  
TheIDTlogoisaregisteredtrademarkofIntegratedDeviceTechnology,Inc.  
COMMERCIAL AND INDUSTRIAL TEMPERATURE RANGES  
SEPTEMBER 2001  
1
c
2001 Integrated Device Technology, Inc.  
DSC 5845/1  
123456

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与IDT59910A-2SO相关器件

型号 品牌 获取价格 描述 数据表
IDT59910A-2SO8 IDT

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 		PLL Based Clock Driver, 8 True Output(s), 0 Inverted Output(s), PDSO24, 0.300 INCH, SOIC-2
IDT59910A-2SOC IDT

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 		暂无描述
IDT59910A-2SOI IDT

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 		LOW SKEW PLL CLOCK DRIVER TURBOCLOCK JR.
IDT59910A-5SO IDT

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 		LOW SKEW PLL CLOCK DRIVER TURBOCLOCK JR.
IDT59910A-5SOC IDT

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 		暂无描述
IDT59910A-5SOI IDT

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 		LOW SKEW PLL CLOCK DRIVER TURBOCLOCK JR.
IDT59910A-7SO IDT

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 		LOW SKEW PLL CLOCK DRIVER TURBOCLOCK JR.
IDT59910A-7SOI IDT

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 		LOW SKEW PLL CLOCK DRIVER TURBOCLOCK JR.
IDT5991A IDT

获取价格

 		PROGRAMMABLE SKEW PLL CLOCK DRIVER TURBOCLOCK
IDT5991A-2J IDT

获取价格

 		PLL Based Clock Driver, 5991 Series, 8 True Output(s), 0 Inverted Output(s), PQCC32, PLAST

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