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ICS873S02BMILFT

更新时间： 2024-09-29 20:57:51

品牌	Logo	应用领域
艾迪悌 - IDT		驱动光电二极管逻辑集成电路
页数	文件大小	规格书
15页	673K
描述
Low Skew Clock Driver, 873 Series, 1 True Output(s), 0 Inverted Output(s), PDSO20, 7.50 X 12.80 MM, 2.30 MM HEIGHT, ROHS COMPLIANT, MS-013, MO-19, SOIC-20

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ICS873S02BMILFT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	SOIC
包装说明：	SOP,	针数：	20
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.27	系列：	873
输入调节：	DIFFERENTIAL	JESD-30 代码：	R-PDSO-G20
JESD-609代码：	e3	长度：	12.8 mm
逻辑集成电路类型：	LOW SKEW CLOCK DRIVER	功能数量：	1
反相输出次数：		端子数量：	20
实输出次数：	1	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	260
认证状态：	Not Qualified	座面最大高度：	2.65 mm
最大供电电压 (Vsup)：	3.465 V	最小供电电压 (Vsup)：	3.135 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
温度等级：	INDUSTRIAL	端子面层：	MATTE TIN
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	7.5 mm	Base Number Matches：	1

ICS873S02BMILFT 数据手册

PRELIMINARY

1:1 DIFFERENTIAL-TO-3.3V LVPECL

ZERO DELAY CLOCK GENERATOR

ICS873S02I

GENERAL DESCRIPTION

FEATURES

The ICS873S02I is a highly versatile 1:1 LVPECL

• One differential LVPECL output pair designed to meet or

exceed the requirements of ANSI TIA/EIA-644,

One differential feedback output pair

ICS

Clock Generator and

member of the

HiPerClockS™

HiPerClockS™ family of High Performance Clock

Solutions from IDT. The ICS873S02I has a fully in-

tegrated PLL and can be configured as zero delay

• Differential CLK, nCLK input pair

buffer, multiplier or divider, and has an output frequency range

of 62.5MHz to 1GHz. The Reference Divider, Feedback Divider

and Output Divider are each programmable, thereby allowing

for the following output-to-input frequency ratios: 8:1, 4:1, 2:1,

1:1, 1:2, 1:4, 1:8. The external feedback allows the device to

achieve “zero delay” between the input clock and

the output clock. The PLL_SEL pin can be used to bypass the

PLL for system test and debug purposes. In bypass mode, the

reference clock is routed around the PLL and into the internal

output dividers.

• CLK, nCLK pair can accept the following differential

input levels: LVPECL, LVDS, LVHSTL, SSTL

• Output frequency range: 62.5MHz to 1GHz

• Input frequency range: 62.5MHz to 1GHz

• VCO range: 500MHz to 1GHz

• External feedback for “zero delay” clock regeneration with

configurable frequencies

• Programmable dividers allow for the following output-to-input

frequency ratios: 8:1, 4:1, 2:1, 1:1, 1:2, 1:4, 1:8

• Cycle-to-cycle jitter: 23ps (typical)

• Output skew: 7ps (typical)

• Static phase offset: 15ps (typical)

• 3.3V supply voltage

• -40°C to 85°C ambient operating temperature

• Available in both standard (RoHS5) and lead-free (RoHS 6)

packages

BLOCK DIAGRAM

PIN ASSIGNMENT

PLL_SEL

CLK

nCLK

nFB_IN

FB_IN

SEL2

V^CCO

nQFB

QFB

V^EE

SEL1

SEL0

V^CC

PLL_SEL

V^CCA

SEL3

V^EE

V^CCO

÷1, ÷2, ÷4, ÷8,

÷16, ÷32, ÷64

QFB

CLK

nCLK

nQFB

PLL

8:1, 4:1, 2:1, 1:1,

1:2, 1:4, 1:8

FB_IN

nFB_IN

ICS873S02I

20-Lead, 300-MIL SOIC

7.5mm x 12.8mm x 2.3mm body package

M Package

Top View

SEL0

SEL1

SEL2

SEL3

The Preliminary Information presented herein represents a product in pre-production.The noted characteristics are based on initial product characterization

and/or qualification.Integrated DeviceTechnology, Incorporated (IDT) reserves the right to change any circuitry or specifications without notice.

IDT^™/ ICS^™3.3V LVPECL ZERO DELAY CLOCK GENERATOR

ICS873S02BMI REVA JANUARY 21, 2008

12 3 4 5 6 7...15

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与ICS873S02BMILFT相关器件

型号	品牌	获取价格	描述	数据表
ICS874001AGI-02LFT	IDT	获取价格	PLL Based Clock Driver, 874001 Series, 1 True Output(s), 0 Inverted Output(s), PDSO20, 6.5
ICS874001AGI-02T	IDT	获取价格	PLL Based Clock Driver, 874001 Series, 1 True Output(s), 0 Inverted Output(s), PDSO20, 6.5
ICS874001AGI-05LF	IDT	获取价格	PCI Expressâ¢ Jitter Attenuator
ICS874001I-05	IDT	获取价格	PCI EXPRESS? JITTER ATTENUATOR
ICS874002	ICSI	获取价格	PCI EXPRESS JITTER ATTENUATOR
ICS874002AG	ICSI	获取价格	PCI EXPRESS JITTER ATTENUATOR
ICS874002AG-02	IDT	获取价格	PLL Based Clock Driver, 874002 Series, 2 True Output(s), 0 Inverted Output(s), PDSO20, 4.4
ICS874002AG-02LF	IDT	获取价格	PLL Based Clock Driver, 874002 Series, 2 True Output(s), 0 Inverted Output(s), PDSO20, 4.4
ICS874002AG-02T	IDT	获取价格	PLL Based Clock Driver, 874002 Series, 2 True Output(s), 0 Inverted Output(s), PDSO20, 4.4
ICS874002AGLF	IDT	获取价格	PLL Based Clock Driver, 874002 Series, 2 True Output(s), 0 Inverted Output(s), PDSO20, 6.5

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