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EPF6016ATC100-1

更新时间： 2024-01-18 12:57:19

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阿尔特拉 - ALTERA		时钟 LTE 栅输入元件可编程逻辑
页数	文件大小	规格书
52页	374K
描述
Loadable PLD, CMOS, PQFP100, TQFP-100

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EPF6016ATC100-1 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Transferred	零件包装代码：	QFP
包装说明：	LFQFP,	针数：	100
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.14	Is Samacsys：	N
其他特性：	CAN ALSO BE USED 16000 LOGIC GATES	最大时钟频率：	172 MHz
JESD-30 代码：	S-PQFP-G100	JESD-609代码：	e3
长度：	14 mm	湿度敏感等级：	3
专用输入次数：	4	I/O 线路数量：	81
端子数量：	100	最高工作温度：	85 °C
最低工作温度：		组织：	4 DEDICATED INPUTS, 81 I/O
输出函数：	MACROCELL	封装主体材料：	PLASTIC/EPOXY
封装代码：	LFQFP	封装形状：	SQUARE
封装形式：	FLATPACK, LOW PROFILE, FINE PITCH	峰值回流温度（摄氏度）：	260
可编程逻辑类型：	LOADABLE PLD	认证状态：	Not Qualified
座面最大高度：	1.27 mm	最大供电电压：	3.6 V
最小供电电压：	3 V	标称供电电压：	3.3 V
表面贴装：	YES	温度等级：	OTHER
端子面层：	MATTE TIN (472) OVER COPPER	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	40	宽度：	14 mm
Base Number Matches：	1

EPF6016ATC100-1 数据手册

FLEX 6000 Programmable Logic Device Family Data Sheet

Table 4 shows FLEX 6000 performance for more complex designs.

Table 4. FLEX 6000 Device Performance for Complex Designs

Note (1)

Application

LEs Used

Performance

Units

-1 Speed -2 Speed -3 Speed

Grade

8-bit, 16-tap parallel finite impulse response

(FIR) filter

599

1,182

487

MSPS

8-bit, 512-point fast Fourier transform (FFT)

function

109

µS

MHz

a16450 universal asynchronous

receiver/transmitter (UART)

MHz

PCI bus target with zero wait states

609

Note:

(1) The applications in this table were created using Altera MegaCore^TMfunctions.

FLEX 6000 devices are supported by Altera development systems; a

single, integrated package that offers schematic, text (including AHDL),

and waveform design entry, compilation and logic synthesis, full

simulation and worst-case timing analysis, and device configuration. The

Altera software provides EDIF 2 0 0 and 3 0 0, LPM, VHDL, Verilog HDL,

and other interfaces for additional design entry and simulation support

from other industry-standard PC- and UNIX workstation-based EDA

tools.

The Altera software works easily with common gate array EDA tools for

synthesis and simulation. For example, the Altera software can generate

Verilog HDL files for simulation with tools such as Cadence Verilog-XL.

Additionally, the Altera software contains EDA libraries that use device-

specific features such as carry chains which are used for fast counter and

arithmetic functions. For instance, the Synopsys Design Compiler library

supplied with the Altera development systems include DesignWare

functions that are optimized for the FLEX 6000 architecture.

The Altera development system runs on Windows-based PCs, Sun

SPARCstations, and HP 9000 Series 700/800.

See the MAX+PLUS II Programmable Logic Development System & Software

Data Sheet and the Quartus Programmable Logic Development System &

Software Data Sheet for more information.

Altera Corporation

1 2 345 6 7...52

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型号	品牌	描述	获取价格	数据表
EPF6016ATC100-2	ALTERA	Programmable Logic Device Family	获取价格
EPF6016ATC100-2N	ALTERA	Loadable PLD, PQFP100, TQFP-100	获取价格
EPF6016ATC100-3	ALTERA	Loadable PLD, CMOS, PQFP100, TQFP-100	获取价格
EPF6016ATC100-3N	ALTERA	Loadable PLD, PQFP100, TQFP-100	获取价格
EPF6016ATC144-1	ALTERA	Loadable PLD, CMOS, PQFP144, TQFP-144	获取价格
EPF6016ATC144-2N	ALTERA	Programmable Logic Device Family	获取价格

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