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DM74ALS74AN

更新时间： 2024-09-08 22:56:51
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 触发器锁存器逻辑集成电路光电二极管
页数 文件大小 规格书
7页 72K
描述
Dual D Positive-Edge-Triggered Flip-Flop with Preset and Clear

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DM74ALS74AN 技术参数

是否Rohs认证：符合生命周期：Obsolete
零件包装代码：DIP包装说明：0.300 INCH, PLASTIC, MS-001, DIP-14
针数：14Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：8.25
Is Samacsys：N系列：ALS
JESD-30 代码：R-PDIP-T14JESD-609代码：e3
长度：19.18 mm逻辑集成电路类型：D FLIP-FLOP
最大频率@ Nom-Sup：34000000 Hz最大I（ol）：0.008 A
位数：1功能数量：2
端子数量：14最高工作温度：70 °C
最低工作温度：输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装等效代码：DIP14,.3封装形状：RECTANGULAR
封装形式：IN-LINE峰值回流温度（摄氏度）：NOT APPLICABLE
电源：5 V最大电源电流（ICC）：4 mA
传播延迟（tpd）：18 ns认证状态：Not Qualified
座面最大高度：5.08 mm子类别：FF/Latches
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：NO
技术：TTL温度等级：COMMERCIAL
端子面层：Matte Tin (Sn)端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT APPLICABLE触发器类型：POSITIVE EDGE
宽度：7.62 mm最小 fmax：34 MHz
Base Number Matches：1

DM74ALS74AN 数据手册

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September 1986  
Revised February 2000  
DM74ALS74A  
Dual D Positive-Edge-Triggered Flip-Flop  
with Preset and Clear  
General Description  
Features  
■ Switching specifications at 50 pF  
The DM74ALS74A contains two independent positive  
edge-triggered flip-flops. Each flip-flop has individual D,  
clock, clear and preset inputs, and also complementary Q  
and Q outputs.  
■ Switching specifications guaranteed over full tempera-  
ture and VCC range  
■ Advanced oxide-isolated, ion-implanted Schottky TTL  
process  
Information at input D is transferred to the Q output on the  
positive going edge of the clock pulse. Clock triggering  
occurs at a voltage level of the clock pulse and is not  
directly related to the transition time of the positive going  
pulse. When the clock input is at either the HIGH or LOW  
level, the D input signal has no effect.  
■ Functionally and pin-for-pin compatible with Schottky  
and LS TTL counterpart  
■ Improved AC performance over LS74 at approximately  
half the power  
Asynchronous preset and clear inputs will set or clear Q  
output respectively upon the application of low level signal.  
Ordering Code:  
Order Number  
DM74ALS74AM  
DM74ALS74ASJ  
DM74ALS74AN  
Package Number Package Description  
M14A  
M14D  
N14A  
14-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-012, 0.150 Narrow  
14-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide  
14-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide  
Devices also available in Tape and Reel. Specify by appending the suffix letter “X” to the ordering code.  
Connection Diagram  
Function Table  
Inputs  
Outputs  
PR  
L
CLR  
CLK  
X
D
X
X
X
H
L
Q
H
L
Q
L
H
L
H
L
X
H
L
X
H (Note 1) H (Note 1)  
H
H
H
H
H
H
↑
H
L
L
H
↑
L
X
Q0  
Q 0  
L = LOW State  
H = HIGH State  
X = Don't Care  
↑ = Positive Edge Transition  
= Previous Condition of Q  
Q
0
Note 1: This condition is nonstable; it will not persist when preset and clear  
inputs return to their inactive (HIGH) level. The output levels in this condi-  
tion are not guaranteed to meet the V  
specification.  
OH  
© 2000 Fairchild Semiconductor Corporation  
DS006109  
www.fairchildsemi.com  
1234567

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DM74ALS74AN 替代型号

型号 品牌 替代类型 描述 数据表
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