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CY7C016A-20ACT

更新时间： 2024-11-07 17:50:15

品牌	Logo	应用领域
赛普拉斯 - CYPRESS		静态存储器内存集成电路
页数	文件大小	规格书
20页	2676K
描述
Dual-Port SRAM, 16KX9, 20ns, CMOS, PQFP80, PLASTIC, TQFP-80

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CY7C016A-20ACT 技术参数

生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	LQFP,	针数：	80
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.32.00.41	风险等级：	5.78
最长访问时间：	20 ns	JESD-30 代码：	S-PQFP-G80
长度：	14 mm	内存密度：	147456 bit
内存集成电路类型：	DUAL-PORT SRAM	内存宽度：	9
功能数量：	1	端子数量：	80
字数：	16384 words	字数代码：	16000
工作模式：	ASYNCHRONOUS	最高工作温度：	70 °C
最低工作温度：		组织：	16KX9
封装主体材料：	PLASTIC/EPOXY	封装代码：	LQFP
封装形状：	SQUARE	封装形式：	FLATPACK, LOW PROFILE
并行/串行：	PARALLEL	认证状态：	Not Qualified
座面最大高度：	1.6 mm	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	4.5 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	QUAD
宽度：	14 mm	Base Number Matches：	1

CY7C016A-20ACT 数据手册

CY7C006A

CY7C007A

CY7C017A32K/16K

x 8, 32K x 9

Dual-Port Static RAM

CY7C006A/CY7C007A

CY7C016A/CY7C017A

32K/16K x 8, 32K x 9

Dual-Port Static RAM

Features

• True dual-ported memory cells which allow

• Automatic power-down

simultaneous access of the same memory location

• Expandable data bus to 16/18 bits or more using

Master/Slave chip select when using more than one

device

• 16K x 8 organization (CY7C006A)

• 32K x 8 organization (CY7C007A)

• 16K x 9 organization (CY7C016A)

• 32K x 9 organization (CY7C017A)

• 0.35-micron CMOS for optimum speed/power

• High-speed access: 12^[1]/15/20 ns

• Low operating power

• On-chip arbitration logic

• Semaphores included to permit software handshaking

between ports

• INT flags for port-to-port communication

• Pin select for Master or Slave

• Commercial temperature range

— Active: I_CC= 180 mA (typical)

— Standby: I_SB3= 0.05 mA (typical)

• Fully asynchronous operation

• Available in 68-pin PLCC (CY7C006A, CY7C007A and

CY7C017A), 64-pin TQFP (CY7C006A), and in 80-pin

TQFP (CY7C007A and CY7C016A)

• Pb-Free packages available

Logic Block Diagram

R/W_L

CE_L

R/W_R

CE_R

OE_L

OE_R

8/9

[2]

8/9

[2]

I/O_0L–I/O_7/8L

I/O_0R–I/O_7/8R

I/O

Control

I/O

Control

14/15

Address

Decode

Address

Decode

True Dual-Ported

[4]

A_0L–A_13/14L

A_0R–A_13/14R

RAM Array

14/15

[4]

_0L–A_13/14L

A_0R–A_13/14R

CE_R

CE_L

Interrupt

Semaphore

Arbitration

OE_L

OE_R

R/W_L

SEM_L

R/W_R

SEM_R

^[3]BUSY_R

INT_R

[3]

BUSY_L

INT_L

M/S

Notes:

1. See page 7 for Load Conditions.

2. I/O –I/O for x8 devices; I/O –I/O for x9 devices.

3. BUSY is an output in master mode and an input in slave mode.

4. A –A for 16K; A –A for 32K devices.

Cypress Semiconductor Corporation

Document #: 38-06045 Rev. *D

•

198 Champion Court

•

San Jose, CA 95134-1709

•

408-943-2600

Revised August 11, 2005

[+] Feedback

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型号	品牌	获取价格	描述	数据表
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