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CY2XL12ZXIT

更新时间： 2024-09-30 19:35:23

品牌	Logo	应用领域
赛普拉斯 - CYPRESS		时钟光电二极管外围集成电路晶体
页数	文件大小	规格书
17页	1820K
描述
Clock Generator, CMOS, PDSO8, TSSOP-8

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CY2XL12ZXIT 技术参数

生命周期：	Active	包装说明：	TSSOP-8
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.77
其他特性：	IT ALSO OPERATES AT 3.3V NOM SUPPLY	JESD-30 代码：	R-PDSO-G8
长度：	4.4 mm	端子数量：	8
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
主时钟/晶体标称频率：	25 MHz	座面最大高度：	1.1 mm
最大供电电压：	2.625 V	最小供电电压：	2.375 V
标称供电电压：	2.5 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	宽度：	3 mm
uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER	Base Number Matches：	1

CY2XL12ZXIT 数据手册

CY2XL12

Low RMS Phase Jitter

Programmable LVDS Clock Generator

Low RMS Phase Jitter Programmable LVDS Clock Generator

Features

Functional Description

■ Programmable LVDS clock generator

■ Low RMS Phase Jitter

The CY2XL12 is

phase locked loop (PLL)-based

high-performance clock generator that uses Cypress’s low-noise

voltage control oscillator (VCO) technology to achieve less than

1 ps typical RMS phase jitter. The CY2XL12 uses an external

crystal reference input and drives one LVDS output pair having

programmable drive strength. CY2XL12 can be programmed as

Output Enable (OE), or Power Down (PD#), or Frequency Select

(FS) device by configuring the pin 5. The device can be

programmed either to operate at 3.3 V or at 2.5 V.

■ Available output frequencies: 50 MHz to 700 MHz

■ Package: Pb-free 8-pin thin shrunk small outline package

(TSSOP)

■ Supply voltage: 3.3 V or 2.5 V

■ Temperature: Industrial

Logic Block Diagram

XIN

CLK

External

Crystal

CRYSTAL

OSCILLATOR

LOW-NOISE

OUTPUT

DIVIDER

PLL

CLK#

XOUT

OE / PD# / FS

Cypress Semiconductor Corporation

Document Number: 001-63176 Rev. *E

•

198 Champion Court

•

San Jose, CA 95134-1709

•408-943-2600

Revised September 26, 2016

12 3 4 5 6 7...17

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型号	品牌	获取价格	描述	数据表
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