CY29940AC-1

更新时间： 2024-09-24 02:51:23

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赛普拉斯 - CYPRESS		时钟
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2.5V or 3.3V, 200-MHz 1:18 Clock Distribution Buffer

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CY29940AC-1 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	QFP	包装说明：	LQFP, QFP32,.35SQ,32
针数：	32	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.7
其他特性：	ALSO OPERATES WITH 3.3V SUPPLY	系列：	29940
输入调节：	DIFFERENTIAL MUX	JESD-30 代码：	S-PQFP-G32
JESD-609代码：	e0	长度：	7 mm
逻辑集成电路类型：	LOW SKEW CLOCK DRIVER	最大I（ol）：	0.02 A
功能数量：	1	反相输出次数：
端子数量：	32	实输出次数：	18
最高工作温度：	70 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	LQFP
封装等效代码：	QFP32,.35SQ,32	封装形状：	SQUARE
封装形式：	FLATPACK, LOW PROFILE	峰值回流温度（摄氏度）：	240
电源：	2.5/3.3 V	Prop。Delay @ Nom-Sup：	5.2 ns
传播延迟（tpd）：	5.2 ns	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.15 ns	座面最大高度：	1.6 mm
子类别：	Clock Drivers	最大供电电压 (Vsup)：	2.625 V
最小供电电压 (Vsup)：	2.375 V	标称供电电压 (Vsup)：	2.5 V
表面贴装：	YES	温度等级：	COMMERCIAL
端子面层：	TIN LEAD	端子形式：	GULL WING
端子节距：	0.8 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	30	宽度：	7 mm
Base Number Matches：	1

CY29940AC-1 数据手册

CY29940-1

2.5V or 3.3V, 200-MHz

1:18 Clock Distribution Buffer

Description

Features

• 200-MHz clock support

The CY29940-1 is a low-voltage 200-MHz clock distribution

buffer with the capability to select either a differential LVPECL-

or a LVCMOS/LVTTL-compatible input clock. The two clock

sources can be used to provide for a test clock as well as the

primary system clock. All other control inputs are

LVCMOS/LVTTL-compatible. The eighteen outputs are 2.5V

or 3.3V LVCMOS/LVTTL-compatible and can drive 50Ω series

or parallel terminated transmission lines. For series terminated

transmission lines, each output can drive one or two traces

giving the device an effective fanout of 1:36. Low

output-to-output skews make the CY29940-1 an ideal clock

distribution buffer for nested clock trees in the most

demanding of synchronous systems.

• LVPECL or LVCMOS/LVTTL clock input

• LVCMOS/LVTTL-compatible inputs

• 18 clock outputs: drive up to 36 clock lines

• 150 ps max. output-to-output skew

• 23Ω output impedance

• Dual or single supply operation:

— 3.3V core and 3.3V outputs

— 3.3V core and 2.5V outputs

— 2.5V core and 2.5V outputs

• Pin-compatible with MPC940L, MPC9109

• Available in commercial and industrial temperature

ranges

• 32-pin TQFP package

Block Diagram

Pin Configuration

VDD

VDDC

32 31

27 26

VSS

PECL_CLK

PECL_CLK#

TCLK

Q0-Q17

TCLK_SEL

PECL_CLK

VDD

TCLK

CY29940-1

TCLK_SEL

PECL_CLK#

VDD

Q10

Q11

VSS

VDDC

14 15

Cypress Semiconductor Corporation

Document #: 38-07487 Rev. **

•

3901 North First Street

•

San Jose, CA 95134

•

408-943-2600

Revised January 28, 2003

12 3 4 5 6 7

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