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CY2547QIXXX PDF预览

CY2547QIXXX

更新时间： 2024-11-18 21:02:23
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 时钟外围集成电路晶体
页数 文件大小 规格书
20页 523K
描述
Processor Specific Clock Generator, 166MHz, CMOS, QFN-24

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CY2547QIXXX 技术参数

是否Rohs认证： 符合生命周期：Active
包装说明：HVQCCN,Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.77JESD-30 代码：S-XQCC-N24
长度：4 mm端子数量：24
最高工作温度：85 °C最低工作温度：-40 °C
最大输出时钟频率：166 MHz封装主体材料：UNSPECIFIED
封装代码：HVQCCN封装形状：SQUARE
封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE主时钟/晶体标称频率：48 MHz
座面最大高度：0.6 mm最大供电电压：1.95 V
最小供电电压：1.65 V标称供电电压：1.8 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子形式：NO LEAD
端子节距：0.5 mm端子位置：QUAD
宽度：4 mmuPs/uCs/外围集成电路类型：CLOCK GENERATOR, PROCESSOR SPECIFIC
Base Number Matches：1

CY2547QIXXX 数据手册

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CY2545/CY2547  
Quad PLL Programmable Spread Spectrum  
Clock Generator with Serial I2C Interface  
Quad PLL Programmable Spread Spectrum Clock Generator with Serial I2  
C Interface  
■ Glitch-free outputs while frequency switching  
■ 24-pin QFN package  
Features  
■ Four fully integrated phase locked loops (PLLs)  
■ Commercial and industrial temperature ranges  
■ Input frequency range  
❐ External crystal: 8 to 48 MHz  
❐ External reference: 8 to 166 MHz clock  
Benefits  
■ Multiple high performance PLLs allow synthesis of unrelated  
frequencies  
■ Wide operating output frequency range  
❐ 3 to 166 MHz  
■ Nonvolatile programming for personalization of PLL  
frequencies, spread spectrum characteristics, drive strength,  
crystal load capacitance, and output frequencies  
■ Serial programmable over 2-wire I2C interface  
■ Programmable spread spectrum with center and down spread  
option and Lexmark and Linear modulation profiles  
■ Application specific programmable EMI reduction using Spread  
Spectrum for clocks  
■ VDD supply voltage options:  
❐ 2.5 V, 3.0 V, and 3.3 V for CY2545  
❐ 1.8 V for CY2547  
■ Programmable PLLs for system frequency margin tests  
■ Meets critical timing requirements in complex system designs  
■ Selectable output clock voltages independent of VDD supply:  
❐ 2.5 V, 3.0 V, and 3.3 V for CY2545  
❐ 1.8 V for CY2547  
■ Suitability for PC, consumer, portable, and networking  
applications  
■ Capable of zero PPM frequency synthesis error  
■ Power-down, output enable, or frequency select features  
■ Low jitter, high accuracy outputs  
■ Uninterrupted system operation during clock frequency switch  
■ Application compatibility in standard and low power systems  
■ Abilitytosynthesizenonstandard frequencies with Fractional-N  
capability  
Functional Description  
■ Up to eight clock outputs with programmable drive strength  
For a complete list of related documentation, click here.  
Logic Block Diagram  
CLKIN/RST  
Crossbar  
Switch  
CLK1  
XIN/  
EXCLKIN  
Bank  
1
CLK2  
Output  
OSC  
PLL1  
XOUT  
Dividers  
and  
CLK3  
CLK4  
CLK5  
CLK6  
CLK7  
CLK8  
Bank  
2
Drive  
PLL2  
Strength  
Control  
MUX  
and  
Control  
Logic  
FS  
Bank  
3
PLL3  
(SS)  
SCL  
SDA  
PLL4  
(SS)  
I2C  
PD#/OE  
SSON  
Cypress Semiconductor Corporation  
Document Number: 001-13196 Rev. *F  
•
198 Champion Court  
•
San Jose, CA 95134-1709  
•
408-943-2600  
Revised March 14, 2016  
1234567...20

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