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CY25482SXCT

更新时间： 2024-11-18 09:41:27

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赛普拉斯 - CYPRESS		时钟发生器
页数	文件大小	规格书
14页	208K
描述
Two PLL Programmable Clock Generator with Spread Spectrum

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CY25482SXCT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	SOIC
包装说明：	SOP, SOP8,.25	针数：	8
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.31.00.01	风险等级：	5.18
其他特性：	IT CAN ALSO OPERATES ON 3 OR 3.3 V SUPPLY	JESD-30 代码：	R-PDSO-G8
JESD-609代码：	e4	长度：	4.889 mm
湿度敏感等级：	3	端子数量：	8
最高工作温度：	70 °C	最低工作温度：
最大输出时钟频率：	166 MHz	封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装等效代码：	SOP8,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	260	电源：	2.5/3.3 V
主时钟/晶体标称频率：	48 MHz	认证状态：	Not Qualified
座面最大高度：	1.727 mm	子类别：	Clock Generators
最大供电电压：	3.6 V	最小供电电压：	2.25 V
标称供电电压：	2.5 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	20	宽度：	3.8985 mm
uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER	Base Number Matches：	1

CY25482SXCT 数据手册

CY25402/CY25422/CY25482

Two PLL Programmable Clock Generator

with Spread Spectrum

■ AbilitytosynthesizenonstandardfrequencieswithFractional-N

capability

Features

■ Two fully integrated phase locked loops (PLLs)

■ Three clock outputs with programmable drive strength

■ Glitch-free outputs while frequency switching

■ 8-pin small outline integrated circuit (SOIC) package

■ Commercial and Industrial temperature ranges

■ Input frequency range

❐ External crystal: 8 to 48 MHz

❐ External reference: 8 to 166 MHz clock

■ Reference clock input voltage range

❐ 2.5 V, 3.0 V, and 3.3 V for CY25482

❐ 1.8 V for CY25402 and CY25422

Benefits

■ Wide operating output frequency range

❐ 3 to 166 MHz

■ Multiple high performance PLLs allow synthesis of unrelated

frequencies

■ Nonvolatile programming for personalization of PLL

frequencies, spread spectrum characteristics, drive strength,

crystal load capacitance, and output frequencies

■ Programmable spread spectrum with center and down spread

option and lexmark and linear modulation profiles

■ V_DDsupply voltage options:

❐ 2.5 V, 3.0 V, and 3.3 V for CY25402 and CY25482

❐ 1.8 V for CY25422

■ Application specific programmableEMIreduction usingspread

spectrum for clocks

■ Programmable PLLs for system frequency margin tests

■ Selectable output clock voltages independent of V_DD

❐ 2.5 V, 3.0 V, and 3.3 V for CY25402 and CY25482

❐ 1.8 V for CY25422

■ Meets critical timing requirements in complex system designs

■ Suitability for PC, consumer, portable, and networking

applications

■ Frequency select feature with option to select four different

frequencies

■ Capable of zero parts per million (PPM) frequency synthesis

■ Power-down, Output Enable, and SS ON/OFF controls

■ Low jitter, high accuracy outputs

error

■ Uninterrupted system operation during clock frequency switch

■ Application compatibility in standard and low power systems

Block Diagram

Crossbar

XIN/

CLK1

Output

Switch

EXCLKIN

PLL 1

(SS)

OSC

Dividers

and

XOUT

MUX

and

REFOUT

CLK2

Drive

PLL 2

(SS)

Control

Logic

Strength

Control

FS0

FS1

SSON

PD#/OE

Cypress Semiconductor Corporation

Document #: 001-12565 Rev. *F

•

198 Champion Court

•

San Jose, CA 95134-1709

•

408-943-2600

Revised April 20, 2011

12 3 4 5 6 7...14

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