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CDC330DW PDF预览

CDC330DW

更新时间： 2024-11-20 14:48:27
品牌 Logo 应用领域
德州仪器 - TI 驱动信息通信管理光电二极管逻辑集成电路
页数 文件大小 规格书
8页 123K
描述
Clock Driver With 3-State Outputs 24-SOIC

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CDC330DW 技术参数

是否无铅：含铅是否Rohs认证：不符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：PLASTIC, SOIC-24针数：24
Reach Compliance Code：not_compliantHTS代码：8542.39.00.01
风险等级：5.85Is Samacsys：N
系列：330输入调节：STANDARD
JESD-30 代码：R-PDSO-G24长度：15.365 mm
逻辑集成电路类型：LOW SKEW CLOCK DRIVER最大I（ol）：0.032 A
功能数量：1反相输出次数：
端子数量：24实输出次数：10
最高工作温度：70 °C最低工作温度：
输出特性：3-STATE封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP24,.4
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
Prop。Delay @ Nom-Sup：11 ns传播延迟（tpd）：11 ns
认证状态：Not QualifiedSame Edge Skew-Max（tskwd）：0.5 ns
座面最大高度：2.65 mm子类别：Clock Drivers
最大供电电压 (Vsup)：5.25 V最小供电电压 (Vsup)：4.75 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：BICMOS温度等级：COMMERCIAL
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7.52 mm最小 fmax：100 MHz
Base Number Matches：1

CDC330DW 数据手册

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CDC330  
CLOCK DRIVER  
WITH 3-STATE OUTPUTS  
SCAS329A – OCTOBER 1993 – REVISED MARCH 1994  
DW PACKAGE  
(TOP VIEW)  
• Low Output Skew, Low Pulse Skew for  
Clock-Distribution and Clock-Generation  
Applications  
GND  
1Y1  
1Y2  
GND  
2Q1  
2OE  
2A  
1OE  
1Y3  
1A  
1
2
3
4
5
6
7
8
9
24  
23  
22  
21  
20  
19  
18  
17  
16  
• TTL-Compatible Inputs and Outputs  
• Two Banks Distribute One Clock Input to  
Three Same-Frequency Clock Outputs  
V
CC  
• One Bank Distributes One Clock Input to  
PRE  
2Q3  
GND  
2Q4  
Four Half-Frequency Clock Outputs  
• Internal Power-Up Circuit  
2Q2  
GND  
• Distributed V  
and Ground Pins Reduce  
CC  
V
Switching Noise  
CC  
3Y1 10  
3Y2  
15 3OE  
• Symmetrical Output Drive (–32-mA I  
,
OH  
3Y3  
3A  
11  
12  
14  
13  
32-mA I  
)
OL  
GND  
• State-of-the-Art EPIC-ΙΙB BiCMOS Design  
Significantly Reduces Power Dissipation  
• Packaged in Plastic Small-Outline Package  
description  
The CDC330 is a high-performance, low-skew clock driver. It is specifically designed for applications requiring  
output signals at both the primary clock frequency and one-half the primary clock frequency.  
This device contains two banks that fan out one input to three same-frequency outputs and one bank that fans  
out one input to four half-frequency outputs with minimum skew for clock distribution. Each bank of Y outputs  
switch in phase and at the same frequency as its clock (A) input. The four Q outputs switch at one-half the  
frequency of their clock (2A) input.  
When the output-enable (2OE) input is low and the preset (PRE) input is high, the Q outputs toggle on  
high-to-low transitions of 2A. Taking PRE low asynchronously presets the Q outputs to the high level. When a  
bank’s OE input is high, the outputs are in the high-impedance state.  
The CDC330 is characterized for operation from 0°C to 70°C.  
FUNCTION TABLES  
INPUTS  
OUTPUTS  
nY1–nY3  
nOE  
nA  
X
H
Z
L
L
L
L
H
H
n = 1, 3  
INPUTS  
OUTPUTS  
2Q1–2Q3  
2OE  
H
PRE  
X
2A  
X
Z
H
L
L
L
L
H
↓
Toggle  
EPIC-ΙΙB is a trademark of Texas Instruments Incorporated.  
Copyright 1994, Texas Instruments Incorporated  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
testing of all parameters.  
2–1  
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
12345678

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型号 品牌 获取价格 描述 数据表
CDC330DWR TI

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 		Clock Driver With 3-State Outputs 24-SOIC
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 		CDC SERIES, LOW SKEW CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20, GREEN,

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