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C9827JT

更新时间： 2024-11-23 23:39:19
品牌 Logo 应用领域
其他 - ETC 晶体时钟发生器外围集成电路光电二极管
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25页 171K
描述
CPU SYSTEM CLOCK GENERATOR|TSSOP|56PIN|PLASTIC

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C9827J  
High Performance Pentium® 4 Clock Synthesizer  
•
•
•
•
•
•
3 differential CPU clocks  
Product Features  
SMBus Support with read back capabilities  
Spread Spectrum EMI Reduction  
Dial-a-Frequency™ features  
Dial-a-dB™ features  
•
•
•
Supports Pentium® 4 type CPUs  
3.3 Volt Power supply  
10 copies of PCI clocks  
56 Pin SSOP and TSSOP package  
Frequency Table  
S2  
S1 S0 CPU  
(0:2)  
3V66  
66BUFF(0:2)/  
3V66(0:4)  
66IN  
66IN/  
3V66-5  
66MHz clock input  
66MHz clock input  
66MHz clock input  
66MHZ clock input  
PCI_F  
PCI  
REF  
USB/  
DOT  
48M  
48M  
48M  
48M  
48M  
48M  
48M  
48M  
Hi-Z  
1
1
1
1
0
0
0
0
M
M
M
M
0
0
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
0
1
0
1
66M  
100M  
200M  
133M  
66M  
100M  
200M  
133M  
Hi-Z  
66M  
66M  
66M  
66M  
66M  
66M  
66M  
66M  
Hi-Z  
66IN/2  
66IN/2  
66IN/2  
66IN/2  
33 M  
33 M  
33 M  
33 M  
Hi-Z  
14.318M  
14.318M  
14.318M  
14.318M  
14.318M  
14.318M  
14.318M  
14.318M  
Hi-Z  
66IN  
66IN  
66IN  
66M  
66M  
66M  
66M  
Hi-Z  
66M  
66M  
66M  
66M  
Hi-Z  
TCLK/4  
50M  
55.5M  
TCLK/2  
150M  
166.6M  
TCLK/4  
50M  
55.5M  
TCLK/4  
50M  
55.5M  
TCLK/8  
25M  
27.7M  
TCLK  
14.318M  
14.318M  
TCLK/2  
48M  
48M  
Note: TCLK is a test clock over driven on the XTAL_IN input during test mode. M= driven to a level between 1.0 and 1.8 Volts  
If the S2 pin is at an M level during power up, a 0 state will be latched into the devices internal state register.  
Block Diagram  
Pin Configuration  
XIN  
XOUT  
REF  
VDD  
XIN  
XOUT  
VSS  
PCIF0  
PCIF1  
PCIF2  
VDD  
VSS  
PCI0  
PCI1  
PCI2  
PCI3  
VDD  
VSS  
PCI4  
PCI5  
PCI6  
VDD  
VSS  
1
2
3
4
5
6
7
8
56  
55  
54  
53  
52  
51  
50  
49  
48  
47  
46  
45  
44  
43  
42  
41  
40  
39  
38  
37  
36  
35  
34  
33  
32  
31  
30  
29  
REF  
S1  
S0  
CPU_STP#  
CPU0  
CPU/0  
VDD  
CPU1  
CPU/1  
VSS  
VDD  
CPU2  
CPU/2  
MULT0  
IREF  
VSSIREF  
S2  
48MUSB  
48MDOT  
VDD  
CPU(0:2)  
CPU/(0:2)  
PLL1  
CPU_STP#  
IREF  
VSSIREF  
9
3V66_0  
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
25  
26  
27  
28  
S(0:2)  
3V66_1/VCH  
MULT0  
VTT_PG#  
PCI_STP#  
/2  
PCI(0:6)  
PCI_F(0:2)  
48M USB  
48M DOT  
PLL2  
PD#  
66B0/3V66_2  
66B1/3V66_3  
66B2/3V66_4  
66IN/3V66_5  
PD#  
VSS  
WD  
Logic  
3V66_1/VCH  
PCI_STP#  
3V66_0  
VDD  
VSS  
SCLK  
I2C  
Logic  
SDATA  
SCLK  
VDDA  
VSSA  
VTT_PG#  
66B[0:2]/3V66[2:4]  
66IN/3V66-5  
Power  
Up Logic  
VDDA  
SDATA  
Cypress Semiconductor Corporation  
525 Los Coches St.  
Milpitas, CA 95035. Tel: 408-263-6300, Fax: 408-263-6571  
http://www.cypress.com  
Document#: 38-07107 Rev. **  
5/24/2001  
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与C9827JT相关器件

型号 品牌 获取价格 描述 数据表
C9827JY ETC

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 		CPU SYSTEM CLOCK GENERATOR|SSOP|56PIN|PLASTIC
C9829BY CYPRESS

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 		Processor Specific Clock Generator, CMOS, PDSO56, SSOP-56
C982P PERKINELMER

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 		CHANNEL PHOTO MULTIPLIER
C983 PERKINELMER

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 		CHANNEL PHOTO MULTIPLIER
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 		Processor Specific Clock Generator, CMOS, PDSO48, SSOP-48
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 		CPU SYSTEM CLOCK GENERATOR|SSOP|56PIN|PLASTIC
C9834AYB CYPRESS

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C9835 CYPRESS

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 		Low-EMI Clock Generator for Intel Mobile 133-MHz/3 SO-DIMM Chipset Systems
C9835AT CYPRESS

获取价格

 		Processor Specific Clock Generator, CMOS, PDSO56, TSSOP-56

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