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74LVT162373DGG

更新时间： 2024-12-01 11:13:03
品牌 Logo 应用领域
安世 - NEXPERIA 驱动信息通信管理光电二极管逻辑集成电路
页数 文件大小 规格书
13页 211K
描述
3.3 V 16-bit transparent D-type latch with 30 Ohm termination resistors; 3-stateProduction

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74LVT162373DGG 技术参数

是否Rohs认证：符合生命周期：Active
包装说明：TSSOP-48Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.24
Is Samacsys：N系列：LVT
JESD-30 代码：R-PDSO-G48JESD-609代码：e4
长度：12.5 mm逻辑集成电路类型：BUS DRIVER
湿度敏感等级：1位数：8
功能数量：2端口数量：2
端子数量：48最高工作温度：85 °C
最低工作温度：-40 °C输出特性：3-STATE WITH SERIES RESISTOR
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：260
传播延迟（tpd）：5.8 ns认证状态：Not Qualified
座面最大高度：1.2 mm最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：2.7 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：BICMOS
温度等级：INDUSTRIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：0.5 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：6.1 mmBase Number Matches：1

74LVT162373DGG 数据手册

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74LVT162373  
3.3 V 16-bit transparent D-type latch with 30 Ω termination  
resistors; 3-state  
Rev. 2 — 1 October 2018  
Product data sheet  
1. General description  
The 74LVT162373 is a high-performance BiCMOS product designed for VCC operation at 3.3 V.  
This device is a 16-bit transparent D-type latch with non-inverting 3-state bus compatible outputs.  
The device can be used as two 8-bit latches or one 16-bit latch. When latch enable (LE) input is  
HIGH, the Q outputs follow the date (D) inputs. When latch enable is taken LOW, the Q outputs are  
latched at the levels of the D inputs one setup time prior to the HIGH-to-LOW transition.  
The 74LVT162373 is designed with 30 Ω series resistance in both the HIGH-state and LOW-state  
of the output. This design reduces the noise in applications such as memory address drivers, clock  
drivers and bus receivers and transmitters.  
2. Features and benefits  
•
•
16-bit transparent latch  
3-state buffers  
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•
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•
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•
Output capability: +12 mA/–12 mA  
TTL input and output switching levels  
Input and output interface capability to systems at 5 V supply  
Bus-hold data inputs eliminate the need for external pull-up resistors to hold unused inputs  
Live insertion/extraction permitted  
Outputs include series resistance of 30 Ω making external termination resistors unnecessary  
Power-up reset  
Power-up 3-state  
No bus current loading when output is tied to 5 V bus  
Latch-up protection:  
•
JESD78B Class II exceeds 500 mA  
•
ESD protection:  
•
•
HBM: JESD22-A114F exceeds 2000 V  
MM: JESD22-A115-A exceeds 200 V  
3. Ordering information  
Table 1. Ordering information  
Type number  
Package  
Temperature range Name  
Description  
Version  
74LVT162373DGG -40 °C to +85 °C  
TSSOP48  
plastic thin shrink small outline package;  
48 leads; body width 6.1 mm  
SOT362-1  
 
 
 
1234567...13

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